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pld

可編程邏輯器件英文全稱為：programmablelogicdevice即pld。pld是做為一種通用集成電路產生的，他的邏輯功能按照用戶對器件編程來確定。一般的pld的集成度很高，足以滿足設計一般的數字系統的需要。

可編輯程邏輯及IC開發領域的EDA工具介紹

EDA （Electronic Design Automation）即“電子設計自動化”，是指以計算機為工作平臺，以EDA軟件為開發環境，以硬件描述語言為設計語言，以可編程器件pld為實驗載體(包括Cpld、FPGA、Epld等)，以集成電路芯片為目標器件的電子產品自動化設計過程。“工欲善其事，必先利其器”，因此，EDA工具在電子系統設計中所占的份量越來越高。下面就介紹一些目前較為流行的EDA工具軟件。 pld 及IC設計開發領域的EDA工具，一般至少要包含仿真器（Simulator）、綜合器（Synthesizer）和配置器（Place and Routing, P&R）等幾個特殊的軟件包中的一個或多個，因此這一領域的EDA工具就不包括Protel、PSpice、Ewb等原理圖和PCB板設計及電路仿真軟件。目前流行的EDA工具軟件有兩種分類方法：一種是按公司類別進行分類，另一種是按功能進行劃分。若按公司類別分，大體可分兩類：一類是EDA 專業軟件公司，業內最著名的三家公司是Cadence、Synopsys和Mentor Graphics；另一類是pld器件廠商為了銷售其產品而開發的EDA工具，較著名的公司有Altera、Xilinx、lattice等。前者獨立于半導體器件廠商，具有良好的標準化和兼容性，適合于學術研究單位使用，但系統復雜、難于掌握且價格昂貴；后者能針對自己器件的工藝特點作出優化設計，提高資源利用率，降低功耗，改善性能，比較適合產品開發單位使用。若按功能分，大體可以分為以下三類。 (1) 集成的pld/FPGA開發環境由半導體公司提供，基本上可以完成從設計輸入（原理圖或HDL）→仿真→綜合→布線→下載到器件等囊括所有pld開發流程的所有工作。如Altera公司的MaxplusⅡ、QuartusⅡ，Xilinx公司的ISE，Lattice公司的 ispDesignExpert等。其優勢是功能全集成化，可以加快動態調試，縮短開發周期；缺點是在綜合和仿真環節與專業的軟件相比，都不是非常優秀的。 (2) 綜合類這類軟件的功能是對設計輸入進行邏輯分析、綜合和優化，將硬件描述語句（通常是系統級的行為描述語句）翻譯成最基本的與或非門的連接關系（網表），導出給pld/FPGA廠家的軟件進行布局和布線。為了優化結果，在進行較復雜的設計時，基本上都使用這些專業的邏輯綜合軟件，而不采用廠家提供的集成pld/FPGA開發工具。如Synplicity公司的Synplify、Synopsys公司的FPGAexpress、FPGA Compiler Ⅱ等。 (3) 仿真類這類軟件的功能是對設計進行模擬仿真，包括布局布線（P&R）前的“功能仿真”（也叫“前仿真”）和P&R后的包含了門延時、線延時等的“時序仿真”（也叫“后仿真”）。復雜一些的設計，一般需要使用這些專業的仿真軟件。因為同樣的設計輸入，專業軟件的仿真速度比集成環境的速度快得多。此類軟件最著名的要算Model Technology公司的Modelsim，Cadence公司的NC-Verilog/NC-VHDL/NC-SIM等。以上介紹了一些具代表性的EDA 工具軟件。它們在性能上各有所長，有的綜合優化能力突出，有的仿真模擬功能強，好在多數工具能相互兼容，具有互操作性。比如Altera公司的 QuartusII集成開發工具，就支持多種第三方的EDA軟件，用戶可以在QuartusII軟件中通過設置直接調用Modelsim和 Synplify進行仿真和綜合。如果設計的硬件系統不是很大，對綜合和仿真的要求不是很高，那么可以在一個集成的開發環境中完成整個設計流程。如果要進行復雜系統的設計，則常規的方法是多種EDA工具協調工作，集各家之所長來完成設計流程。

標簽： EDA 編輯邏輯

上傳時間： 2013-10-11

上傳用戶：1079836864
pld對FPGA數據加密

SRAM-based FPGAs are non-volatile devices. Upon powerup, They are required to be programmed from an external source. This procedure allows anyone to easily monitor the bit-stream, and clone the device. The problem then becomes how can you effectively protect your intellectual property from others in an architecture where the part is externally programmed?

標簽： FPGA pld 數據加密

上傳時間： 2013-10-20

上傳用戶：磊子226
電子工程師創新設計必備寶典之FPGA開發全攻略

2008年，我參加了幾次可編程器件供應商舉辦的技術研討會，讓我留下深刻印象的是參加這些研討會的工程師人數之多，簡直可以用爆滿來形容，很多工程師聚精會神地全天聽講，很少出現吃完午飯就閃人的現象，而且工程師們對研討會上展出的基于可編程器件的通信、消費電子、醫療電子、工業等解決方案也有濃厚的興趣，這和其他器件研討會形成了鮮明的對比。 Garnter和iSuppli公布的數據顯示：2008年，全球半導體整體銷售出現25年以來首次萎縮現象，但是，可編程器件卻還在保持了增長，預計2008年可編程邏輯器件(pld)市場銷售額增長7.6%，可編程器件的領頭羊美國供應商賽靈思公司2008年營業收入預計升6.5%！在全球經濟危機的背景下，這是非常驕人的業績！也足見可編程器件在應用領域的熱度沒有受到經濟危機的影響！這可能也解釋了為什么那么多工程師對可編程器件感興趣吧。在與工程師的交流中，我發現，很多工程師非常需要普及以FPGA為代表的可編程器件的應用開發知識，也有很多工程師苦于進階無門，缺乏專業、權威性的指導，在Google上搜索后，我發現很少有幫助工程師設計的FPGA電子書，即使有也只是介紹一些概念性的基礎知識，缺乏實用性和系統性，于是，我萌生了出版一本指導工程師FPGA應用開發電子書的想法，而且這個電子書要突出實用性，讓大家都可以免費下載，并提供許多技巧和資源信息，很高興美國賽靈思公司對這個想法給予了大力支持，賽靈思公司亞太區市場經理張俊偉小姐和高級產品經理梁曉明先生對電子書提出了寶貴的意見，并提供了大量FPGA設計資源，也介紹了一些FPGA設計高手參與了電子書的編撰，很短的時間內，一個電子書項目團隊組建起來，北京郵電大學的研究生田耘先生和賽靈思公司上海辦事處的蘇同麒先生等人都參與了電子書的編寫，他們是有豐富設計經驗的高手，在大家的共同努力下，這本凝結著智慧的FPGA電子書終于和大家見面了！我希望這本電子書可以成為對FPGA有興趣或正在使用FPGA進行開發的工程師的手頭設計寶典之一，也希望這個電子書可以對工程師們學習FPGA開發和進階有實用的幫助！如果可能，未來我們還將出版后續版本！

標簽： FPGA 電子工程師創新設計寶典

上傳時間： 2013-11-10

上傳用戶：wab1981
GAL編程器原理與應用技術

1986年以來，通用可重編程邏輯陣列（GAL）器件幾乎風靡整個可編程邏輯器件（pld）市場。GAL以其高性能、高可靠性、可擦除及輸出邏輯結構可組態的特性，博得了廣大用戶的偏愛。就歷史而言，CAL是在其它 pld器件的基礎上發展起來的。但是GAL不愧為目前最理想的pld邏輯芯片。

標簽： GAL 編程器應用技術

上傳時間： 2014-01-09

上傳用戶：宋桃子
新型GAL原理和應用

GAL(generic array logic)是美國晶格半導體公司(gem 0udu or)最新推出的可電擦寫、可重復編程、可加密的一種可編程邏輯器件(pld)。這是第二代PAL，亦是目前最理想的可多次編程的邏輯電路。它不象PAL是一次性編程，品種鄉也不像EPSOM 需要用紫外線照射擦除。GAL 電路能反復編程采用的是電擦除技術可隨時進行修改，其內部有一個特殊結構控制字，使它芯片類型少，功能全。目前普遍果用的芯片只有兩種：GAL16VS(20 g『腳)和GAL20V8 (24號『腳) 這兩種GAL能仿真所有的PAL，并能按設計者自己的需要構成各種功能的邏輯電瑞在研制開發新的電路系統時極為方便。

標簽： GAL

上傳時間： 2013-10-20

上傳用戶：9牛10
通用陣列邏輯GAL實現基本門電路的設計

通用陣列邏輯GAL實現基本門電路的設計一、實驗目的 1.了解GAL22V10的結構及其應用； 2.掌握GAL器件的設計原則和一般格式； 3.學會使用VHDL語言進行可編程邏輯器件的邏輯設計； 4.掌握通用陣列邏輯GAL的編程、下載、驗證功能的全部過程。二、實驗原理 1. 通用陣列邏輯GAL22V10 通用陣列邏輯GAL是由可編程的與陣列、固定（不可編程）的或陣列和輸出邏輯宏單元（OLMC）三部分構成。GAL芯片必須借助GAL的開發軟件和硬件，對其編程寫入后，才能使GAL芯片具有預期的邏輯功能。GAL22V10有10個I/O口、12個輸入口、10個寄存器單元，最高頻率為超過100MHz。 ispGAL22V10器件就是把流行的GAL22V10與ISP技術結合起來，在功能和結構上與GAL22V10完全相同，并沿用了GAL22V10器件的標準28腳PLCC封裝。ispGAl22V10的傳輸時延低于7.5ns，系統速度高達100MHz以上，因而非常適用于高速圖形處理和高速總線管理。由于它每個輸出單元平均能夠容納12個乘積項，最多的單元可達16個乘積項，因而更為適用大型狀態機、狀態控制及數據處理、通訊工程、測量儀器等領域。ispGAL22V10的功能框圖及引腳圖分別見圖1-1和1-2所示。另外，采用ispGAL22V10來實現諸如地址譯碼器之類的基本邏輯功能是非常容易的。為實現在系統編程，每片ispGAL22V10需要有四個在系統編程引腳，它們是串行數據輸入(SDI)，方式選擇(MODE)、串行輸出(SDO)和串行時鐘(SCLK)。這四個ISP控制信號巧妙地利用28腳PLCC封裝GAL22V10的四個空腳，從而使得兩種器件的引腳相互兼容。在系統編程電源為+5V，無需外接編程高壓。每片ispGAL22V10可以保證一萬次在系統編程。 ispGAL22V10的內部結構圖如圖1-3所示。 2.編譯、下載源文件用VHDL語言編寫的源程序，是不能直接對芯片編程下載的，必須經過計算機軟件對其進行編譯，綜合等最終形成pld器件的熔斷絲文件(通常叫做JEDEC文件，簡稱為JED文件)。通過相應的軟件及編程電纜再將JED數據文件寫入到GAL芯片，這樣GAL芯片就具有用戶所需要的邏輯功能。 3.工具軟件ispLEVER簡介 ispLEVER 是Lattice 公司新推出的一套EDA軟件。設計輸入可采用原理圖、硬件描述語言、混合輸入三種方式。能對所設計的數字電子系統進行功能仿真和時序仿真。編譯器是此軟件的核心，能進行邏輯優化，將邏輯映射到器件中去，自動完成布局與布線并生成編程所需要的熔絲圖文件。軟件中的Constraints Editor工具允許經由一個圖形用戶接口選擇I/O設置和引腳分配。軟件包含Synolicity公司的“Synplify”綜合工具和Lattice的ispVM器件編程工具，ispLEVER軟件提供給開發者一個簡單而有力的工具。

標簽： GAL 陣列邏輯門電路

上傳時間： 2013-11-17

上傳用戶：看到了沒有
8051接口VHDL代碼

pld與8051接口的參考設計 Xilinx提供

標簽： 8051 VHDL 接口代碼

上傳時間： 2013-11-05

上傳用戶：BIBI
Protel使用中的一些問題和解答

Q01、如何使一條走線至兩個不同位置零件的距離相同? 您可先在Design/Rule/High Speed/Matched Net Lengths的規則中來新增規則設定,最后再用Tools/EqualizeNet Lengths 來等長化即可。　 Q02、在SCHLIB中造一零件其PIN的屬性，如何決定是Passive, Input, I/O, Hi- Z,Power,…..？在HELP中能找到說明嗎？市面有關 SIM？pld？的書嗎？或貴公司有講義？你可在零件庫自制零件時點選零件Pin腳,并在Electrical Type里,可以自行設定PIN的屬性,您可參考臺科大的Protel sch 99se 里面有介紹關于SIM的內容。　 Q03、請問各位業界前輩,如何能順利讀取pcad8.6版的線路圖,煩請告知 Protel 99SE只能讀取P-CAD 2000的ASCII檔案格式,所以你必須先將P-CAD8.6版的格式轉為P-CAD 2000的檔案格式,才能讓Protel讀取。

標簽： Protel

上傳時間： 2013-11-07

上傳用戶：tangsiyun
superpro 280驅動及編程器軟件

已通過CE認證。（為什么要選擇經過CE認證的編程器？）程速度無與倫比,逼近芯片理論極限。基本配置48腳流行驅動電路。所選購的適配器都是通用的（插在DIP48鎖緊座上），即支持同封裝所有類型器件，48腳及以下DIP器件無需適配器直接支持。通用適配器保證快速新器件支持。I/O電平由DAC控制，直接支持低達1.5V的低壓器件。更先進的波形驅動電路極大抑制工作噪聲,配合IC廠家認證的算法,無論是低電壓器件、二手器件還是低品質器件均能保證極高的編程良品率。編程結果可選擇高低雙電壓校驗,保證結果持久穩固。支持FLASH、EPROM、EEPROM、MCU、pld等器件。支持新器件僅需升級軟件（免費）。可測試SRAM、標準TTL/COMS電路，并能自動判斷型號。自動檢測芯片錯插和管腳接觸不良,避免損壞器件。完善的過流保護功能,避免損壞編程器。邏輯測試功能。可測試和自動識別標準TTL/CMOS邏輯電路和用戶自定義測試向量的非標準邏輯電路。豐富的軟件功能簡化操作，提高效率，避免出錯，對用戶關懷備至。工程（Project）將用戶關于對象器件的各種操作、設置，包括器件型號設定、燒寫文件的調入、配置位的設定、批處理命令等保存在工程文件中，每次運行時一步進入寫片操作。器件型號選擇和文件載入均有歷史（History）記錄，方便再次選擇。批處理（Auto）命令允許用戶將擦除、查空、編程、校驗、加密等常用命令序列隨心所欲地組織成一步完成的單一命令。量產模式下一旦芯片正確插入CPU即自動啟動批處理命令，無須人工按鍵。自動序列號功能按用戶要求自動生成并寫入序列號。借助于開放的API用戶可以在線動態修改數據BUFFER，使每片芯片內容均不同。器件型號選錯，軟件按照實際讀出的ID提示相近的候選型號。自動識別文件格式, 自動提示文件地址溢出。軟件支持WINDOWS98/ME/NT/2000/XP操作系統（中英文）。器件型號編程(秒) 校驗(秒) P+V (s) Type 28F320W18 9 4.5 13.5 32Mb FLASH 28F640W30 18 9 27 64Mb FLASH AM29DL640E 38.3 10.6 48.9 64Mb FLASH MB84VD21182DA 9.6 2.9 12.5 16Mb FLASH MB84VD23280FA 38.3 10.6 48.9 64Mb FLASH LRS1381 13.3 4.6 19.9 32Mb FLASH M36W432TG 11.8 4.6 16.4 32Mb FLASH MBM29DL323TE 17.5 5.5 23.3 32Mb FLASH AT89C55WD 2.1 1 3.1 20KB MCU P89C51RD2B 4.6 0.9 5.5 64KB MCU

標簽： superpro 280 驅動編程器軟件

上傳時間： 2013-11-21

上傳用戶：xiaoyuer
增加ASCII.C的一個ASCI碼(7F),用于虛擬按鍵用修改UART串口的命令解析程序

增加ASCII.C的一個ASCI碼(7F),用于虛擬按鍵用修改UART串口的命令解析程序，修改RTC的pcf8563中斷部分。精簡IIC和smart_timer代碼,添加define.h的宏定義。修改system.c里的消息堆棧的宏定義增加ii.c函數,支持對eeprom的打包增加由pld或者GPIO輸出的模擬UART，在6個CLOCK下速度為57.6K 增加消息的優先級功能，消息類型的前4位為消息的優先級，后4位為消息的類型試用于初學單片機并且想更上一層樓的，或者有些基礎，想減少工作量的。

標簽： ASCII ASCI UART 7F

上傳時間： 2015-04-10

上傳用戶：athjac

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