這樣做的目的是要說明的應用提供 電子系統設計師的必要工具 設計和評估鎖相環（ PLL ）的 配置集成電路。
標簽： PLL 電子 系統設計師 鎖相環
上傳時間： 2013-12-24
上傳用戶：colinal
PLL的精深而扼要的講述，內容很好，我還沒有時間看就傳上來了
標簽： PLL
上傳時間： 2013-12-10
上傳用戶：wanghui2438
PLL的原理實驗以及數據分析,分析的很好打的四眼數據 下來看看吧
標簽： PLL 實驗 分 數據分析
上傳時間： 2017-06-16
上傳用戶：koulian
pll simulink models for practical nad basic understanding
標簽： understanding practical simulink models
上傳時間： 2013-12-02
上傳用戶：himbly
基于matlab的鎖相環（PLL）仿真源代碼
標簽： matlab PLL 鎖相環 仿真
上傳時間： 2017-07-08
上傳用戶：13517191407
MC33493 - PLL tuned UHF Transmitter for Data Transfer Applications - Motorola, Inc
標簽： Applications Transmitter Motorola Transfer
上傳時間： 2017-07-14
上傳用戶：頂得柱
高速DDR存儲器數據接口設計實例. 1. 將文件拷入硬盤 2. 產生DQS模塊 3. 產生DQ模塊 4. 產生PLL模塊 5. 拷貝以上步驟生成的文件到子目錄【Project】中 6. 打開子目錄【Project】中的DataPath.qpf工程，設計頂層模塊 7. 編譯并查看編譯結果
標簽： Project 模塊 DDR DQS
上傳時間： 2014-12-01
上傳用戶：sclyutian
PLL是數字鎖相環設計源程序, 其中, Fi是輸入頻率(接收數據), Fo(Q5)是本地輸出頻率. 目的是從輸入數據中提取時鐘信號(Q5), 其頻率與數據速率一致, 時鐘上升沿鎖定在數據的上升和下降沿上； 頂層文件是PLL.GDF
標簽： Q5 數據 PLL 輸入
上傳時間： 2017-07-24
上傳用戶：璇珠官人
Altera公司的FPGA器件內帶PLL的詳細中文使用手冊
標簽： Altera FPGA PLL 器件
上傳時間： 2013-12-26
上傳用戶：GavinNeko
thesis related to vlsi area, pll and frequency synthesizer
標簽： synthesizer frequency related thesis
上傳時間： 2017-08-18
上傳用戶：1427796291
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