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  • MT9P001-5100-rev-F圖像傳感器手冊

    MT9P001-5100-rev-F圖像傳感器手冊

    標簽： 圖像傳感器

    上傳時間： 2022-06-12

    上傳用戶：d1997wayne

  • LPC1788用戶手冊LPC178X_7X_rev3

    LPC178* 177*用戶手冊 LPC178x/7x 32-bit ARM Cortex-M3 microcontroller; up to 512 kB flash and 96 kB SRAM; USB Device/Host/OTG; Ethernet; LCD; EMC rev. 3 — 27 December 2011 Objective data sheet

    標簽： LPC X_rev 1788 178

    上傳時間： 2013-04-24

    上傳用戶：胡佳明胡佳明

  • MSP430FR57xx Family User手冊

    MSP430FR57xx Family User's Guide (rev. A)

    標簽： Family User MSP 430

    上傳時間： 2013-11-15

    上傳用戶：ainimao

  • MSP430F13x14x14x1 Device Erratasheet (rev. B)

    msp430單片機

    標簽： Erratasheet 14x x14 Device

    上傳時間： 2013-10-19

    上傳用戶：dick_sh

  • MSP430x13x, MSP430x14x, MSP430x14x1 Mixed Signal Microcontroller (rev. F)

    TI公司低功耗單片機MSP430系列。

    標簽： MSP 430 Microcontroller Signal

    上傳時間： 2013-11-23

    上傳用戶：非衣2016

  • XAPP740利用AXI互聯設計高性能視頻系統

    This application note covers the design considerations of a system using the performance features of the LogiCORE™ IP Advanced eXtensible Interface (AXI) Interconnect core. The design focuses on high system throughput through the AXI Interconnect core with F MAX  and area optimizations in certain portions of the design. The design uses five AXI video direct memory access (VDMA) engines to simultaneously move 10 streams (five transmit video streams and five receive video streams), each in 1920 x 1080p format, 60 Hz refresh rate, and up to 32 data bits per pixel. Each VDMA is driven from a video test pattern generator (TPG) with a video timing controller (VTC) block to set up the necessary video timing signals. Data read by each AXI VDMA is sent to a common on-screen display (OSD) core capable of multiplexing or overlaying multiple video streams to a single output video stream. The output of the OSD core drives the DVI video display interface on the board. Performance monitor blocks are added to capture performance data. All 10 video streams moved by the AXI VDMA blocks are buffered through a shared DDR3 SDRAM memory and are controlled by a MicroBlaze™ processor. The reference system is targeted for the Virtex-6 XC6VLX240TFF1156-1 FPGA on the Xilinx® ML605 rev D evaluation board

    標簽： XAPP 740 AXI 互聯

    上傳時間： 2013-11-14

    上傳用戶：fdmpy

  • 數據分析儀說明書

    User Manualrev. 1.2SmartRF® CC2420DK: Packet Sniffer for IEEE 802.15.4 and ZigBee Table of contents1 INTRODUCTION...............................................................................................31.1 HARDWARE PLATFORM.......................................................................................31.2 SOFTWARE.........................................................................................................32 USER INTERFACE..........................................................................................42.1 MENUS AND TOOLBARS.......................................................................................62.2 SETUP................................................................................................................62.3 SELECT FIELDS...................................................................................................72.3.1 Tips............................................................................................................72.4 PACKET DETAILS.................................................................................................72.5 ADDRESS BOOK..................................................................................................92.5.1 Tips............................................................................................................92.6 DISPLAY FILTER................................................................................................102.7 TIME LINE.........................................................................................................103 HELP....................................................................................................................114 TROUBLESHOOTING..................................................................................125 GENERAL INFORMATION........................................................................135.1 DOCUMENT HISTORY........................................................................................135.2 DISCLAIMER......................................................................................................135.3 TRADEMARKS...................................................................................................136 ADDRESS INFORMATION........................................................................14

    標簽： 數據 分析儀 說明書

    上傳時間： 2014-01-14

    上傳用戶：zhangyi99104144

  • 71M6541演示板用戶手冊

    The Maxim Integrated 71M6541-DB rev 3.0 Demo Board is a demonstration board for evaluating the 71M6541 device for single-phase electronic energy metering applications in conjunction with the Remote Sensor Inter-face. It incorporates a 71M6541 integrated circuit, a 71M6601 Remote Interface IC, peripheral circuitry such as a serial EEPROM, emulator port, and on-board power supply. A serial to USB converter allows communication to a PC through a USB port. The Demo Board allows the evaluation of the 71M6541 energy meter chip for measurement accuracy and overall system use.

    標簽： 71M6541 演示板 用戶手冊

    上傳時間： 2013-11-06

    上傳用戶：雨出驚人love

  • arm7tdmi介紹

    介紹這一章介紹ARMTDMI-S 處理器包含以下小節􀁺􀀃 關于ARM7TDMI-S 處理器􀁺􀀃 ARM7TDMI-S 結構􀁺􀀃 ARM7TDMI-S 模塊內核和功能框圖􀁺􀀃 ARM7TDMI-S 指令集匯總􀁺􀀃 rev 3a 和rev 4 之間的差異1.1 關于ARM7TDMI-S 處理器ARM7TDMI-S 處理器是ARM 通用32 位微處理器家族的成員之一ARM 處理器具有優異的性能但功耗卻很低使用門的數量也很少ARM 結構是基于精簡指令集計算機(RISC)原理而設計的指令集和相關的譯碼機制比復雜指令集計算機要簡單得多這樣的簡化實現了􀁺􀀃 高的指令吞吐量􀁺􀀃 出色的實時中斷響應􀁺􀀃 小的高性價比的處理器宏單元

    標簽： arm7tdmi

    上傳時間： 2014-12-30

    上傳用戶：xiaowei314

  • EVDO基本原理和關鍵技術

    　　§培訓目標： 　　本課程主要對EVDO的基本原理和關鍵技術進行介紹。通過本課程的學習，可以了解EVDO rev.0和rev.A的空中接口和關鍵技術，以及1X/DO互操作的相關規則等。 　　§培訓內容： 　　EVDO技術發展、網絡結構簡介; 　　EVDO rev.0和revA的空中接口結構; 　　EVDO rev.0和revA的關鍵技術; 　　1X / DO互操作原則;

    標簽： EVDO 關鍵技術

    上傳時間： 2014-03-25

    上傳用戶：d815185728

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