多徑干擾信號是導航接收機測量過程中遇到的主要誤差源之一。針對Galileo系統以及GPS現代化過程中擬使用的BOC調制信號，研究了基于strobe相關的BOC信號跟蹤過程中的多徑抑制方法。分析了多徑效應對碼跟蹤精度的影響，從鑒相函數入手，提出了一種新的En-strobe相關法。運用窄相關法、strobe相關法和En-strobe相關法對BOC（1，1）信號和CBOC（6，1，1/11）信號進行多徑抑制性能分析。仿真結果表明En-strobe相關法在中短延遲的情況下能夠很好的抑制多徑誤差，且性能優于窄相關法和strobe相關法。
上傳時間： 2013-10-25
上傳用戶：腳趾頭
A simple C program to strobe the LEDsvia Port D. The strobe rate is to be set by adjusting the voltage drop over a potentiometer that is sampled by an ADC.
上傳時間： 2014-01-09
上傳用戶：lifangyuan12
An assembly to strobe the LEDsvia Port D. The strobe rate is to be set by adjusting the voltage drop over a potentiometer that is sampled by an ADC
上傳時間： 2015-03-21
上傳用戶：13681659100
介紹一種以MSP430單片機為基礎的智能頻率測量系統，采用硬件邏輯與軟件指令相結合的方式控制閘門，實現0 MHz~10 MHz范圍內無檔切換的等精度測量。 Abstract: An intelligent frequency measurement system based on MSP430 singlechip is introduced. The system uses a way that can combine hardware logic and software instructions to contronl the strobe ,and completes the functions of equal precision in the range of 0MHz~10MHz without shifting
上傳時間： 2013-10-28
上傳用戶：dbs012280
cd4094驅動程序，驅動1位共陰極數碼管，pic12c508a作為控制器，gp0-gp2分別為data,clk,strobe.
上傳時間： 2015-04-02
上傳用戶：gaojiao1999
站長:我所上傳的是FX2開發板的相關程序及驅動,絕對是有市場的,FX2開發板在市上賣到800-500元,有了這些程序,就可以自己設計了,不用發錢買了. The purpose of this code is to demonstrate how to utilize EZUSB FX2 PORTC strobe FEATURE.
上傳時間： 2013-12-30
上傳用戶：ynwbosss
FPGA讀寫SD卡讀取BMP圖片通過LCD顯示例程實驗 Verilog邏輯源碼Quartus工程文件+文檔說明,FPGA型號Cyclone4E系列中的EP4CE6F17C8，Quartus版本17.1。1 實驗簡介在前面的實驗中我們練習了 SD 卡讀寫，VGA 視頻顯示等例程，本實驗將 SD 卡里的 BMP 圖片讀出，寫入到外部存儲器，再通過 VGA、LCD 等顯示。本實驗如果通過液晶屏顯示，需要有液晶屏模塊。2 實驗原理在前面的實驗中我們在 VGA、LCD 上顯示的是彩條，是 FPGA 內部產生的數據，本實驗將彩條替換為 SD 內的 BMP 圖片數據，但是 SD 卡讀取速度遠遠不能滿足顯示速度的要求，只能先寫入外部高速 RAM，再讀出后給視頻時序模塊顯示module top( input clk, input rst_n, input key1, output [5:0] seg_sel, output [7:0] seg_data, output vga_out_hs, //vga horizontal synchronization output vga_out_vs, //vga vertical synchronization output[4:0] vga_out_r, //vga red output[5:0] vga_out_g, //vga green output[4:0] vga_out_b, //vga blue output sd_ncs, //SD card chip select (SPI mode) output sd_dclk, //SD card clock output sd_mosi, //SD card controller data output input sd_miso, //SD card controller data input output sdram_clk, //sdram clock output sdram_cke, //sdram clock enable output sdram_cs_n, //sdram chip select output sdram_we_n, //sdram write enable output sdram_cas_n, //sdram column address strobe output sdram_ras_n, //sdram row address strobe output[1:0] sdram_dqm, //sdram data enable output[1:0] sdram_ba, //sdram bank address output[12:0] sdram_addr, //sdram address inout[15:0] sdram_dq //sdram data);parameter MEM_DATA_BITS = 16 ; //external memory user interface data widthparameter ADDR_BITS = 24
標簽： fpga
上傳時間： 2021-10-27
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FPGA讀取OV5640攝像頭數據并通過VGA或LCD屏顯示輸出的Verilog邏輯源碼Quartus工程文件+文檔說明，FPGA型號Cyclone4E系列中的EP4CE6F17C8，Quartus版本17.1。module top( input clk, input rst_n, output cmos_scl, //cmos i2c clock inout cmos_sda, //cmos i2c data input cmos_vsync, //cmos vsync input cmos_href, //cmos hsync refrence,data valid input cmos_pclk, //cmos pxiel clock output cmos_xclk, //cmos externl clock input [7:0] cmos_db, //cmos data output cmos_rst_n, //cmos reset output cmos_pwdn, //cmos power down output vga_out_hs, //vga horizontal synchronization output vga_out_vs, //vga vertical synchronization output[4:0] vga_out_r, //vga red output[5:0] vga_out_g, //vga green output[4:0] vga_out_b, //vga blue output sdram_clk, //sdram clock output sdram_cke, //sdram clock enable output sdram_cs_n, //sdram chip select output sdram_we_n, //sdram write enable output sdram_cas_n, //sdram column address strobe output sdram_ras_n, //sdram row address strobe output[1:0] sdram_dqm, //sdram data enable output[1:0] sdram_ba, //sdram bank address output[12:0] sdram_addr, //sdram address inout[15:0] sdram_dq //sdram data);
上傳時間： 2021-12-18
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基于FPGA設計的sdram讀寫測試實驗Verilog邏輯源碼Quartus工程文件+文檔說明，DRAM選用海力士公司的 HY57V2562 型號,容量為的 256Mbit,采用了 54 引腳的TSOP 封裝, 數據寬度都為 16 位, 工作電壓為 3.3V,并丏采用同步接口方式所有的信號都是時鐘信號。FPGA型號Cyclone4E系列中的EP4CE6F17C8，Quartus版本17.1。timescale 1ps/1psmodule top(input clk,input rst_n,output[1:0] led,output sdram_clk, //sdram clockoutput sdram_cke, //sdram clock enableoutput sdram_cs_n, //sdram chip selectoutput sdram_we_n, //sdram write enableoutput sdram_cas_n, //sdram column address strobeoutput sdram_ras_n, //sdram row address strobeoutput[1:0] sdram_dqm, //sdram data enable output[1:0] sdram_ba, //sdram bank addressoutput[12:0] sdram_addr, //sdram addressinout[15:0] sdram_dq //sdram data);parameter MEM_DATA_BITS = 16 ; //external memory user interface data widthparameter ADDR_BITS = 24 ; //external memory user interface address widthparameter BUSRT_BITS = 10 ; //external memory user interface burst widthparameter BURST_SIZE = 128 ; //burst sizewire wr_burst_data_req; // from external memory controller,write data request ,before data 1 clockwire wr_burst_finish; // from external memory controller,burst write finish
標簽： fpga sdram verilog quartus
上傳時間： 2021-12-18
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1.1系統設計說明本設計使用普通10口模擬標準SPI總線，實現SPMC65P2404A的多機通信。SPI（Serial Peripheral Interface）總線系統是一種同步串行外設接口，它使用4條線：串行時鐘線（SCK）、數據輸出線、輸入線和片選線（SS），支持同步全雙工通信方式。在本設計中，用1號從機采集按鍵，2號從機通過一個撥碼開關控制一個計數器進行計數，從機獲得的鍵值和計數值將送主機，主機用4個數碼管顯示。主機顯示的形式為：從機號+鍵值（或計數值）.1.2系統框圖1.3通信時序SPI采用同步全雙工通信方式，時鐘信號SCK由主機產生。主從機的通信時序圖分別如圖1-2和圖1-3所示：當待發送數據寫入發送緩沖器后，便啟動數據發送，數據接收和發送以字節為單位。時序圖中，Sample strobe為輸入數據采樣點，例如從機在SCK的上升沿對輸入數據進行采樣接收，主機在SCK的下降沿對輸入數據進行采樣接收。SPIF是發送或接收完一字節數據后產生的標志，主機或從機傳輸完一字節的數據后該標志被置為1，可以用于主程序查詢或產生SPI中斷，在中斷服務程序中或查詢程序之后需將該標志寫0，以清除該標志位。ss為從機的片選線，當SS-0時，該從機有效，接收主機發送的命令；當SS-1時，該從機的輸出端（SDO）處于懸浮狀態。
上傳時間： 2022-06-19
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