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verilog-hdl

手把手教你學(xué)CPLD/FPGA與單片機(jī)聯(lián)合設(shè)計(jì)(前3章)

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基于FPGA的多功能頻率計(jì)的設(shè)計(jì)

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Verilog_HDL的基本語(yǔ)法詳解（夏宇聞版）

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基于FPGA的實(shí)時(shí)視頻信號(hào)處理平臺(tái)的設(shè)計(jì)

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基于NiosII軟核處理器的步進(jìn)電機(jī)接口設(shè)計(jì)

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基于FPGA 的方向?yàn)V波器指紋圖像增強(qiáng)算法實(shí)現(xiàn)

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基于FPGA的數(shù)字三相鎖相環(huán)的優(yōu)化設(shè)計(jì)

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突發(fā)OFDM接收機(jī)同步算法研究與實(shí)現(xiàn)

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U盤SoC的設(shè)計(jì)與實(shí)現(xiàn)

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基于SOPC的觸控屏控制器IP核設(shè)計(jì)

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