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xilinx-XUPV

開始使用Vitis軟件工具，xilinx vitis軟件實用教程

xilinx vitis軟件的簡單實用教程，基礎版本

標簽： vitis軟件

上傳時間： 2022-05-25

上傳用戶：zhanglei193
Xilinx Zynq SoC與嵌入式Linux設計實戰指南

Xilinx Zynq SoC與嵌入式Linux設計實戰指南，，與大家分享學習交流。

標簽： soc 嵌入式 linux

上傳時間： 2022-06-03

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Xilinx FPGA應用進階通用IP核詳解和設計開發資料

Xilinx FPGA應用進階通用IP核詳解和設計開發

標簽： xilinx fpga IP核

上傳時間： 2022-06-03

上傳用戶：jiabin
xilinx fpga開發實用教程田耕徐文波

《Xilinx FPGA開發實用教程》系統講述了Xilinx FPGA的開發知識,包括FPGA開發簡介、Verilog HDL語言基礎、基于Xilinx芯片的HDL語言高級進階、ISE開發環境使用指南、FPGA配置電路及軟件操作、在線邏輯分析儀ChipScope的使用、基于FPGA的數字信號處理技術、基于System Generator的DSP系統開發技術、基于FPGA的可編程嵌入式開發技術、基于FPGA的高速數據連接技術和時序分析原理以及時序分析器的使用11章內容，各章均以實例為基礎，涵蓋了FPGA開發的主要方面。

標簽： xilinx fpga

上傳時間： 2022-06-09

上傳用戶：aben
Xilinx FPGA應用進階通用IP核詳解和設計開發

本書系統講解通信網絡領域Xilinx FPGA內部的IP硬核。以流行的Xilinx Virtex-6型號芯片舉例，涵蓋Xilinx FPGA在通信領域主流的IP核，闡述Xilinx FPGA時鐘資源和DCM、PLL和MMCM時鐘管理器的特性和使用方法；介紹基于Block RAM資源生成ROM、RAM、FIFO和CAM核的使用過程。闡述TEMAC核背景知識、內部結構、接口時序和配置參數，給出生成實例；介紹LVDS技術規范、源同步實現方案和去偏移技術，講解Xilinx FPGA中IODELAYE1、ISERDES1和OSERDES核使用方法；闡述Xilinx FPGA DDR3控制器IP核的結構組成、模塊劃分、接口信號和物理約束等。

標簽： xilinx fpga ip核

上傳時間： 2022-06-11

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Xilinx FPGA伴你玩轉USB3.0與LVDS

特權同學 xilinx fpga伴你玩轉usb3.0與lvd叢書電子版PDF 本書主要使用Xilinx公司的Artix7 FPGA器件（引出自帶的LVDS接口）和Cypress公司的USB 3.0控制器芯片FX3，以及一些常見的DDR3存儲器、UART電路、擴展接口等，由淺入深地引領讀者從板級設計、軟件工具、相關驅動安裝到基礎的FPGA實例,從基于FPGA的UART、DDR3、USB 3.0、LVDS傳輸實例入手，掌握FPGA各種片內資源的應用以及接口時序的設計。本書基于特定的FPGA開發平臺，既有足夠的理論知識深度進行支撐，也有豐富的例程進行實踐講解，并且穿插著筆者多年FPGA學習和開發過程中的各種經驗和技巧。對于希望基于FPGA實現USB 3.0和LVD S開發的工程師，本書提供的很多實例都是很好的參考原型，可以幫助其實現快速系統原型的開發。

標簽： xilinx fpga usb lvds

上傳時間： 2022-06-11

上傳用戶：wangshoupeng199
Xilinx Spartan 6的DDR3原理圖+用戶手冊

板子采用4層PCB，層疊情況：Top -> GND -> Power -> Bottom板子芯片情況：(1) FPGA: Xilinx Spartan6系列的XC6SLX16-FTG256(2) DDR3: Micron的MT41J128M16，2Gbit存儲容量(2) 電源：采用2片Onsemi的NCP1529分別為FPGA Core 1.2V和DDR3 1.5V提供電源FPGA的1.2V VDDCore電壓，1.5V的DDR3供電電壓，VREF的0.75V電壓都OK。往FPGA內部下載點燈程序OK，往SPI FLASH固化程序也OK。下一步，DDR3 的MCB實現

標簽： ddr3

上傳時間： 2022-06-13

上傳用戶：ttalli
Xilinx與iMPACT的用法

關于Xilinx IS（14.2）簡單使用方法介紹安裝ISE軟件基本上是一路點擊鼠標就是，但必須安裝注冊表文件，可在網上查找，可能是一個生成注冊表文件或注冊表文件（license），功能仿真是在設計輸入后進行；時序仿真是在邏輯綜合后或布局布線后進行。（系統差不多占20GB硬盤）1創建工程文件（New Projiect）File New Projiect。如輸入文件名：Two20ne.在上圖點擊Next鍵，彈出如下窗口，設置一些參數，如下圖所示：創建資源文件（New Source）ProjectNew Source。如輸入文件名：One2Two.選擇模型，如Verilog Module，輸入HDL語言，或輸入原理圖。或Project>Add Source，，增加已存在的資源文件（*v）。實例：二選一電路。點擊Next鍵，彈出如下窗口，

標簽： xilinx impact

上傳時間： 2022-06-18

上傳用戶：shjgzh
xilinx ise license

xilinx ise 14.7 license 親測可用

標簽： xilinx ise

上傳時間： 2022-06-21

上傳用戶：jason_vip1
xilinx ise 14.7 license

xilinx ise 14.7 license ,親測可用！

標簽： xilinx ise

上傳時間： 2022-06-21

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