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串行數(shù)據(jù)通信

  • 下面我們根據8251A芯片的使用體會對其在串行同步方式下的通信原理及應用進行著重介紹。在開始發送或接收之前

    下面我們根據8251A芯片的使用體會對其在串行同步方式下的通信原理及應用進行著重介紹。在開始發送或接收之前,8251A必須裝入一組由CPU 產生的控制字。

    標簽: 8251A 芯片 串行同步 方式

    上傳時間: 2015-04-08

    上傳用戶:frank1234

  • i2s串行線廣泛用于音頻通信中,這里包括了master和slave的代碼.

    i2s串行線廣泛用于音頻通信中,這里包括了master和slave的代碼.

    標簽: master slave i2s 串行

    上傳時間: 2015-07-10

    上傳用戶:hzy5825468

  • 用于CSI24串行EEPROM的讀寫通信子程序

    用于CSI24串行EEPROM的讀寫通信子程序

    標簽: EEPROM CSI 24 串行

    上傳時間: 2015-08-15

    上傳用戶:ikemada

  • 本程序是利用AVR單片機的串行口和PC機通信

    本程序是利用AVR單片機的串行口和PC機通信,很適合初學者學習,利用WINAVR開發

    標簽: AVR 程序 單片機 串行口

    上傳時間: 2015-10-19

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  • 寫出了LPC2164與串行FLASH M25P64的數據通信

    寫出了LPC2164與串行FLASH M25P64的數據通信

    標簽: M25P64 FLASH 2164 LPC

    上傳時間: 2016-07-01

    上傳用戶:wpt

  • DS1302 是 DALLAS 公司推出的涓流充電時鐘芯片 內含有一個實時時鐘/日歷和 31 字節靜態 RAM 通過簡 單的串行接口與單片機進行通信 實時時鐘/日歷電路提供秒 分 時 日 日期 月

    DS1302 是 DALLAS 公司推出的涓流充電時鐘芯片 內含有一個實時時鐘/日歷和 31 字節靜態 RAM 通過簡 單的串行接口與單片機進行通信 實時時鐘/日歷電路提供秒 分 時 日 日期 月 年的信息 每月的天 數和閏年的天數可自動調整 時鐘操作可通過 AM/PM 指示決定采用 24 或 12 小時格式 DS1302 與單片機之 間能簡單地采用同步串行的方式進行通信 僅需用到三個口線 1 RES 復位 2 I/O 數據線 3 SCLK 串行時鐘 時鐘/RAM 的讀/寫數據以一個字節或多達 31 個字節的字符組方式通信 DS1302 工作時功耗很 低 保持數據和時鐘信息時功率小于 1mW

    標簽: DALLAS 1302 RAM 實時時鐘

    上傳時間: 2014-06-06

    上傳用戶:weixiao99

  • 液晶模塊RT12864如何顯示漢字? 我采用串行方式與LCD進行通信

    液晶模塊RT12864如何顯示漢字? 我采用串行方式與LCD進行通信,按照說明書寫的程序,但是只能顯示一個光標在第一個字符位置(我設置顯示光標),不顯示字符什么的。 請問如何顯示漢字?這個液晶模塊是帶中文字庫的,每個漢字的偏移地址是2個字節(比如A123),不知道怎么寫入。請用過的高手指點一二。

    標簽: 12864 LCD RT 液晶模塊

    上傳時間: 2017-04-15

    上傳用戶:frank1234

  • 基于USB的串行通信軟硬件設計

    基于USB的串行通信軟硬件設計

    標簽: USB 串行通信 軟硬件設計

    上傳時間: 2013-08-04

    上傳用戶:eeworm

  • 基于USB的串行通信軟硬件設計-41頁-0.8M.pdf

    專輯類-數字處理及顯示技術專輯-106冊-9138M 基于USB的串行通信軟硬件設計-41頁-0.8M.pdf

    標簽: USB 0.8 41

    上傳時間: 2013-07-19

    上傳用戶:yatouzi118

  • 基于FPGA的SCI串行通信接口的研究與實現.rar

    國家863項目“飛行控制計算機系統FC通信卡研制”的任務是研究設計符合CPCI總線標準的FC通信卡。本課題是這個項目的進一步引伸,用于設計SCI串行通信接口,以實現環上多計算機系統間的高速串行通信。 本文以此項目為背景,對基于FPGA的SCI串行通信接口進行研究與實現。論文先概述SCI協議,接著對SCI串行通信接口的兩個模塊:SCI節點模型模塊和CPCI總線接口模塊的功能和實現進行了詳細的論述。 SCI節模型包含Aurora收發模塊、中斷進程、旁路FIFO、接受和發送存儲器、地址解碼、MUX。在SCI節點模型的實現上,利用FPGA內嵌的RocketIO高速串行收發器實現主機之間的高速串行通信,并利用Aurora IP核實現了Aurora鏈路層協議;設計一個同步FIFO實現旁路FIFO;利用FPGA上的塊RAM實現發送和接收存儲器;中斷進程、地址解碼和多路復合分別在控制邏輯中實現。 CPCI總線接口包括PCI核、PCI核的配置模塊以及用戶邏輯三個部分。本課題中,采用FPGA+PCI軟核的方法來實現CPCI總線接口。PCI核作為PCI總線與用戶邏輯之間的橋梁:PCI核的配置模塊負責對PCI核進行配置,得到用戶需要的PCI核;用戶邏輯模塊負責實現整個通信接口具體的內部邏輯功能;并引入中斷機制來提高SCI通信接口與主機之間數據交換的速率。 設計選用硬件描述語言VerilogHDL和VHDL,在開發工具Xilinx ISE7.1中完成整個系統的設計、綜合、布局布線,利用Modelsim進行功能及時序仿真,使用DriverWorks為SCI串行通信接口編寫WinXP下的驅動程序,用VC++6.0編寫相應的測試應用程序。最后,將FPGA設計下載到FC通信卡中運行,并利用ISE內嵌的ChipScope Pro虛擬邏輯分析儀對設計進行驗證,運行結果正常。 文章最后分析傳輸性能上的原因,指出工作中的不足之處和需要進一步完善的地方。

    標簽: FPGA SCI 串行通信接口

    上傳時間: 2013-04-24

    上傳用戶:竺羽翎2222

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