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利用IP

  • 充分利用IP以及拓?fù)湟?guī)劃提高PCB設(shè)計(jì)效率

    本文探討的重點(diǎn)是PCB設(shè)計(jì)人員利用IP,并進(jìn)一步采用拓?fù)湟?guī)劃和布線工具來(lái)支持IP,快速完成整個(gè)PCB設(shè)計(jì)。從圖1可以看出,設(shè)計(jì)工程師的職責(zé)是通過(guò)布局少量必要元件、并在這些元件之間規(guī)劃關(guān)鍵互連路徑來(lái)獲取IP。一旦獲取到了IP,就可將這些IP信息提供給PCB設(shè)計(jì)人員,由他們完成剩余的設(shè)計(jì)。 圖1:設(shè)計(jì)工程師獲取IP,PCB設(shè)計(jì)人員進(jìn)一步采用拓?fù)湟?guī)劃和布線工具支持IP,快速完成整個(gè)PCB設(shè)計(jì)。現(xiàn)在無(wú)需再通過(guò)設(shè)計(jì)工程師和PCB設(shè)計(jì)人員之間的交互和反復(fù)過(guò)程來(lái)獲取正確的設(shè)計(jì)意圖,設(shè)計(jì)工程師已經(jīng)獲取這些信息,并且結(jié)果相當(dāng)精確,這對(duì)PCB設(shè)計(jì)人員來(lái)說(shuō)幫助很大。在很多設(shè)計(jì)中,設(shè)計(jì)工程師和PCB設(shè)計(jì)人員要進(jìn)行交互式布局和布線,這會(huì)消耗雙方許多寶貴的時(shí)間。從以往的經(jīng)歷來(lái)看交互操作是必要的,但很耗時(shí)間,且效率低下。設(shè)計(jì)工程師提供的最初規(guī)劃可能只是一個(gè)手工繪圖,沒(méi)有適當(dāng)比例的元件、總線寬度或引腳輸出提示。隨著PCB設(shè)計(jì)人員參與到設(shè)計(jì)中來(lái),雖然采用拓?fù)湟?guī)劃技術(shù)的工程師可以獲取某些元件的布局和互連,不過(guò),這個(gè)設(shè)計(jì)可能還需要布局其它元件、獲取其它IO及總線結(jié)構(gòu)和所有互連才能完成。PCB設(shè)計(jì)人員需要采用拓?fù)湟?guī)劃,并與經(jīng)過(guò)布局的和尚未布局的元件進(jìn)行交互,這樣做可以形成最佳的布局和交互規(guī)劃,從而提高PCB設(shè)計(jì)效率。隨著關(guān)鍵區(qū)域和高密區(qū)域布局完成及拓?fù)湟?guī)劃被獲取,布局可能先于最終拓?fù)湟?guī)劃完成。因此,一些拓?fù)渎窂娇赡鼙仨毰c現(xiàn)有布局一起工作。雖然它們的優(yōu)先級(jí)較低,但仍需要進(jìn)行連接。因而一部分規(guī)劃圍繞布局后的元件產(chǎn)生了。此外,這一級(jí)規(guī)劃可能需要更多細(xì)節(jié)來(lái)為其它信號(hào)提供必要的優(yōu)先級(jí)。

    標(biāo)簽: PCB 利用IP 拓?fù)湟?guī)劃

    上傳時(shí)間: 2013-10-12

    上傳用戶:sjyy1001

  • 充分利用IP以及拓?fù)湟?guī)劃提高PCB設(shè)計(jì)效率

    本文探討的重點(diǎn)是PCB設(shè)計(jì)人員利用IP,并進(jìn)一步采用拓?fù)湟?guī)劃和布線工具來(lái)支持IP,快速完成整個(gè)PCB設(shè)計(jì)。從圖1可以看出,設(shè)計(jì)工程師的職責(zé)是通過(guò)布局少量必要元件、并在這些元件之間規(guī)劃關(guān)鍵互連路徑來(lái)獲取IP。一旦獲取到了IP,就可將這些IP信息提供給PCB設(shè)計(jì)人員,由他們完成剩余的設(shè)計(jì)。 圖1:設(shè)計(jì)工程師獲取IP,PCB設(shè)計(jì)人員進(jìn)一步采用拓?fù)湟?guī)劃和布線工具支持IP,快速完成整個(gè)PCB設(shè)計(jì)。現(xiàn)在無(wú)需再通過(guò)設(shè)計(jì)工程師和PCB設(shè)計(jì)人員之間的交互和反復(fù)過(guò)程來(lái)獲取正確的設(shè)計(jì)意圖,設(shè)計(jì)工程師已經(jīng)獲取這些信息,并且結(jié)果相當(dāng)精確,這對(duì)PCB設(shè)計(jì)人員來(lái)說(shuō)幫助很大。在很多設(shè)計(jì)中,設(shè)計(jì)工程師和PCB設(shè)計(jì)人員要進(jìn)行交互式布局和布線,這會(huì)消耗雙方許多寶貴的時(shí)間。從以往的經(jīng)歷來(lái)看交互操作是必要的,但很耗時(shí)間,且效率低下。設(shè)計(jì)工程師提供的最初規(guī)劃可能只是一個(gè)手工繪圖,沒(méi)有適當(dāng)比例的元件、總線寬度或引腳輸出提示。隨著PCB設(shè)計(jì)人員參與到設(shè)計(jì)中來(lái),雖然采用拓?fù)湟?guī)劃技術(shù)的工程師可以獲取某些元件的布局和互連,不過(guò),這個(gè)設(shè)計(jì)可能還需要布局其它元件、獲取其它IO及總線結(jié)構(gòu)和所有互連才能完成。PCB設(shè)計(jì)人員需要采用拓?fù)湟?guī)劃,并與經(jīng)過(guò)布局的和尚未布局的元件進(jìn)行交互,這樣做可以形成最佳的布局和交互規(guī)劃,從而提高PCB設(shè)計(jì)效率。隨著關(guān)鍵區(qū)域和高密區(qū)域布局完成及拓?fù)湟?guī)劃被獲取,布局可能先于最終拓?fù)湟?guī)劃完成。因此,一些拓?fù)渎窂娇赡鼙仨毰c現(xiàn)有布局一起工作。雖然它們的優(yōu)先級(jí)較低,但仍需要進(jìn)行連接。因而一部分規(guī)劃圍繞布局后的元件產(chǎn)生了。此外,這一級(jí)規(guī)劃可能需要更多細(xì)節(jié)來(lái)為其它信號(hào)提供必要的優(yōu)先級(jí)。

    標(biāo)簽: PCB 利用IP 拓?fù)湟?guī)劃

    上傳時(shí)間: 2014-01-14

    上傳用戶:lz4v4

  • 基于FPGA的數(shù)字圖像處理的研究.rar

    圖像是人類智能活動(dòng)重要的信息來(lái)源之一,是人類相互交流和認(rèn)識(shí)世界的主要媒體。隨著信息高速公路、數(shù)字地球概念的提出,人們對(duì)圖像處理技術(shù)的需求與日劇增,同時(shí)VLSI技術(shù)的發(fā)展給圖像處理技術(shù)的應(yīng)用提供了廣闊的平臺(tái)。圖像處理技術(shù)是圖像識(shí)別和分析的基礎(chǔ),所以圖像處理技術(shù)對(duì)整個(gè)圖像工程來(lái)說(shuō)就非常重要,對(duì)圖像處理技術(shù)的實(shí)現(xiàn)的研究也就具有重要的理論意義與實(shí)用價(jià)值,包括對(duì)傳統(tǒng)算法的改進(jìn)和硬件實(shí)現(xiàn)的研究。仿生算法的興起為圖像處理問(wèn)題的解決提供了一條十分有效的新途徑;FPGA技術(shù)的發(fā)展為圖像處理的硬件實(shí)現(xiàn)提供了有效的平臺(tái)。 @@ 本文在詳細(xì)介紹鄰域圖像處理算法及其數(shù)據(jù)結(jié)構(gòu)、遺傳算法和蟻群算法基本原理的基礎(chǔ)上,將其應(yīng)用于圖像增強(qiáng)和圖像分割的圖像處理問(wèn)題之中,并將其用FPGA技術(shù)實(shí)現(xiàn)。論文中采用遺傳算法自適應(yīng)的確定非線性變換函數(shù)的參數(shù)對(duì)圖像進(jìn)行增強(qiáng),在采用FPGA來(lái)實(shí)現(xiàn)的過(guò)程中先對(duì)系統(tǒng)進(jìn)行模塊劃分,主要分為初始化模塊、選擇模塊、適應(yīng)度模塊、控制模塊等,然后利用VHDL語(yǔ)言描述各個(gè)功能模塊,為了提高設(shè)計(jì)效率,利用IP核進(jìn)行存儲(chǔ)器設(shè)計(jì),利用DSP Builder進(jìn)行數(shù)學(xué)運(yùn)算處理。時(shí)序控制是整個(gè)系統(tǒng)設(shè)計(jì)的核心,為盡量避免毛刺現(xiàn)象,各模塊的時(shí)序控制都是采用單進(jìn)程的Moore狀態(tài)機(jī)實(shí)現(xiàn)的。在圖像分割環(huán)節(jié)中,圖像分割問(wèn)題轉(zhuǎn)換為求圖像的最大熵問(wèn)題,采用蟻群算法對(duì)改進(jìn)的最大熵確定的適應(yīng)度函數(shù)進(jìn)行優(yōu)化,并對(duì)基于FPGA和蟻群算法實(shí)現(xiàn)圖像分割的各個(gè)模塊設(shè)計(jì)進(jìn)行了詳細(xì)介紹。 @@ 對(duì)實(shí)驗(yàn)結(jié)果進(jìn)行分析表明遺傳算法和蟻群算法在數(shù)字圖像處理中的使用明顯改善了處理的效果,在利用FPGA實(shí)現(xiàn)遺傳算法和蟻群算法的整個(gè)設(shè)計(jì)過(guò)程中由于充分發(fā)揮了FPGA的并行計(jì)算能力及流水線技術(shù)的應(yīng)用,大大提高算法的運(yùn)行速度。 @@關(guān)鍵詞:圖像處理;遺傳算法;蟻群算法;FPGA

    標(biāo)簽: FPGA 數(shù)字圖像處理

    上傳時(shí)間: 2013-06-03

    上傳用戶:小火車?yán)怖怖?/p>

  • 基于FPGA的通用異步收發(fā)器的設(shè)計(jì).rar

    通用異步收發(fā)器(Universal Asynchronous Receiver Transmitter,UART)是一種能同時(shí)支持短距離和長(zhǎng)距離數(shù)據(jù)傳輸?shù)拇型ㄐ沤涌冢粡V泛應(yīng)用于微機(jī)和外設(shè)之間的數(shù)據(jù)交換。像8251、NS8250、NS16550等都是常用的UART芯片,但是這些專用的串行接口芯片的缺點(diǎn)是數(shù)據(jù)傳輸速率比較慢,難以滿足高速率數(shù)據(jù)傳輸?shù)膱?chǎng)合,而更重要的就是它們都具有不可移植性,因此要利用這些芯片來(lái)實(shí)現(xiàn)PC機(jī)和FPGA芯片之間的通信,勢(shì)必會(huì)增加接口連線的復(fù)雜程度以及降低整個(gè)系統(tǒng)的穩(wěn)定性和有效性。 本課題就是針對(duì)UART的特點(diǎn)以及FPGA設(shè)計(jì)具有可移植性的優(yōu)勢(shì),提出了一種基于FPGA芯片的嵌入式UART設(shè)計(jì)方法,其中主要包括狀態(tài)機(jī)的描述形式以及自頂向下的設(shè)計(jì)方法,利用硬件描述語(yǔ)言來(lái)編制UART的各個(gè)子功能模塊以及頂層模塊,之后將其集成到FPGA芯片的內(nèi)部,這樣不僅能解決傳統(tǒng)UART芯片的缺點(diǎn)而且同時(shí)也使整個(gè)系統(tǒng)變得更加具有緊湊性以及可靠性。 本課題所設(shè)計(jì)的LIART支持標(biāo)準(zhǔn)的RS-232C傳輸協(xié)議,主要設(shè)計(jì)有發(fā)送模塊、接收模塊、線路控制與中斷仲裁模塊、Modem控制模塊以及兩個(gè)獨(dú)立的數(shù)據(jù)緩沖區(qū)FIFO模塊。該模塊具有可變的波特率、數(shù)據(jù)幀長(zhǎng)度以及奇偶校驗(yàn)方式,還有多種中斷源、中斷優(yōu)先級(jí)、較強(qiáng)的抗干擾數(shù)據(jù)接收能力以及芯片內(nèi)部自診斷的能力,模塊內(nèi)分開(kāi)的接收和發(fā)送數(shù)據(jù)緩沖寄存器能實(shí)現(xiàn)全雙工通信。除此之外最重要的是利用IP模塊復(fù)用技術(shù)設(shè)計(jì)數(shù)據(jù)緩沖區(qū)FIFO,采用兩種可選擇的數(shù)據(jù)緩沖模式。這樣既可以應(yīng)用于高速的數(shù)據(jù)傳輸環(huán)境,也能適合低速的數(shù)據(jù)傳輸場(chǎng)合,因此可以達(dá)到資源利用的最大化。 在具體的設(shè)計(jì)過(guò)程中,利用Synplify Pro綜合工具、ModelSim仿真工具、ISE集成的軟件開(kāi)發(fā)環(huán)境中對(duì)各個(gè)功能模塊進(jìn)行綜合優(yōu)化、仿真驗(yàn)證以及下載實(shí)現(xiàn)。各項(xiàng)數(shù)據(jù)結(jié)果表明,本課題中所設(shè)計(jì)的UART滿足預(yù)期設(shè)計(jì)目標(biāo)。

    標(biāo)簽: FPGA 異步收發(fā)器

    上傳時(shí)間: 2013-08-02

    上傳用戶:rocketrevenge

  • 基于FPGA的圖像處理平臺(tái)及3D加速引擎的設(shè)計(jì).rar

    3D加速引擎是3D圖形加速系統(tǒng)的重要組成部分,以往在軟件平臺(tái)上對(duì)3D引擎的研究,實(shí)現(xiàn)了復(fù)雜的渲染模型和渲染算法,但這些復(fù)雜算法與模型在FPGA上綜合實(shí)現(xiàn)具有一定難度,針對(duì)FPGA的3D加速引擎設(shè)計(jì)及其平臺(tái)實(shí)現(xiàn)需要進(jìn)一步研究。 本文在研究3D加速引擎結(jié)構(gòu)的基礎(chǔ)上,實(shí)現(xiàn)了基于FPGA的圖像處理平臺(tái),使用模塊化的思想,利用IP核技術(shù)分析設(shè)計(jì)實(shí)現(xiàn)了3D加速管道及其他模塊,并進(jìn)行了仿真、驗(yàn)證、實(shí)現(xiàn)。 圖像處理平臺(tái)選用Virtex-Ⅳ FPGA為核心器件,并搭載了Hynix HY5DU573222F-25、AT91FR40162S、XCF32P VO48及其他組件。 為滿足3D加速引擎的實(shí)現(xiàn)與驗(yàn)證,設(shè)計(jì)搭建的圖像處理平臺(tái)還實(shí)現(xiàn)了DDR-SDRAM控制器模塊、VGA輸出模塊、總線控制器模塊、命令解釋模塊、指令寄存器模塊及控制寄存器模塊。 3D加速引擎設(shè)計(jì)包含3D加速渲染管道、視角變換管道、基元讀取、頂點(diǎn)FIFO、基元FIFO、寫內(nèi)存等模塊。針對(duì)FPGA的特性,簡(jiǎn)化、設(shè)計(jì)、實(shí)現(xiàn)了光照管道、紋理管道、著色管道和Alpha融合管道。 最后使用Modelsim進(jìn)行了仿真測(cè)試和圖像處理平臺(tái)上的驗(yàn)證,其結(jié)果表明3D加速引擎設(shè)計(jì)的大部分功能得到實(shí)現(xiàn),結(jié)果令人滿意。

    標(biāo)簽: FPGA 3D加速 圖像

    上傳時(shí)間: 2013-07-30

    上傳用戶:lepoke

  • NCO的VHDL程序

    NCO的VHDL程序,是利用IP核生成的,超好的,快下吧

    標(biāo)簽: VHDL NCO 程序

    上傳時(shí)間: 2014-01-11

    上傳用戶:whenfly

  • 中科院算所《創(chuàng)新·求實(shí)》2005年11月(雙月刊·總第57期) ·所內(nèi)動(dòng)態(tài)· 路甬祥、華建敏視察計(jì)算所蘇州分部韓 程 馬頌德副部長(zhǎng)視察計(jì)算所東莞分部鐘天智 ·領(lǐng)域前瞻· 建設(shè)具有中國(guó)特色網(wǎng)絡(luò)

    中科院算所《創(chuàng)新·求實(shí)》2005年11月(雙月刊·總第57期) ·所內(nèi)動(dòng)態(tài)· 路甬祥、華建敏視察計(jì)算所蘇州分部韓 程 馬頌德副部長(zhǎng)視察計(jì)算所東莞分部鐘天智 ·領(lǐng)域前瞻· 建設(shè)具有中國(guó)特色網(wǎng)絡(luò)型研究所的戰(zhàn)略思考(上)樊建平 劉新宇 ·專家視點(diǎn)· 統(tǒng)計(jì)機(jī)器翻譯新進(jìn)展劉 群 關(guān)于基于網(wǎng)格的問(wèn)題求解環(huán)境的幾點(diǎn)思考(下)馮圣中 ·科研掠影· 利用IP SAN技術(shù)建設(shè)校園公共計(jì)算機(jī)應(yīng)用環(huán)境王 晗 ·特別報(bào)道· 紀(jì)念抗戰(zhàn)勝利60周年系列活動(dòng) 為了明天,我們……卓 然 優(yōu)化研究生思想教育模式 全面提高人才培養(yǎng)質(zhì)量(下)檀彥卓整理 ·分部建設(shè)· 產(chǎn)學(xué)研相結(jié)合,自強(qiáng)不息,團(tuán)結(jié)奮進(jìn)黃朝暉 ·簡(jiǎn)訊· ·諸子百家· 拔河比賽中的天時(shí)、地利、人和郭紅松 ·閑情雅致· 武林秘籍在哪里?由淵霞

    標(biāo)簽: 2005 計(jì)算 創(chuàng)新

    上傳時(shí)間: 2014-12-02

    上傳用戶:dongqiangqiang

  • 實(shí)現(xiàn)通訊錄功能

    實(shí)現(xiàn)通訊錄功能,《網(wǎng)絡(luò)電話》是一款PC對(duì)PC利用IP可以在局域網(wǎng)內(nèi)語(yǔ)音通話的軟件。該軟件語(yǔ)音清晰,不出現(xiàn)語(yǔ)音延時(shí);有來(lái)電顯示,且有提示音。尤如電話通話一般。該軟件采用TCP/IP協(xié)議

    標(biāo)簽: 通訊

    上傳時(shí)間: 2013-12-07

    上傳用戶:jackgao

  • 是一款可以穿透防火牆以及代理伺服器的桌面分享及遠(yuǎn)端搖控的免費(fèi)軟體。 市面上雖然也有類似的軟體

    是一款可以穿透防火牆以及代理伺服器的桌面分享及遠(yuǎn)端搖控的免費(fèi)軟體。 市面上雖然也有類似的軟體,但通常這類軟體都是利用 IP 位址做連線,

    標(biāo)簽: 防火 代理 伺服器

    上傳時(shí)間: 2016-08-20

    上傳用戶:huql11633

  • 實(shí)驗(yàn)一 路由器的命令行界面配置 2 實(shí)驗(yàn)二 路由器的全局配置 4 實(shí)驗(yàn)三 路由器端口的基本配置 6 實(shí)驗(yàn)四 查看路由器的系統(tǒng)和配置信息 9 實(shí)驗(yàn)五 靜態(tài)路由 11 實(shí)驗(yàn)六 RIP

    實(shí)驗(yàn)一 路由器的命令行界面配置 2 實(shí)驗(yàn)二 路由器的全局配置 4 實(shí)驗(yàn)三 路由器端口的基本配置 6 實(shí)驗(yàn)四 查看路由器的系統(tǒng)和配置信息 9 實(shí)驗(yàn)五 靜態(tài)路由 11 實(shí)驗(yàn)六 RIP 路由協(xié)議 17 實(shí)驗(yàn)七 OSPF單區(qū)域 25 實(shí)驗(yàn)八 利用IP標(biāo)準(zhǔn)訪問(wèn)列表進(jìn)行網(wǎng)絡(luò)流量的控制 32

    標(biāo)簽: 實(shí)驗(yàn) 路由器 RIP 11

    上傳時(shí)間: 2017-04-22

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