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  • 對于不同的18b20這個程序可能有些問題,我遇到是的將暫存器的數據拷回18b20中數據無法保存. 換過18b20就正常了.

    對于不同的18b20這個程序可能有些問題,我遇到是的將暫存器的數據拷回18b20中數據無法保存. 換過18b20就正常了.

    標簽: 18b20 數據 程序 暫存

    上傳時間: 2014-01-15

    上傳用戶:shizhanincc

  • 匯編語言---程式設計,暫存器安排,程式規格,變數法,對稱法,虛擬法

    匯編語言---程式設計,暫存器安排,程式規格,變數法,對稱法,虛擬法

    標簽: 匯編語言 暫存 對稱 程式設計

    上傳時間: 2014-01-19

    上傳用戶:wang0123456789

  • ARM定址方式 直接由暫存器取出值操作 指令中的位址為暫存器編號 例題: MOV R1,R2 R2 -> R1 SUB R0,R1,R2 R1 - R2 -> R

    ARM定址方式 直接由暫存器取出值操作 指令中的位址為暫存器編號 例題: MOV R1,R2 R2 -> R1 SUB R0,R1,R2 R1 - R2 -> R0

    標簽: R2 R1 gt ARM

    上傳時間: 2016-03-26

    上傳用戶:邶刖

  • 用java寫的網上售書系統 功能詳盡 支持各種類別書目查詢 分頁顯示 購物車的暫存功能 內部附有數據庫

    用java寫的網上售書系統 功能詳盡 支持各種類別書目查詢 分頁顯示 購物車的暫存功能 內部附有數據庫

    標簽: java 查詢

    上傳時間: 2016-07-15

    上傳用戶:yyq123456789

  • DS1820匯編讀寫程序 包含從DS18B20中讀出的溫度數據進行轉換和DS18B20暫存存儲器設定值BCD數據轉換

    DS1820匯編讀寫程序 包含從DS18B20中讀出的溫度數據進行轉換和DS18B20暫存存儲器設定值BCD數據轉換

    標簽: 18B B20 DS 1820

    上傳時間: 2016-10-10

    上傳用戶:linlin

  • 基于DSP/FPGA的多波形數字脈沖壓縮系統硬件的研究與實現

    現代雷達系統廣泛采用脈沖壓縮技術,用以解決作用距離與分辨能力之間的矛盾。脈沖壓縮是指雷達通過發射寬脈沖,保證足夠的最大作用距離,而接收時,采用相應的脈沖壓縮法獲得窄脈沖以提高距離分辨率的過程。同時,數字信號處理技術的迅猛發展和廣泛應用,為雷達脈沖壓縮處理的數字化實現提供了可能。 本文主要研究雷達多波形頻域數字脈沖壓縮系統的硬件系統實現。在匹配濾波理論的指導下,成功研制了基于FPGAEP1K100QC208-1和4片高性能ADSP21160M的多波形頻域數字脈沖壓縮系統。該系統可處理時寬在42μs以內、帶寬在5MHz以下的線性調頻信號(LFM),非線性調頻信號(NLFM)和Taylor四相碼信號,且技術指標完全滿足實用系統的設計要求。 本文完成的主要工作和創新之處有:(1)基于雙通道模數轉換器AD10242設計高精度數據采集電路,為整個脈壓系統的工作提供必要的條件。完成了前端模擬信號輸入電路的優化和差分輸入時鐘的產生,以實現高精度采樣。 (2)根據協議和脈壓系統的工作要求,以基于FPGAEP1K100QC208完成系統控制,使整個脈壓系統正確穩定地工作。同時以該FPGA生成雙口RAM,實現數據暫存,以匹配采樣速率和脈壓系統頻率。 (3)設計基于4片高性能ADSP21160M的緊耦合并行處理系統,以完成多波形頻域數字脈沖壓縮的全部運算工作。4片DSP共享外部總線,且各DSP以鏈路口互連,進行數據通信。各DSP還使用一個鏈路口連接到接口板DSP,將脈壓結果送出。 (4)以一片ADSP21160M和一片EP1K100QC208為核心,設計輸出板電路,完成數據對齊、求模和數據向下一級的輸出,并產生模擬輸出。 (5)調試并改進處理板和輸出板。

    標簽: FPGA DSP 多波形 壓縮系統

    上傳時間: 2013-06-11

    上傳用戶:qq277541717

  • 基于運動補償的去隔行系統的研究與FPGA設計

    本文采用基于運動補償的算法,對去隔行系統及其FPGA設計作了深入的研究.該系統包括三個關鍵模塊運動估計模塊是去隔行系統的設計重點,設計為雙向運動估計,采用菱形快速搜索算法,主要分為計算和控制兩大部分.計算部分為SAD計算模塊,采用累加樹和流水線技術;控制部分根據菱形搜索算法的第三步搜索的特點,對比較模塊、SAD暫存器等模塊做了具體的設計.對于運動補償模塊采用雙向補償的算法,補償精度為半像素.根據半像素點的位置將運動補償計算分為四個狀態,并通過對四個狀態計算特點的分析設計了加法器的結構復用.同時基于視頻數據處理的需要,設計了四個具有雙體存儲結構的內部緩存器,由FPGA內部的嵌入式陣列塊實現.根據運動估計模塊和運動補償模塊的計算特點,分別對緩存器的結構、讀寫時序和列序號控制進行設計,有效提高了數據的存取效率.本文對于這三個去隔行系統的關鍵模塊都給出了RTL級設計和模塊的功能仿真,并在最后一章中給出了去隔行系統的FPGA設計.

    標簽: FPGA 補償 去隔行

    上傳時間: 2013-06-11

    上傳用戶:han_zh

  • 基于ARM的圖像采集系統的設計

    近年來,隨著計算機和通信技術的飛速發展,特別是網絡的迅速普及和3C(計算機、通信、消費電子)合一的加速,微型化和專業化成為發展的新趨勢,嵌入式產品已經成為了信息產業的主流,嵌入式系統技術也成為目前電子產品設計領域最為熱門的技術之一,目前已經廣泛地應用于軍事國防、消費電子、網絡通信、工業控制等各個領域。本文在研究視頻采集發展現狀和趨勢的基礎上,設計了一種基于32位處理器的嵌入式圖像采集和傳輸系統。此套硬件系統可應用于LCD顯示屏、桌面視頻、多媒體、數字電視機、圖像處理、可視電話和遠程戶外圖像采集等領域。 該圖像采集系統在硬件系統上以ARM芯片S3C44BOX為核心,利用CMOS圖像傳感器采集圖像;以FIFO幀存儲器暫存圖像數據,解決了ARM芯片與圖像傳感器之間速率的不同步問題;并充分利用了FPGA/CPLD高性能、低功耗、低成本的優點,用CPID器件控制整個圖像采集的時序邏輯。在軟件平臺移植了嵌入式操作系統’uClinux,并在此基礎上開發了底層的驅動程序和應用程序。體積小巧,具備圖像采集、顯示和遠程傳輸功能和良好的可擴展性。 全文共分為五個章節,第一章主要介紹了論文的課題背景和圖像采集技術的發展現狀,介紹了論文的研究目標和研究內容。第二章從硬件和軟件兩方面闡述了嵌入式圖像采集系統的總體設計方案,詳細介紹了硬件開發平臺嵌入式系統和軟件開發平臺嵌入式操作系統各自的定義和特點。第三章主要介紹基于ARM的圖像采集系統硬件設計方面的內容,包括各個模塊的具體實現方案、系統硬件性能分析和硬件電路的抗干擾設計等。第四章研究了基于uClinux平臺的幾個主要模塊的軟件設計,主要包括圖像傳感芯片的初始化和采集程序的實現、LCD控制器的初始化和圖像顯示程序的實現、以太網控制器的初始化和圖像數據傳輸程序的實現。第五章是對全文的一個總結,概括了作者所做的工作,提出所存在的不足并對后續的研究工作做了進一步的展望。

    標簽: ARM 圖像采集系統

    上傳時間: 2013-04-24

    上傳用戶:wangxuan

  • 基于FPGA的高分辨率圖像采集卡

    隨著計算機科學和視頻技術的廣泛發展,數字圖像采集在電子通信與信息處理領域得到了廣泛的應用,例如廣播電視的數字化、網絡視頻、監視監控系統等. 視頻圖像采集卡作為計算機視頻應用的前端設備,承擔著模擬視頻信號向數字視頻信號轉換的任務,在多媒體時代占據著重要的位置.設計一種功能靈活,使用方便,便于嵌入到系統中的視頻信號采集電路具有重要的實用意義. 本文首先介紹數字圖像采集系統的發展現狀和前景,提出了本次設計的目標: 完成基于PCI總線的高分辨率圖像采集卡設計.然后簡單介紹了本次設計用到的基本理論:數據采集理論,特別說明了采樣和量化的定義與區別,以及量化的幾種方式和量化與AD技術之間的關系. 圖像采集系統的基本構成,是以數字信號處理器為核心,控制外圍的A/D、D/A轉換器和外圍存儲器.本文對比了當下流行的DSP芯片和IFPGA芯片作為數字處理核心的優缺點,并根據系統實際需要,選用FPGA作為數字信號處理器.然后列舉了幾款常用A/D視頻芯片,還介紹了SDRAM控制的基本流程,最后提出了系統的整體設計方案. 圖像采集卡的硬件設計分為A/D前端模擬通道設計和FPGA數字信號傳輸及外圍電路設計.本文重點介紹了A/D芯片外圍電路連接和使用方法,對PCI總線和它的控制電路也做了詳細闡述.對圖像采集卡的PCB布局布線也有詳細說明. 圖像采集卡FPGA內部程序構成也是本文的一個重點.本次的程序設計主要分為數據采集模塊,即與A/D接口模塊,數據暫存模塊,即SDRAM讀寫控制模塊,數據處理模塊和數據傳輸模塊,即PCI控制模塊.重點在于對的SDRAM的連續讀寫控制和各個模塊間的協調工作.說明了.A/D采集數據從接收到存儲詳細過程,以及對SDRAM讀寫狀態機和PCI總線的操控. 最后介紹了硬件調試和FPGA程序驗證結果.詳細說明了以Modelsim為平臺的前端功能仿真和后端時序仿真,以及以SignalTapⅡ為平臺,程序下載到FPGA中進行的實時驗證.結果表明整個圖像采集系統基本達到了系統設計中所給出的性能指標,證明了整個系統設計的正確性和合理性.

    標簽: FPGA 高分辨率 圖像采集卡

    上傳時間: 2013-04-24

    上傳用戶:amandacool

  • MCS-51系列單片機芯片結構

    MCS-51系列單片機芯片結構:2.1  MCS—51系列單片機的結構原理2.1.1  MCS-51單片機邏輯結構          MCS-51單片機的系統結構框圖如圖2.1所示。 圖2.1    MCS-51單片機的系統結構框圖由圖2.1可以看出,單片機內部主要包含下列幾個部件:u       一個8位CPU;u       一個時鐘電路;u       4Kbyte程序存儲器;u       128byte數據存儲器;u       兩個16位定時/計數器;u       64Kbyte擴展總線控制電路;u       四個8-bit并行I/O端口;u       一個可編程串行接口;五個中斷源,其中包括兩個優先級嵌套中斷 1.  CPU        CPU即中央處理器的簡稱,是單片機的核心部件,它完成各種運算和控制操作,CPU由運算器和控制器兩部分電路組成。(1)運算器電路     運算器電路包括ALU(算術邏輯單元)、ACC(累加器)、B寄存器、狀態寄存器、暫存器1和暫存器2等部件,運算器的功能是進行算術運算和邏輯運算。 (2)控制器電路    控制器電路包括程序計數器PC、PC加1寄存器、指令寄存器、指令譯碼器、數據指針DPTR、堆棧指針SP、緩沖器以及定時與控制電路等。控制電路完成指揮控制工作,協調單片機各部分正常工作。

    標簽: MCS 51 單片機 芯片結構

    上傳時間: 2013-10-27

    上傳用戶:tianyi223

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