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通用計數(shù)器

  • 基於8951的計數(shù)器

    基於8951的計數(shù)器,用4位LED顯示,通過脈衝計數(shù),每一個下降沿計數(shù)一個

    標簽: 8951

    上傳時間: 2013-11-29

    上傳用戶:hgy9473

  • 倒數(shù)計時器 提供時間到關(guān)機的功能 可自由設(shè)定是否關(guān)機或者提供警示

    倒數(shù)計時器 提供時間到關(guān)機的功能 可自由設(shè)定是否關(guān)機或者提供警示

    標簽:

    上傳時間: 2016-02-02

    上傳用戶:lepoke

  • 德州儀器新款dsp TMS320F28335 看門狗程式設(shè)計,簡易重置看門狗計數(shù)功能,方便使用者開發(fā)程式!

    德州儀器新款dsp TMS320F28335 看門狗程式設(shè)計,簡易重置看門狗計數(shù)功能,方便使用者開發(fā)程式!

    標簽: F28335 28335 320F dsp

    上傳時間: 2013-12-20

    上傳用戶:woshini123456

  • 一個很好用的 lcd 時鐘程序 C語言 #include<reg51.h> #include<stdio.h> //定義計時器0 的重裝值 #define RELOAD

    一個很好用的 lcd 時鐘程序 C語言 #include<reg51.h> #include<stdio.h> //定義計時器0 的重裝值 #define RELOAD_HIGH 0x3C #define RELOAD_LOW 0xD2 //定義按鍵彈跳時間 #define DB_VAL //定義設(shè)置模式的最大時間間隔 #define TIMEOUT 200 //定義游標位置常數(shù) #define HOME 0 #define HOUR 1 #define MIN 2 #define SEC 3

    標簽: include define RELOAD stdio

    上傳時間: 2014-12-19

    上傳用戶:zukfu

  • 基于FPGA的通用異步收發(fā)器的設(shè)計.rar

    通用異步收發(fā)器(Universal Asynchronous Receiver Transmitter,UART)是一種能同時支持短距離和長距離數(shù)據(jù)傳輸?shù)拇型ㄐ沤涌?,被廣泛應(yīng)用于微機和外設(shè)之間的數(shù)據(jù)交換。像8251、NS8250、NS16550等都是常用的UART芯片,但是這些專用的串行接口芯片的缺點是數(shù)據(jù)傳輸速率比較慢,難以滿足高速率數(shù)據(jù)傳輸?shù)膱龊?,而更重要的就是它們都具有不可移植性,因此要利用這些芯片來實現(xiàn)PC機和FPGA芯片之間的通信,勢必會增加接口連線的復(fù)雜程度以及降低整個系統(tǒng)的穩(wěn)定性和有效性。 本課題就是針對UART的特點以及FPGA設(shè)計具有可移植性的優(yōu)勢,提出了一種基于FPGA芯片的嵌入式UART設(shè)計方法,其中主要包括狀態(tài)機的描述形式以及自頂向下的設(shè)計方法,利用硬件描述語言來編制UART的各個子功能模塊以及頂層模塊,之后將其集成到FPGA芯片的內(nèi)部,這樣不僅能解決傳統(tǒng)UART芯片的缺點而且同時也使整個系統(tǒng)變得更加具有緊湊性以及可靠性。 本課題所設(shè)計的LIART支持標準的RS-232C傳輸協(xié)議,主要設(shè)計有發(fā)送模塊、接收模塊、線路控制與中斷仲裁模塊、Modem控制模塊以及兩個獨立的數(shù)據(jù)緩沖區(qū)FIFO模塊。該模塊具有可變的波特率、數(shù)據(jù)幀長度以及奇偶校驗方式,還有多種中斷源、中斷優(yōu)先級、較強的抗干擾數(shù)據(jù)接收能力以及芯片內(nèi)部自診斷的能力,模塊內(nèi)分開的接收和發(fā)送數(shù)據(jù)緩沖寄存器能實現(xiàn)全雙工通信。除此之外最重要的是利用IP模塊復(fù)用技術(shù)設(shè)計數(shù)據(jù)緩沖區(qū)FIFO,采用兩種可選擇的數(shù)據(jù)緩沖模式。這樣既可以應(yīng)用于高速的數(shù)據(jù)傳輸環(huán)境,也能適合低速的數(shù)據(jù)傳輸場合,因此可以達到資源利用的最大化。 在具體的設(shè)計過程中,利用Synplify Pro綜合工具、ModelSim仿真工具、ISE集成的軟件開發(fā)環(huán)境中對各個功能模塊進行綜合優(yōu)化、仿真驗證以及下載實現(xiàn)。各項數(shù)據(jù)結(jié)果表明,本課題中所設(shè)計的UART滿足預(yù)期設(shè)計目標。

    標簽: FPGA 異步收發(fā)器

    上傳時間: 2013-08-02

    上傳用戶:rocketrevenge

  • 用Verilog實現(xiàn)基于FPGA的通用分頻器

    用Verilog實現(xiàn)基于FPGA的通用分頻器

    標簽: Verilog FPGA 分頻器

    上傳時間: 2013-08-30

    上傳用戶:xingyuewubian

  • 用VerilogHDL實現(xiàn)基于FPGA的通用分頻器的設(shè)計

    用VerilogHDL實現(xiàn)基于FPGA的通用分頻器的設(shè)計

    標簽: VerilogHDL FPGA 分頻器

    上傳時間: 2013-10-28

    上傳用戶:xiaoxiang

  • 用VerilogHDL實現(xiàn)基于FPGA的通用分頻器的設(shè)計

    用VerilogHDL實現(xiàn)基于FPGA的通用分頻器的設(shè)計

    標簽: VerilogHDL FPGA 分頻器

    上傳時間: 2015-01-02

    上傳用戶:oooool

  • 本人自已寫的一個24點的計算器 希望大家多多的幫我改正。 有什麼更好的算法

    本人自已寫的一個24點的計算器 希望大家多多的幫我改正。 有什麼更好的算法,還請指點!

    標簽: 算法

    上傳時間: 2014-01-25

    上傳用戶:z754970244

  • 通用異步收發(fā)器st2552的驅(qū)動程序

    通用異步收發(fā)器st2552的驅(qū)動程序,對于運用UART通信來講具有通用性。

    標簽: 2552 st 異步收發(fā)器 驅(qū)動程序

    上傳時間: 2014-01-06

    上傳用戶:6546544

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