單片機(jī)應(yīng)用
資源簡(jiǎn)介：基于51單片機(jī)開發(fā)的多功能桌面助手，時(shí)鐘、互聯(lián)網(wǎng)控制、智能家居硬件和軟件并搭載了嵌入式WiFi模塊，MP3模塊，語音識(shí)別模塊等。 它擁有的功能如下： 1：萬年歷（包括時(shí)間、日期、星期、溫度、鬧鐘） 2：非特定人聲語音識(shí)別操作（能識(shí)別開燈、開空調(diào)等簡(jiǎn)...
上傳時(shí)間： 2022-07-19
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資源簡(jiǎn)介：單片機(jī)應(yīng)用
上傳時(shí)間： 2013-11-22
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資源簡(jiǎn)介：Matlab命令大全
上傳時(shí)間： 2013-05-15
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資源簡(jiǎn)介：基于Verilog HDL設(shè)計(jì)的多功能數(shù)字鐘，有興趣的
上傳時(shí)間： 2013-11-26
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資源簡(jiǎn)介：基于單片機(jī)的多功能數(shù)字時(shí)鐘設(shè)計(jì)這是一份非常不錯(cuò)的資料，歡迎下載，希望對(duì)您有幫助！
上傳時(shí)間： 2021-12-06
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資源簡(jiǎn)介：基于51單片機(jī)設(shè)計(jì)的用1602 顯示數(shù)字鐘 頻率計(jì) 歌曲
上傳時(shí)間： 2014-01-05
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資源簡(jiǎn)介：本文利用Verilog HDL 語言自頂向下的設(shè)計(jì)方法設(shè)計(jì)多功能數(shù)字鐘，突出了其作為硬件描述語言的良好的可讀性、可移植性和易理解等優(yōu)點(diǎn)，并通過Altera QuartusⅡ 4.1 和ModelSim
上傳時(shí)間： 2013-07-21
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資源簡(jiǎn)介：本文利用Verilog HDL 語言自頂向下的設(shè)計(jì)方法設(shè)計(jì)多功能數(shù)字鐘，突出了其作為硬件描述語言的良好的可讀性、可移植性和易理解等優(yōu)點(diǎn)，并通過Altera QuartusⅡ 4.1 和ModelSim SE 6.0 完成綜合、仿真。此程序通過下載到FPGA 芯片后，可應(yīng)用于實(shí)際的數(shù)字鐘顯示中...
上傳時(shí)間： 2013-11-10
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資源簡(jiǎn)介：這是用單片機(jī)實(shí)現(xiàn)的多功能數(shù)字鐘,通過8255擴(kuò)展端口,AD0809將模擬信號(hào)轉(zhuǎn)換成數(shù)字信號(hào)進(jìn)行處理,可以比較精確的測(cè)出電壓值.
上傳時(shí)間： 2014-12-20
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資源簡(jiǎn)介：基于51單片機(jī)設(shè)計(jì)的實(shí)時(shí)溫度程序，通過18b20能準(zhǔn)確的測(cè)試外界的溫度
上傳時(shí)間： 2016-07-09
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資源簡(jiǎn)介：基于51單片機(jī)設(shè)計(jì)的實(shí)時(shí)測(cè)試距離的程序，能夠測(cè)試距離
上傳時(shí)間： 2016-07-09
上傳用戶：rocketrevenge
資源簡(jiǎn)介：這是一個(gè)在MTALAB 中采用的SIMULIN設(shè)計(jì)的多功能數(shù)字頻率合成器的源代碼
上傳時(shí)間： 2014-01-13
上傳用戶：小鵬
資源簡(jiǎn)介：基于51單片機(jī)設(shè)計(jì)的紅外熱釋電的人體感應(yīng)報(bào)警器原理圖和源碼
上傳時(shí)間： 2022-07-16
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資源簡(jiǎn)介：基于51單片機(jī)控制的1602液晶電子時(shí)鐘顯示程序
上傳時(shí)間： 2016-02-11
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資源簡(jiǎn)介：基于51單片機(jī)控制的1602液晶電子時(shí)鐘顯示程序
上傳時(shí)間： 2013-12-17
上傳用戶：hasan2015
資源簡(jiǎn)介：【設(shè)計(jì)題目】 多功能數(shù)字鐘的設(shè)計(jì) 【設(shè)計(jì)目的】 1掌握數(shù)字系統(tǒng)的分析和設(shè)計(jì)方法 2能夠熟練的、合理的選用集成電路器件 3熟悉EWB軟件的使用。 【設(shè)計(jì)指標(biāo)及要求】 設(shè)計(jì)一個(gè)多功能數(shù)字鐘，以一晝夜24小時(shí)為一個(gè)計(jì)數(shù)周期。準(zhǔn)確計(jì)時(shí)，具有“時(shí)”“分”“...
上傳時(shí)間： 2014-12-08
上傳用戶：亞亞娟娟123
資源簡(jiǎn)介：設(shè)計(jì)一個(gè)多功能數(shù)字鐘，以一晝夜24小時(shí)為一個(gè)計(jì)數(shù)周期。準(zhǔn)確計(jì)時(shí)，具有“時(shí)”“分”“秒”數(shù)字顯示。整點(diǎn)能自動(dòng)打點(diǎn)、報(bào)時(shí)。要求報(bào)時(shí)聲響四低一高，最后一響為整點(diǎn)。具有校時(shí)功能。要求電路主要采用中小規(guī)模CMOS集成電路。要求電路盡量簡(jiǎn)化，并選用同類型的器...
上傳時(shí)間： 2013-12-29
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資源簡(jiǎn)介：多功能數(shù)字鐘設(shè)計(jì) 一、設(shè)計(jì)任務(wù)： （一）主體功能 用HDL設(shè)計(jì)一個(gè)多功能數(shù)字鐘，包含以下主要功能： 1.計(jì)時(shí)及校時(shí)，時(shí)間可以24小時(shí)制或12小時(shí)制顯示 2.日歷：顯示年月日星期，及設(shè)定設(shè)定功能 3.跑表：?jiǎn)?dòng)/停止/保持顯示/清除 4.鬧鐘：設(shè)定鬧鐘時(shí)間，整...
上傳時(shí)間： 2013-12-31
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資源簡(jiǎn)介：采用Verilog HDL語言編寫的多功能數(shù)字鐘，包括四個(gè)功能：時(shí)間顯示與設(shè)置、秒表、鬧鐘、日期顯示與設(shè)置，源代碼對(duì)FPGA和CPLD學(xué)習(xí)者價(jià)值很高，
上傳時(shí)間： 2016-03-21
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資源簡(jiǎn)介：基于51單片機(jī)控制的掉電數(shù)據(jù)存儲(chǔ)器，可以保證數(shù)據(jù)在掉電時(shí)保存
上傳時(shí)間： 2016-04-18
上傳用戶：thinode
資源簡(jiǎn)介：用高速硬件語言VHDL設(shè)計(jì)的全功能數(shù)字鐘，經(jīng)測(cè)試運(yùn)行穩(wěn)定
上傳時(shí)間： 2016-12-26
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資源簡(jiǎn)介：單片機(jī)AT89C52的多功能顯示電路，及相應(yīng)代碼。
上傳時(shí)間： 2017-01-09
上傳用戶：semi1981
資源簡(jiǎn)介：基于STM32F103的ADC試驗(yàn)例程，c語言代碼。
上傳時(shí)間： 2022-06-08
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資源簡(jiǎn)介：基于51單片機(jī)的多功能數(shù)字鐘。時(shí)間，年月日，多組鬧鐘，議程。且外接24C04的EEPROM后可保存設(shè)置。蜂鳴器由I/O口接三極管放大后驅(qū)動(dòng)。
上傳時(shí)間： 2013-12-29
上傳用戶：dengzb84
資源簡(jiǎn)介：基于單片機(jī)多功能數(shù)字時(shí)鐘的設(shè)計(jì)與制作這是一份非常不錯(cuò)的資料，歡迎下載，希望對(duì)您有幫助！
上傳時(shí)間： 2021-12-03
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資源簡(jiǎn)介：基于FPGA的多功能數(shù)字鐘的設(shè)計(jì)與實(shí)現(xiàn) 內(nèi)附有詳盡的Verilog HDL源碼，其功能主要有：時(shí)間設(shè)置，時(shí)間顯示，跑表，分頻，日期設(shè)置，日期顯示等
上傳時(shí)間： 2013-08-18
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資源簡(jiǎn)介：介紹一種基于單片機(jī)控制的多功能直流穩(wěn)壓電源的設(shè)計(jì)方案。該電源簡(jiǎn)單易用 ,精度高、成 本低 ,可以用作信號(hào)發(fā)生器 ,產(chǎn)生輸出正弦波、方波、三角波、鋸齒波等多種波形信號(hào) 通過軟件升級(jí)很容 易實(shí)現(xiàn)功能擴(kuò)展。
上傳時(shí)間： 2015-10-14
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資源簡(jiǎn)介：基于FPGA的多功能數(shù)字鐘Verilog設(shè)計(jì)2007-06-17 21:06基本功能： 1．具有時(shí)、分、秒計(jì)數(shù)顯示功能（6位數(shù)碼管構(gòu)成），以24小時(shí)循環(huán)為計(jì)時(shí)基準(zhǔn)。 2. 具有調(diào)節(jié)小時(shí)、分鐘的功能。 3．具有整點(diǎn)報(bào)時(shí)功能，整點(diǎn)報(bào)時(shí)的同時(shí)數(shù)碼管顯示閃爍提示。
上傳時(shí)間： 2016-03-10
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資源簡(jiǎn)介：基于單片機(jī)的車載多功能數(shù)字時(shí)鐘,整個(gè)電子鐘用兩個(gè)鍵來調(diào)節(jié)時(shí)間和日期
上傳時(shí)間： 2016-07-05
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資源簡(jiǎn)介：基于FPGA的多功能數(shù)字鐘的設(shè)計(jì)與實(shí)現(xiàn) 內(nèi)附有詳盡的Verilog HDL源碼，其功能主要有：時(shí)間設(shè)置，時(shí)間顯示，跑表，分頻，日期設(shè)置，日期顯示等
上傳時(shí)間： 2016-09-06
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