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基于FPGA的高速高階FIR濾波器設(shè)計

  • 資源大小:1654 K
  • 上傳時間: 2013-07-18
  • 上傳用戶:spie1
  • 資源積分:2 下載積分
  • 標      簽: FPGA FIR 濾波器設(shè)計

資 源 簡 介

  隨著雷達、圖像、通信等領(lǐng)域?qū)π盘柛咚偬幚淼囊螅芯咳藛T正尋求高速的數(shù)字信號處理算法,以滿足這種高速地處理數(shù)據(jù)的需要。常用的高速實時數(shù)字信號處理的器件有ASIC、可編程的數(shù)字信號處理芯片、FPGA,等等。  本文研究了時域FPGA上實現(xiàn)高速高階FIR數(shù)字濾波器結(jié)構(gòu),并實現(xiàn)了高壓縮比的LFM脈沖信號的匹配濾波。文章根據(jù)FIR數(shù)字濾波器理論,分析比較實現(xiàn)了FIR濾波器的方法;使用并行分布式算法,在Xilinx的VirtexⅡFPGA系列芯片上設(shè)計了高速高階FIR濾波器。并詳細進行了分析;設(shè)計出了一個256階的線性調(diào)頻脈沖壓縮信號的匹配濾波器設(shè)計實例,并用ModelSim軟件進行了仿真。

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