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基于FPGA的I2C總線控制器的設計

  • 資源大小:1852 K
  • 上傳時間: 2013-04-24
  • 上傳用戶:zdhloo
  • 資源積分:2 下載積分
  • 標      簽: FPGA I2C 總線控制器

資 源 簡 介

本文利用Verilog HDL語言在FPGA上實現I<'2>C總線控制器的功能。首先,研究了I<'2>C總線的規范,又簡要介紹了Quartus Ⅱ設計環境和設計方法,以及FPGA的設計流程。在此基礎上,重點介紹了I<'2>C控制器的總體設計方案,詳細描述時序狀態機的工作原理和Verilog HDL語言的實現,以及在Quartus Ⅱ平臺上的時序仿真。采用了自頂向下的設計方法,利用了Verilog HDL語言的結構描述風格,把整個設計分成6個模塊,時鐘分頻模塊,寄存器組模塊,數據接收模塊,數據發送模塊,輸出緩沖模塊,時序控制模塊,項層模塊也采用語言描述。以Altera公司的cycloneⅡ系列的EP2C35器件為載體,設置相應的參數,在Quartus Ⅱ開發平臺上,實現系統的功能和時序仿真。

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