aes算法的verilog hdl實現,供給大家作為參考 。
資源簡介:aes算法的verilog hdl實現,供給大家作為參考 。
上傳時間: 2013-12-18
上傳用戶:gundan
資源簡介:aes高級加密算法的verilog語言實現。同時附有aes協議的pdf文檔,和此代碼的測試程序,可作為一個IP核直接使用,可減少開發人員的設計時間。
上傳時間: 2014-01-08
上傳用戶:PresidentHuang
資源簡介:cordic算法的verilog hdl具體實現
上傳時間: 2013-12-06
上傳用戶:2467478207
資源簡介:一個關于DES算法的verilog語言實現,包括了各個實現模塊以及測試模塊
上傳時間: 2014-01-23
上傳用戶:璇珠官人
資源簡介:aes算法的C語言實現方案,可以借鑒學習
上傳時間: 2014-01-12
上傳用戶:xsnjzljj
資源簡介:aes算法的verilog代碼,即aes算法IP核
上傳時間: 2017-09-02
上傳用戶:zhangzhenyu
資源簡介:從算法設計到硬線邏輯的實現:復雜數字邏輯系統的verilog hdl設計技術和方法,結合DSP算法介紹verilog hdl 設計。
上傳時間: 2016-12-16
上傳用戶:xiaohuanhuan
資源簡介:基于FPGA的多功能數字鐘的設計與實現 內附有詳盡的verilog hdl源碼,其功能主要有:時間設置,時間顯示,跑表,分頻,日期設置,日期顯示等
上傳時間: 2013-08-18
上傳用戶:問題問題
資源簡介:用verilog hdl實現曼徹斯特編碼的源碼
上傳時間: 2013-12-29
上傳用戶:lhc9102
資源簡介:MD5算法的verilog實現,同時包含有testbench。
上傳時間: 2014-01-09
上傳用戶:1159797854
資源簡介:des加密算法的verilog語言的實現
上傳時間: 2015-04-10
上傳用戶:leixinzhuo
資源簡介:aes算法的c++實現及其加密解密過程所需時間的測試,無解壓密碼
上傳時間: 2014-01-12
上傳用戶:xiaohuanhuan
資源簡介:verilog hdl實現的I2C Slave模擬
上傳時間: 2014-11-17
上傳用戶:ztj182002
資源簡介:硬件描述語言,verilog hdl,實現了解碼器的設計
上傳時間: 2013-12-22
上傳用戶:sclyutian
資源簡介:原創verilog hdl 實現CACHE的操作,有需要請下載
上傳時間: 2015-09-20
上傳用戶:181992417
資源簡介:aes加密算法的VS2005工程實現,方便易用,在VS2005環境直接生成解決方案就能生成可執行程序,很好。
上傳時間: 2013-12-25
上傳用戶:1966640071
資源簡介:本代碼是C語言實現的aes算法的源代碼。aes是繼DES之后目前最為流行的對稱加密算法。
上傳時間: 2016-02-14
上傳用戶:開懷常笑
資源簡介:aes加密算法的Vhdl代碼實現,在FPGA芯片上調試過
上傳時間: 2014-08-23
上傳用戶:guanliya
資源簡介:這是關于2分頻的vhdl實現和verilog hdl實現,都已經仿真驗證了其正確性,大家可以對比參考。
上傳時間: 2014-10-27
上傳用戶:lwwhust
資源簡介:用verilog hdl實現的曼徹斯特編碼器和解碼器。
上傳時間: 2013-12-23
上傳用戶:lifangyuan12
資源簡介:用verilog hdl實現的1553B航空電子總線接口。
上傳時間: 2016-05-19
上傳用戶:許小華
資源簡介:aes算法c++實現源碼 可以用于對文檔進行基于aes算法的加密和解密功能
上傳時間: 2016-06-18
上傳用戶:ywqaxiwang
資源簡介:用verilog hdl實現的VGA顯示彩條信號,其中包括VGA時序、豎彩條、橫彩條、棋盤格
上傳時間: 2016-06-29
上傳用戶:yangbo69
資源簡介:密碼學中的aes算法的C++有一實現 密碼學中的aes算法的C++有一實現
上傳時間: 2016-07-05
上傳用戶:凌云御清風
資源簡介:密碼學中的aes算法的C語言又一實現 密碼學中的aes算法的C語言又一實現
上傳時間: 2014-11-23
上傳用戶:watch100
資源簡介:用VHADL和verilog hdl實現帶進位的8位加減法器。
上傳時間: 2016-07-12
上傳用戶:bruce
資源簡介:包含了四位計數器等基本數字模塊的的verilog hdl程序代碼,該功能實現,可以直接利用DC進行綜合,得到硬件電路,亦能夠轉換成Vhdl語言進行綜合
上傳時間: 2013-12-19
上傳用戶:hopy
資源簡介:基于FPGA的多功能數字鐘的設計與實現 內附有詳盡的verilog hdl源碼,其功能主要有:時間設置,時間顯示,跑表,分頻,日期設置,日期顯示等
上傳時間: 2016-09-06
上傳用戶:1583060504
資源簡介:用verilog hdl實現的任意 頻率分頻器源代碼,是一個通用的程序
上傳時間: 2014-01-07
上傳用戶:alan-ee
資源簡介:實現十字路口簡單交通燈的verilog hdl源代碼,可以實現
上傳時間: 2013-12-17
上傳用戶:plsee