用verilog HDL實現(xiàn)曼徹斯特編碼的源碼
資源簡介:用verilog HDL實現(xiàn)曼徹斯特編碼的源碼
上傳時間: 2013-12-29
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資源簡介:用cpld實現(xiàn)曼徹斯特編碼 用verilog HDL進(jìn)行曼徹斯特編碼,用于通信中
上傳時間: 2015-05-02
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資源簡介:用verilog HDL實現(xiàn)狀態(tài)機的設(shè)計
上傳時間: 2014-01-22
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資源簡介:用鏈表實現(xiàn)Josephus問題的源碼,混一個得分點吧
上傳時間: 2014-01-19
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資源簡介:用verilog HDL實現(xiàn)的曼徹斯特編碼器和解碼器。
上傳時間: 2013-12-23
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資源簡介:用cpld實現(xiàn)曼徹斯特編碼\r\n用verilog HDL進(jìn)行曼徹斯特編碼,用于通信中
上傳時間: 2013-09-07
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資源簡介:用verilog HDL實現(xiàn)的1553B航空電子總線接口。
上傳時間: 2016-05-19
上傳用戶:許小華
資源簡介:用verilog HDL實現(xiàn)的VGA顯示彩條信號,其中包括VGA時序、豎彩條、橫彩條、棋盤格
上傳時間: 2016-06-29
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資源簡介:用verilog HDL實現(xiàn)了83編碼器.
上傳時間: 2016-07-15
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資源簡介:用verilog HDL實現(xiàn)的任意 頻率分頻器源代碼,是一個通用的程序
上傳時間: 2014-01-07
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資源簡介:用verilog HDL實現(xiàn)I2C Master Controller 的設(shè)計,包括主程序設(shè)計和測試程序設(shè)計
上傳時間: 2014-01-04
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資源簡介:用Pascal實現(xiàn)訪問USB的源碼
上傳時間: 2015-02-01
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資源簡介:用usb實現(xiàn)數(shù)據(jù)傳輸?shù)脑创a,已經(jīng)產(chǎn)品化,有參考價值
上傳時間: 2015-04-08
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資源簡介:用verilog HDL實現(xiàn)I2C總線功能,對I2C總線有很大幫助
上傳時間: 2013-12-28
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資源簡介:用verilog HDL實現(xiàn)I2C總線功能,對I2C總線有很大幫助
上傳時間: 2013-12-31
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資源簡介:用單片機實現(xiàn)出租車計價器的源碼,是參加全國大學(xué)生電子設(shè)計比賽的訓(xùn)練時寫的, 和普通的計價器比,考慮到實際多種情況與環(huán)境。
上傳時間: 2016-01-06
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資源簡介:實現(xiàn)了哈夫曼編碼的源碼函數(shù),下面的字湊個數(shù)
上傳時間: 2016-01-06
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資源簡介:實現(xiàn)了行程編碼編碼的源碼函數(shù),下面的字湊個數(shù)
上傳時間: 2016-01-06
上傳用戶:凌云御清風(fēng)
資源簡介:實現(xiàn)了香農(nóng)費諾 編碼的源碼函數(shù),下面的字湊個數(shù)
上傳時間: 2016-01-06
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資源簡介:用DELPHI控制網(wǎng)頁元素實現(xiàn)在線翻譯的源碼
上傳時間: 2014-01-09
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資源簡介:數(shù)字時鐘顯示模塊,用verilog HDL 實現(xiàn)
上傳時間: 2016-03-03
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資源簡介:用verilog HDL 實現(xiàn)時鐘(時和分)
上傳時間: 2013-12-26
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資源簡介:文件中包含有用fpga實現(xiàn)isp接口的源碼,以及和處理器接口,測試時處理器是ARM7。
上傳時間: 2013-09-01
上傳用戶:Aeray
資源簡介:這是在C5000系列DSP上實現(xiàn)FIR濾波器的源碼,是用匯編語言編寫的,可直接在CCS上運行
上傳時間: 2016-06-12
上傳用戶:aeiouetla
資源簡介:verilog HDL 實際工控項目源碼\r\n開發(fā)工具 altera quartus2
上傳時間: 2013-09-05
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資源簡介:一個實現(xiàn)文件加密的源碼
上傳時間: 2013-12-26
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資源簡介:實現(xiàn)在線升級的源碼
上傳時間: 2013-12-18
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資源簡介:用并口模擬I2C總線的源碼
上傳時間: 2014-01-25
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資源簡介:matlab的GA工具箱與vc混和實現(xiàn)遺傳算法的源碼
上傳時間: 2015-02-28
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資源簡介:用ADO.Net實現(xiàn)通用數(shù)據(jù)庫編程源碼.rar
上傳時間: 2013-12-18
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