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This Verilog HDL description implements a UART.

  • 資源大小:4 K
  • 上傳時間: 2013-12-17
  • 上傳用戶:Sundaymorn
  • 資源積分:2 下載積分
  • 標      簽: description implements Verilog This

資 源 簡 介

This Verilog HDL description implements a UART.

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