Verilog-RISC CPU 代碼 實現了簡單的RISC cpu - 免費下載

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Verilog-RISC CPU 代碼 實現了簡單的RISC cpu，可供初學者參考，學習硬件描述語言，及設計方法。該程序通過了modelsim仿真驗證。 北航

源碼文件列表

?? 共 21 個源碼文件 點擊文件名可在線查看源代碼

1 ??
datactl.v
大小: 307 B
查看源碼
2 ??
test1.pro
大小: 3.15 KB
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3 ??
test2.dat
大小: 442 B
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4 ??
clk_gen.v
大小: 2.76 KB
查看源碼
5 ??
counter.v
大小: 493 B
查看源碼
7 ??
adr.v
大小: 345 B
查看源碼
8 ??
machine.v
大小: 3.79 KB
查看源碼
9 ??
rom.v
大小: 220 B
查看源碼
10 ??
test1.dat
大小: 442 B
查看源碼
11 ??
test2.pro
大小: 1.36 KB
查看源碼
12 ??
test3.dat
大小: 494 B
查看源碼
14 ??
cpu.v
大小: 2.2 KB
查看源碼
15 ??
accum.v
大小: 350 B
查看源碼
??
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