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RISC

  • 基于FPGA的32位RISC處理器設(shè)計(jì)與實(shí)現(xiàn)

    隨著SOC技術(shù)、IP技術(shù)以及集成電路技術(shù)的發(fā)展，RISC軟核處理器的研究與開發(fā)設(shè)計(jì)開始受到了人們的重視。基于FPGA的RISC軟核處理器在各個(gè)行業(yè)開始得到了廣泛的應(yīng)用，特別是在一些基于FPGA的嵌入式系統(tǒng)中有著越來(lái)越廣泛的應(yīng)用前景。 該論文在研究了大量國(guó)內(nèi)外技術(shù)文獻(xiàn)的基礎(chǔ)上，總結(jié)了RISC處理器發(fā)展的現(xiàn)狀與水平。認(rèn)真分析了RISC處理器的基本結(jié)構(gòu)，包括總線結(jié)構(gòu)，流水線處理的原理，以及流水線數(shù)據(jù)通路和流水線控制的原理；并詳細(xì)分析了該設(shè)計(jì)采用的指令集——MIPS指令集的內(nèi)在結(jié)構(gòu)。設(shè)計(jì)出了一個(gè)32位RISC軟核處理器，這個(gè)軟核處理器采用五級(jí)流水線結(jié)構(gòu)，能完成加法、減法、邏輯與、邏輯或、左移右移等算術(shù)邏輯操作，以及它們的組合操作。通過軟件仿真和在Altera的FPGA開發(fā)板上進(jìn)行驗(yàn)證，證明了所設(shè)計(jì)的32位RISC處理器能準(zhǔn)確的執(zhí)行所選用的MIPS指令集，運(yùn)行速度能達(dá)到30MHz，功能良好。 通過對(duì)所設(shè)計(jì)對(duì)象特點(diǎn)及其可行性的研究，選用了Altera公司QuartusⅡ軟件作為設(shè)計(jì)與仿真驗(yàn)證的環(huán)境。在設(shè)計(jì)方法上，該課題采用了自頂向下的設(shè)計(jì)方法。在設(shè)計(jì)過程中采用了邊設(shè)計(jì)邊驗(yàn)證這種設(shè)計(jì)與驗(yàn)證相結(jié)合的設(shè)計(jì)流程，大大提高了設(shè)計(jì)的可靠性。該課題在設(shè)計(jì)過程中還提出了兩個(gè)有效的設(shè)計(jì)思路：第一是在32位寄存器的設(shè)計(jì)中利用FPGA的內(nèi)部RAM資源來(lái)設(shè)計(jì)，減少了傳輸延時(shí)，提高了運(yùn)行速度，并大大減少了對(duì)FPGA內(nèi)部資源的占用；第二是在系統(tǒng)架構(gòu)上采用了柔性化的設(shè)計(jì)方法，使得設(shè)計(jì)可以根據(jù)實(shí)際的需求適當(dāng)?shù)脑鰷p相應(yīng)的部件，以達(dá)到需求與性能的統(tǒng)一。這兩個(gè)方法都有效地解決了設(shè)計(jì)中出現(xiàn)的問題，提高了處理器的性能。

    標(biāo)簽： FPGA RISC 處理器

    上傳時(shí)間： 2013-07-21

    上傳用戶：caozhizhi

  • 英文原版書籍：Guide to RISC Processors For Programmers and Engineers

    ·英文原版書籍：Guide to RISC Processors For Programmers and Engineers

    標(biāo)簽： nbsp Programmers Processors Engineers

    上傳時(shí)間： 2013-06-27

    上傳用戶：zzy7826

  • Building a RISC System in an FPGA

    Building a RISC System in an FPGA

    標(biāo)簽： Building System RISC FPGA

    上傳時(shí)間： 2013-09-04

    上傳用戶：朗朗乾坤

  • ACELP在RISC處理器的移植與優(yōu)化

    本文首先介紹了語(yǔ)音編碼實(shí)現(xiàn)領(lǐng)域發(fā)展?fàn)顩r，然后對(duì)DSP平臺(tái)上實(shí)現(xiàn)語(yǔ)音標(biāo)準(zhǔn)進(jìn)行了較為詳細(xì)的研究和闡述，最后給出了基于RISC處理器平臺(tái)上語(yǔ)音標(biāo)準(zhǔn)的一個(gè)系統(tǒng)實(shí)現(xiàn).

    標(biāo)簽： ACELP RISC 處理器 移植

    上傳時(shí)間： 2013-10-20

    上傳用戶：Bunyan

  • 8位RISC　CPU的VERILOG編程　SOURCECODE

    8位RISC　CPU的VERILOG編程　SOURCECODE

    標(biāo)簽： SOURCECODE VERILOG RISC CPU

    上傳時(shí)間： 2015-01-09

    上傳用戶：Andy123456

  • 幾個(gè)VHDL的源代碼和和一個(gè)本人編寫的5級(jí)流水線RISC CPU的代碼

    幾個(gè)VHDL的源代碼和和一個(gè)本人編寫的5級(jí)流水線RISC CPU的代碼

    標(biāo)簽： VHDL RISC CPU 源代碼

    上傳時(shí)間： 2013-12-02

    上傳用戶：jyycc

  • RISC的指令VerilogHDL實(shí)現(xiàn)

    RISC的指令VerilogHDL實(shí)現(xiàn)

    標(biāo)簽： VerilogHDL RISC 指令

    上傳時(shí)間： 2014-10-31

    上傳用戶：dianxin61

  • 詳細(xì)的介紹了RISC技術(shù)

    詳細(xì)的介紹了RISC技術(shù)，是不可多得的入門讀物

    標(biāo)簽： RISC

    上傳時(shí)間： 2014-11-27

    上傳用戶：busterman

  • 這是一個(gè)很好的Verilog 編寫的8位RISC CPU源碼（可做為MCU）

    這是一個(gè)很好的Verilog 編寫的8位RISC CPU源碼（可做為MCU），并且包括完整的C 語(yǔ)言的測(cè)試代碼。

    標(biāo)簽： Verilog RISC CPU MCU

    上傳時(shí)間： 2014-01-05

    上傳用戶：李夢(mèng)晗

  • 這是一個(gè)Verilog HDL編寫的RISC cpu的程序

    這是一個(gè)Verilog HDL編寫的RISC cpu的程序，該程序共10個(gè)子程序，實(shí)現(xiàn)了簡(jiǎn)單的RISC cpu，可供初學(xué)者參考，學(xué)習(xí)硬件描述語(yǔ)言，及設(shè)計(jì)方法。該程序通過了modelsim仿真驗(yàn)證。

    標(biāo)簽： Verilog RISC HDL cpu

    上傳時(shí)間： 2015-03-26

    上傳用戶：qiao8960

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