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《ALTERA FPGA/CPLD高級(jí)篇》高速DDR存儲(chǔ)器數(shù)據(jù)接口設(shè)計(jì)實(shí)例

  • 資源大?。?/b>25 K
  • 上傳時(shí)間: 2014-01-08
  • 上傳用戶:li444255
  • 資源積分:2 下載積分
  • 標(biāo)      簽: ALTERA FPGA CPLD DDR

資 源 簡(jiǎn) 介

《ALTERA FPGA/CPLD高級(jí)篇》高速DDR存儲(chǔ)器數(shù)據(jù)接口設(shè)計(jì)實(shí)例

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