網(wǎng)上流傳的usb_blaster原理圖里的CPLD源碼,主要是實(shí)現(xiàn)usb時(shí)序轉(zhuǎn)換成JATG時(shí)序輸出！ - 免費(fèi)下載

VHDL/FPGA/Verilog資源 文件大小：52 K

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RAR
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52 K
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資源簡(jiǎn)介

網(wǎng)上流傳的usb_blaster原理圖里的CPLD源碼,主要是實(shí)現(xiàn)usb時(shí)序轉(zhuǎn)換成JATG時(shí)序輸出！

源碼文件列表

?? 共 22 個(gè)源碼文件 點(diǎn)擊文件名可在線查看源代碼

1 ??
makefile
大小: 232 B
查看源碼
2 ??
eecksum.c
大小: 376 B
查看源碼
3 ??
makefile
大小: 144 B
查看源碼
4 ??
devtest.c
大小: 2.96 KB
查看源碼
5 ??
usb_jtag.patch
大小: 22.6 KB
查看源碼
7 ??
openocd.cfg
大小: 117 B
查看源碼
8 ??
usb_jtag.patch
大小: 23.78 KB
查看源碼
9 ??
dscr.a51
大小: 7.48 KB
查看源碼
10 ??
usbjtag.c
大小: 17.69 KB
查看源碼
11 ??
usbjtag.uv2
大小: 2.3 KB
查看源碼
12 ??
fw.c
大小: 12.6 KB
查看源碼
13 ??
usbjtag.opt
大小: 1.32 KB
查看源碼
14 ??
eeprom.c
大小: 2.45 KB
查看源碼
15 ??
shift.a51
大小: 3.17 KB
查看源碼
??
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