摘 要：以上海地區的出租車計費器為例 - 免費下載

VHDL/FPGA/Verilog資源 文件大小：208 K

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資源簡介

摘 要：以上海地區的出租車計費器為例，利用Verilog HDL語言設計了出租車計費器，使其具有時間 顯示、計費以及模擬出租車啟動、停止、復位等功能，并設置了動態掃描電路顯示車費和對應時間，顯示 了硬件描述語言Verilog—HDL設計數字邏輯電路的優越性。源程序經MAX+PLUS Ⅱ軟件調試、優 化，下載到EPF1OK10TC144—3芯片中，可應用于實際的出租車收費系統。 關鍵詞：Verilog HDL；電子自動化設計；硬件描述語言；MAX+PLUSⅡ

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