實現一個FIR濾波器 - 免費下載

VHDL/FPGA/Verilog資源 文件大小：1604 K

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資源簡介

實現一個FIR濾波器，基于直接型型算法 輸入數據寬度：8位 輸出數據寬度：16位 階數：16階 濾波器經轉換后（右移16位）的特征參數為： h[0]=h[15]=0000 h[1]=h[14]=0065 h[2]=h[13]=018F h[3]=h[12]=035A h[4]=h[11]=0579 h[5]=h[10]=078E h[6]=h[9]=0935 h[7]=h[8]=0A1F

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