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本程序是在傳輸流傳輸過(guò)程中對(duì)節(jié)目時(shí)鐘字段進(jìn)行檢測(cè)與修改,采用Verilog HDL 語(yǔ)言進(jìn)行編程。

  • 資源大小:5 K
  • 上傳時(shí)間: 2013-12-27
  • 上傳用戶(hù):jellylihui
  • 資源積分:2 下載積分
  • 標(biāo)      簽: Verilog HDL 程序 傳輸流

資 源 簡(jiǎn) 介

本程序是在傳輸流傳輸過(guò)程中對(duì)節(jié)目時(shí)鐘字段進(jìn)行檢測(cè)與修改,采用Verilog HDL 語(yǔ)言進(jìn)行編程。

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