利用數控分頻器設計硬件電子琴.硬件電子琴電路模塊設計
資源簡介：利用數控分頻器設計硬件電子琴.硬件電子琴電路模塊設計
上傳時間： 2013-11-28
上傳用戶：Shaikh
資源簡介：數控分頻器的輸出信號頻率為輸入數據的函數。用傳統的方法設計,其設計過程和電路都比較復雜,且設計成 果的可修改性和可移植性都較差。基于VHDL 的數控分頻器設計,整個過程簡單、快捷,極易修改,可移植性強。他可利用 并行預置數的加法計數器和減法計數器實現...
上傳時間： 2014-11-29
上傳用戶：1051290259
資源簡介：數控分頻器設計:對于一個加法計數器，裝載不同的計數初始值時，會有不同頻率的溢出輸出信號。計數器溢出時，輸出‘1’電平，同時溢出時的‘1’電平反饋給計數器的輸入端作為裝載信號；否則輸出‘0’電平。
上傳時間： 2015-07-16
上傳用戶：wxhwjf
資源簡介：基于vhdl的數控分頻器設計的源代碼及仿真
上傳時間： 2016-02-11
上傳用戶：410805624
資源簡介：數控分頻器的設計數控分頻器的功能就是當在輸入端給定不同輸入數據時，將對輸入的時鐘信號有不同的分頻比，數控分頻器就是用計數值可并行預置的加法計數器設計完成的，方法是將計數溢出位與預置數加載輸入信號相接即可。
上傳時間： 2016-10-13
上傳用戶：wangzhen1990
資源簡介：數控分頻器的設計 數控分頻器的功能就是當在輸入端給定不同輸入數據時，將對輸入的時鐘信號有不同的分頻比，例3的數控分頻器就是用計數值可并行預置的加法計數器設計完成的，方法是將計數溢出位與預置數加載輸入信號相接即可。
上傳時間： 2013-12-11
上傳用戶：黑漆漆
資源簡介：基于Quartus II的數控分頻器的項目設計，實現對時鐘信號的任意進制分頻，包含了項目文件和VHDL源代碼
上傳時間： 2017-07-18
上傳用戶：yangbo69
資源簡介：基于fpga和sopc的用VHDL語言編寫的EDA數控分頻器
上傳時間： 2014-01-03
上傳用戶：yan2267246
資源簡介：fredivn.vhd 偶數分頻 fredivn1.vhd 奇數分頻 frediv16.vhd 16分頻 PULSE.vhd 數控分頻器
上傳時間： 2016-11-21
上傳用戶：zl5712176
資源簡介：用FPGA仿真實現數控分頻器，完整的工程文件
上傳時間： 2014-06-18
上傳用戶：dyctj
資源簡介：fredivn.vhd 偶數分頻\r\nfredivn1.vhd 奇數分頻\r\nfrediv16.vhd 16分頻\r\nPULSE.vhd 數控分頻器
上傳時間： 2013-08-15
上傳用戶：lizhen9880
資源簡介：分頻器 FPGＡ程序設計 二分頻 對硬件設計有很大用處
上傳時間： 2014-01-25
上傳用戶：z754970244
資源簡介：本文介紹了兩種分頻系數為整數或半整數的可控分頻器的設計方法。其中之一可以實現50％的奇數分頻。利用VHDL語言編程，并用QUARTERS||4.0進行仿真，用 FPGA 芯片實現。 關鍵詞：半整數，可控分頻器，VHDL, FPGA
上傳時間： 2015-11-27
上傳用戶：tyler
資源簡介：[VHDL經典設計26例]--在xilinx芯片上調試通過--[01--1位全加器][02--2選1多路選擇器][03--8位硬件加法器][04--7段數碼顯示譯碼器][05--8位串入并出寄存器][6--8位并入串出寄存器][7--內部三態總線][8--含清零和同步時鐘使能的4位加法計數器][9--數控分頻器][1...
上傳時間： 2014-09-06
上傳用戶：han_zh
資源簡介：利用計數器和分頻器設計一個實時的時鐘。一共需要1個模24計數器、2個模6計數器、2個模10計數器、一個生成1Hz的分頻器和6個數碼管解碼器。最終用HEX5~HEX4顯示小時（0~23），用HEX3~HEX2顯示分鐘（0~59），用HEX1~HEX0顯示秒鐘（0~59）。
上傳時間： 2014-12-20
上傳用戶：dbs012280
資源簡介：分頻器 FPGＡ程序設計 二分頻 對硬件設計有很大用處\r\n
上傳時間： 2013-08-31
上傳用戶：lhc9102
資源簡介：簡易電子琴，可以彈奏音樂。本課程設計主要內容是基于VHDL語言并利用數控分頻器設計硬件電子琴，利用GW48作為課程開發硬件平臺，鍵1至鍵8設計為電子琴鍵。某一個LED顯示當前的按鍵的音節數。
上傳時間： 2017-09-23
上傳用戶：woshiayin
資源簡介：基于CPLD-FPGA的半整數分頻器的設計，用于設計EDA
上傳時間： 2013-09-03
上傳用戶：pioneer_lvbo
資源簡介：用VerilogHDL實現基于FPGA的通用分頻器的設計
上傳時間： 2013-10-28
上傳用戶：xiaoxiang
資源簡介：用VerilogHDL實現基于FPGA的通用分頻器的設計
上傳時間： 2015-01-02
上傳用戶：oooool
資源簡介：基于CPLD-FPGA的半整數分頻器的設計，用于設計EDA
上傳時間： 2015-04-09
上傳用戶：凌云御清風
資源簡介：帶分頻器的bcd計數電路設計，verilog源碼
上傳時間： 2014-01-14
上傳用戶：s363994250
資源簡介：第7章數字系統設計實例 7.1 半整數分頻器的設計 7.2 音樂發生器 7.3 2FSK/2PSK信號產生器 7.4 實用多功能電子表 7.5 交通燈控制器 7.6 數字頻率計
上傳時間： 2015-06-23
上傳用戶：tianyi223
資源簡介：利用VHDL語言編寫的一個16分頻器，另外可以在程序中修改為任意2N的分頻器
上傳時間： 2014-01-18
上傳用戶：erkuizhang
資源簡介：本文件介紹的是用VerilogHDL語言設計分頻器和32位計數器.
上傳時間： 2013-12-15
上傳用戶：縹緲
資源簡介：本文主要介紹了50％占空比三分頻器的三種設計方法，并給出了圖形設計、VHDL設計、編譯結果和仿真結果。設計中采用EPM7064AETC44-7 CPLD，在QUARTUSⅡ4.2軟件平臺上進行。
上傳時間： 2014-01-25
上傳用戶：凌云御清風
資源簡介：《分頻器設計》絕對好用的EDA實驗程序！已經通過測試。VHDL語言編寫
上傳時間： 2013-11-29
上傳用戶：star_in_rain
資源簡介：基于FPGA的分頻器設計,已經通過了仿真(VHDL語言編寫)
上傳時間： 2013-12-14
上傳用戶：haoxiyizhong
資源簡介：由VHDL 語言實現的數控分頻 利用的是QUARTUES環境已經得到驗證
上傳時間： 2014-01-12
上傳用戶：teddysha
資源簡介：基于VHDL的分頻器設計，這是源碼希望對大家有用。
上傳時間： 2014-01-25
上傳用戶：watch100
