用VHDL語言設計維特比 解碼器 是VHDL原代碼用ModelSim XE III 6.3c軟件實現(xiàn)仿真
資源簡介:用VHDL語言設計維特比 解碼器 是VHDL原代碼用ModelSim XE III 6.3c軟件實現(xiàn)仿真
上傳時間: 2013-12-09
上傳用戶:qiao8960
資源簡介:維特比解碼器低功耗設計verilog編碼完整的程序可直接用
上傳時間: 2013-12-18
上傳用戶:silenthink
資源簡介:卷積碼編碼和維特比解碼 當K為7 時 供大家參考Convolutional encoding and Viterbi decoding with k 7 rate 1 2
上傳時間: 2013-12-22
上傳用戶:zjf3110
資源簡介:是一個介紹軟維特比解碼的matlab軟件程序,針對8psk,
上傳時間: 2016-01-12
上傳用戶:aa17807091
資源簡介:維特比譯碼器的asic設計的相關(guān)論文
上傳時間: 2014-01-09
上傳用戶:wys0120
資源簡介:用VHDL語言設計四位全加器,有低位進位和高位進位。
上傳時間: 2013-12-26
上傳用戶:6546544
資源簡介:這是維特比譯碼器的編程,是我自己編的,可以給做設計的人一點參考
上傳時間: 2014-01-13
上傳用戶:onewq
資源簡介:一種維特比譯碼器狀態(tài)度量初始化的方法和裝置.無壓縮密碼。
上傳時間: 2013-12-17
上傳用戶:zukfu
資源簡介:基于MATLAB的2_1_7_維特比譯碼器的并行算法實現(xiàn)
上傳時間: 2016-06-09
上傳用戶:古谷仁美
資源簡介:這是DEL原代碼,用ACCESS數(shù)據(jù)庫連接的 可以通過各種方式查詢信息
上傳時間: 2013-12-27
上傳用戶:bruce5996
資源簡介:由于其很強的糾錯性能和適合硬件實現(xiàn)的編譯碼算法,卷積編碼和軟判決維特比譯碼目前已經(jīng)廣泛應用于衛(wèi)星通信系統(tǒng)。然而隨著航天事業(yè)的發(fā)展,衛(wèi)星有效載荷種類的增多和分辨率的不斷提高,信息量越來越大。如何在低信噪比的功率受限信道條件下提高傳輸速率成為目...
上傳時間: 2013-04-24
上傳用戶:mingaili888
資源簡介:在數(shù)字通信中,采用差錯控制技術(shù)(糾錯碼)是提高信號傳輸可靠性的有效手段,并發(fā)揮著越來越重要的作用。糾錯碼主要有分組碼和卷積碼兩種。在碼率和編碼器復雜程度相同的情況下,卷積碼的性能優(yōu)于分組碼。 卷積碼的譯碼方法主要有代數(shù)譯碼和概率譯碼。代數(shù)譯碼...
上傳時間: 2013-04-24
上傳用戶:tedo811
資源簡介:在數(shù)字通信中,采用差錯控制技術(shù)(糾錯碼)是提高信號傳輸可靠性的有效手段,并發(fā)揮著越來越重要的作用。糾錯碼主要有分組碼和卷積碼兩種。在碼率和編碼器復雜程度相同的情況下,卷積碼的性能優(yōu)于分組碼。 卷積碼的譯碼方法主要有代數(shù)譯碼和概率譯碼。代數(shù)譯碼...
上傳時間: 2013-04-24
上傳用戶:zhenyushaw
資源簡介:這是一個8分頻的VHDL語言設計程序,也可以看成是8進制計數(shù)器
上傳時間: 2013-12-22
上傳用戶:nanxia
資源簡介:用VHDL語言設計基于FPGA器件的高采樣率FIR濾波器,基于VHDL與CPLD器件的FIR數(shù)字濾波器的設計
上傳時間: 2013-08-07
上傳用戶:ukuk
資源簡介:用VHDL語言設計CPU中的一部分:加法器的設計,包括多種加法器的設計方法!內(nèi)容為英文
上傳時間: 2015-06-11
上傳用戶:xiaohuanhuan
資源簡介:用VHDL語言設計CPU中的一部分:乘法器的設計,包括多種乘法器的設計方法!內(nèi)容為英文
上傳時間: 2015-06-11
上傳用戶:450976175
資源簡介:卷積碼及其維特比譯碼算法的軟件實現(xiàn) c語言算法介紹
上傳時間: 2015-07-01
上傳用戶:gxrui1991
資源簡介:ic設計入門 用VHDL語言設計IC的一些主要方法和說明
上傳時間: 2015-08-17
上傳用戶:zhengzg
資源簡介:清楚地講述了怎樣用VHDL語言設計整數(shù)分頻、小數(shù)分頻、分數(shù)分頻等,是學習VHDL不可多得的好材料!
上傳時間: 2015-09-09
上傳用戶:Andy123456
資源簡介:維特比編解碼,注釋清楚詳細,并有清楚的運行結(jié)果word文檔
上傳時間: 2013-11-28
上傳用戶:凌云御清風
資源簡介:軟輸出維特比譯碼算法的C語言詳細實現(xiàn),程序效率高,比MATLAB快多了.
上傳時間: 2014-01-24
上傳用戶:wanghui2438
資源簡介:用VHDL語言設計的頻率計,經(jīng)過驗證,沒有問題
上傳時間: 2013-12-08
上傳用戶:15736969615
資源簡介:在用VHDL語言設計中應充分利用VHDL語言特點,從設計思想語句運用及描述方法上等多方面對電路進行優(yōu)化,舉實例.
上傳時間: 2016-02-15
上傳用戶:xymbian
資源簡介:用VHDL語言設計的二輸入與非門電路,結(jié)構(gòu)簡單,使用,希望能有所幫助,謝謝批評指導!
上傳時間: 2016-06-22
上傳用戶:miaochun888
資源簡介:這是用VHDL語言設計的四輸入與非門電路,很簡單,也很實用,希望對大家能有幫助,謝謝批評指導.
上傳時間: 2016-06-22
上傳用戶:xhz1993
資源簡介:用MATLAB語言設計的高通濾波器,是用切比雪夫設計的
上傳時間: 2016-07-09
上傳用戶:D&L37
資源簡介:這是一個用VHDL語言編寫的mp3編解碼實現(xiàn)。
上傳時間: 2016-12-15
上傳用戶:lepoke
資源簡介:要求用VHDL語言設計7人表決器和系列檢測器,檢測“1111111101111110”
上傳時間: 2013-12-26
上傳用戶:asddsd
資源簡介:這是一種用C實現(xiàn)的(2,1,7)卷積碼維特比譯碼算法的軟件實現(xiàn).
上傳時間: 2013-12-14
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