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用VHDL語言設計維特比 解碼器 是VHDL原代碼用ModelSim XE III 6.3c軟件實現(xiàn)仿真

  • 資源大小:2 K
  • 上傳時間: 2013-12-09
  • 上傳用戶:wugu0
  • 資源積分:2 下載積分
  • 標      簽: VHDL ModelSim III 6.3

資 源 簡 介

用VHDL語言設計維特比 解碼器 是VHDL原代碼用ModelSim XE III 6.3c軟件實現(xiàn)仿真

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