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基于vhdl的數字鬧鐘的設計。可實現計時、鬧鐘、調節時間功能。可以在FPGA上實現。

  • 資源大小:3 K
  • 上傳時間: 2014-08-07
  • 上傳用戶:albert333
  • 資源積分:2 下載積分
  • 標      簽: vhdl FPGA 數字鬧鐘 計時

資 源 簡 介

基于vhdl的數字鬧鐘的設計。可實現計時、鬧鐘、調節時間功能。可以在FPGA上實現。

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