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同步數(shù)字復(fù)接的設(shè)計及其FPGA實現(xiàn) 在簡要介紹同步數(shù)字復(fù)接基本原理的基礎(chǔ)上

  • 資源大小:2343 K
  • 上傳時間: 2013-12-20
  • 上傳用戶:Jane
  • 資源積分:2 下載積分
  • 標      簽: FPGA 數(shù)字復(fù)接

資 源 簡 介

同步數(shù)字復(fù)接的設(shè)計及其FPGA實現(xiàn) 在簡要介紹同步數(shù)字復(fù)接基本原理的基礎(chǔ)上,采用VHDL語言對同步數(shù)字復(fù)接各組成模塊進行了設(shè)計,并在ISE集成環(huán)境下進行了設(shè)計描述、綜合、布局布線及時序仿真,取得了正確的設(shè)計結(jié)果,同時利用中小容量的FPGA實現(xiàn)了同步數(shù)字復(fù)接功能。 基群速率數(shù)字信號的合成設(shè)備和分接設(shè)備是電信網(wǎng)絡(luò)中使用較多的關(guān)鍵設(shè)備,在數(shù)字程控交換機的用戶模塊、小靈通基站控制器和集團電話中都需要使用這種同步數(shù)字復(fù)接設(shè)備。近年來,隨著需要自建內(nèi)部通信系統(tǒng)的公司和企業(yè)不斷增多,同步數(shù)字復(fù)接設(shè)備的使用需求也在增加。FPGA(現(xiàn)場可編程門陣列)器件的高性能簡化了數(shù)字通信系統(tǒng)的設(shè)計與實現(xiàn)。本文基于FPGA的技術(shù)特點,結(jié)合數(shù)字復(fù)接技術(shù)的基本原理,實現(xiàn)了基群速率(2048kbps)數(shù)字信號的數(shù)字分接與復(fù)接。

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