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  資源簡(jiǎn)介：MB1501頻率合成器的分頻比設(shè)置源程序

  標(biāo)簽： 1501 MB 頻率合成器 分頻

  上傳時(shí)間： 2013-12-06

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• 此為EDA設(shè)計(jì)的分頻器模塊。可以實(shí)現(xiàn)三種不同的頻率信號(hào)免費(fèi)下載

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  標(biāo)簽： EDA 分頻器 模塊 頻率信號(hào)

  上傳時(shí)間： 2013-12-22

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  標(biāo)簽： 分頻器 代碼 分頻 頻率

  上傳時(shí)間： 2014-06-18

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• 了解減法分頻電路的設(shè)計(jì)。 （2）內(nèi)容：分析例2.8程序的原理免費(fèi)下載

  資源簡(jiǎn)介：了解減法分頻電路的設(shè)計(jì)。 （2）內(nèi)容：分析例2.8程序的原理，給出其仿真結(jié)果，說(shuō)明語(yǔ)句的功能。可以改變程序中的分頻比。引腳鎖定可參考圖2.9。 （3）說(shuō)明：將CLK2的跳線冒連在2Hz上 。LED1指示輸入頻率，LED2分頻后的結(jié)果。可以看到LED1每閃爍6下，LED2閃...

  標(biāo)簽： 2.8 減法 分頻電路 分

  上傳時(shí)間： 2013-12-20

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• MB1504鎖相環(huán)芯片的51單片機(jī)驅(qū)動(dòng)程序,可以根據(jù)需要修改合適的分頻值來(lái)完成頻率合成配置.免費(fèi)下載

  資源簡(jiǎn)介：MB1504鎖相環(huán)芯片的51單片機(jī)驅(qū)動(dòng)程序,可以根據(jù)需要修改合適的分頻值來(lái)完成頻率合成配置.

  標(biāo)簽： 1504 MB 51單片機(jī) 鎖相環(huán)芯片

  上傳時(shí)間： 2013-12-14

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• 片機(jī)電子鐘的計(jì)時(shí)脈沖基準(zhǔn)是由外部晶振的頻率經(jīng)過(guò)12分頻后提供免費(fèi)下載

  資源簡(jiǎn)介：片機(jī)電子鐘的計(jì)時(shí)脈沖基準(zhǔn)是由外部晶振的頻率經(jīng)過(guò)12分頻后提供，采用內(nèi)部的定時(shí)/計(jì)數(shù)器來(lái)實(shí)現(xiàn)計(jì)時(shí)功能。所以，外接晶振頻率精確度直接影響電子鐘計(jì)時(shí)的準(zhǔn)確性。

  標(biāo)簽： 片機(jī) 基準(zhǔn) 分頻 晶振

  上傳時(shí)間： 2014-01-20

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• verilog寫的分頻程序,可以對(duì)輸入的頻率分頻免費(fèi)下載

  資源簡(jiǎn)介：verilog寫的分頻程序,可以對(duì)輸入的頻率分頻

  標(biāo)簽： verilog 分頻 程序 輸入

  上傳時(shí)間： 2016-11-01

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• pll 的64倍頻 鎖相環(huán)技術(shù)用 實(shí)現(xiàn)倍頻 從而達(dá)到對(duì)頻率的分頻免費(fèi)下載

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  標(biāo)簽： pll 倍頻 鎖相環(huán)技術(shù) 分頻

  上傳時(shí)間： 2017-01-03

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• 用vhdl實(shí)現(xiàn)的分頻器免費(fèi)下載

  資源簡(jiǎn)介：用vhdl實(shí)現(xiàn)的分頻器，可產(chǎn)生任意對(duì)主時(shí)鐘的分頻，從而是實(shí)現(xiàn)不同頻率pwm的控制

  標(biāo)簽： vhdl 分頻器

  上傳時(shí)間： 2016-06-01

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• 數(shù)控分頻器的設(shè)計(jì)數(shù)控分頻器的功能就是當(dāng)在輸入端給定不同輸入數(shù)據(jù)時(shí)免費(fèi)下載

  資源簡(jiǎn)介：數(shù)控分頻器的設(shè)計(jì)數(shù)控分頻器的功能就是當(dāng)在輸入端給定不同輸入數(shù)據(jù)時(shí)，將對(duì)輸入的時(shí)鐘信號(hào)有不同的分頻比，數(shù)控分頻器就是用計(jì)數(shù)值可并行預(yù)置的加法計(jì)數(shù)器設(shè)計(jì)完成的，方法是將計(jì)數(shù)溢出位與預(yù)置數(shù)加載輸入信號(hào)相接即可。

  標(biāo)簽： 數(shù)控 分頻器 數(shù)據(jù) 輸入端

  上傳時(shí)間： 2016-10-13

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• 此程序是用硬件描述語(yǔ)言VHDL編寫的分頻程序免費(fèi)下載

  資源簡(jiǎn)介：此程序是用硬件描述語(yǔ)言VHDL編寫的分頻程序，實(shí)現(xiàn)了不同的頻率輸入。

  標(biāo)簽： VHDL 程序 硬件描述語(yǔ)言 分頻

  上傳時(shí)間： 2016-11-15

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• 數(shù)控分頻器的設(shè)計(jì) 數(shù)控分頻器的功能就是當(dāng)在輸入端給定不同輸入數(shù)據(jù)時(shí)免費(fèi)下載

  資源簡(jiǎn)介：數(shù)控分頻器的設(shè)計(jì) 數(shù)控分頻器的功能就是當(dāng)在輸入端給定不同輸入數(shù)據(jù)時(shí)，將對(duì)輸入的時(shí)鐘信號(hào)有不同的分頻比，例3的數(shù)控分頻器就是用計(jì)數(shù)值可并行預(yù)置的加法計(jì)數(shù)器設(shè)計(jì)完成的，方法是將計(jì)數(shù)溢出位與預(yù)置數(shù)加載輸入信號(hào)相接即可。

  標(biāo)簽： 數(shù)控 分頻器 數(shù)據(jù) 輸入端

  上傳時(shí)間： 2013-12-11

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• 這是我在ISP編程實(shí)驗(yàn)中獨(dú)立編寫的一個(gè)采用行為描述方式實(shí)現(xiàn)的分頻器免費(fèi)下載

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  標(biāo)簽： ISP 編程實(shí)驗(yàn) 獨(dú)立 方式

  上傳時(shí)間： 2017-01-19

  上傳用戶：xiaohuanhuan

• 工程中使用的一段資源管理vhdl程序,有簡(jiǎn)單的分頻代碼免費(fèi)下載

  資源簡(jiǎn)介：工程中使用的一段資源管理vhdl程序,有簡(jiǎn)單的分頻代碼等，希望能給你幫助

  標(biāo)簽： vhdl 工程 分頻 代碼

  上傳時(shí)間： 2013-08-10

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• 基于FPGA的分頻器免費(fèi)下載

  資源簡(jiǎn)介：基于FPGA的分頻器,可以根據(jù)更改參數(shù),實(shí)現(xiàn)不同倍數(shù)的分頻.

  標(biāo)簽： FPGA 分頻器

  上傳時(shí)間： 2013-08-15

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• 基于FPGA的直接數(shù)字頻率合成器的設(shè)計(jì)與實(shí)現(xiàn)免費(fèi)下載

  資源簡(jiǎn)介：基于FPGA的直接數(shù)字頻率合成器的設(shè)計(jì)與實(shí)現(xiàn).

  標(biāo)簽： FPGA 數(shù)字頻率合成器

  上傳時(shí)間： 2013-08-21

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• 一個(gè)好用的整數(shù)分頻電路 能夠?qū)崿F(xiàn)對(duì)任意整數(shù)的分頻電路設(shè)計(jì)免費(fèi)下載

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  標(biāo)簽： 整數(shù) 分頻電路 分頻 電路設(shè)計(jì)

  上傳時(shí)間： 2013-09-01

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• 在EDA中基于數(shù)字頻率合成器的FPGA實(shí)現(xiàn)免費(fèi)下載

  資源簡(jiǎn)介：在EDA中，基于數(shù)字頻率合成器的FPGA實(shí)現(xiàn)

  標(biāo)簽： FPGA EDA 數(shù)字頻率合成器

  上傳時(shí)間： 2013-09-04

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• 一種X波段頻率合成器的設(shè)計(jì)方案免費(fèi)下載

  資源簡(jiǎn)介：　　在非相參雷達(dá)測(cè)試系統(tǒng)中，頻率合成技術(shù)是其中的關(guān)鍵技術(shù).針對(duì)雷達(dá)測(cè)試系統(tǒng)的要求，介紹了一種用DDS激勵(lì)PLL的X波段頻率合成器的設(shè)計(jì)方案。文中給出了主要的硬件選擇及具體電路設(shè)計(jì)，通過(guò)對(duì)該頻率合成器的相位噪聲和捕獲時(shí)間的分析，及對(duì)樣機(jī)性能的測(cè)試，結(jié)...

  標(biāo)簽： X波段 頻率合成器 設(shè)計(jì)方案

  上傳時(shí)間： 2013-10-21

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• 利用Verilog_HDL實(shí)現(xiàn)基于FPGA的分頻方法免費(fèi)下載

  資源簡(jiǎn)介：利用Verilog_HDL實(shí)現(xiàn)基于FPGA的分頻方法

  標(biāo)簽： Verilog_HDL FPGA 分頻

  上傳時(shí)間： 2013-10-18

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• 利用Verilog_HDL實(shí)現(xiàn)基于FPGA的分頻方法免費(fèi)下載

  資源簡(jiǎn)介：利用Verilog_HDL實(shí)現(xiàn)基于FPGA的分頻方法

  標(biāo)簽： Verilog_HDL FPGA 分頻

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• 一個(gè)3分頻器。可進(jìn)一步改裝成實(shí)際需要的分頻器使用免費(fèi)下載

  資源簡(jiǎn)介：一個(gè)3分頻器。可進(jìn)一步改裝成實(shí)際需要的分頻器使用

  標(biāo)簽： 分頻器

  上傳時(shí)間： 2014-11-28

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• MC145163P型鎖相頻率合成器的原理與應(yīng)用免費(fèi)下載

  資源簡(jiǎn)介：MC145163P型鎖相頻率合成器的原理與應(yīng)用

  標(biāo)簽： 145163P 145163 MC 鎖相頻率

  上傳時(shí)間： 2014-03-10

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• 這是用VHDL語(yǔ)言編寫的一個(gè)DDS頻率合成器的源程序免費(fèi)下載

  資源簡(jiǎn)介：這是用VHDL語(yǔ)言編寫的一個(gè)DDS頻率合成器的源程序

  標(biāo)簽： VHDL DDS 語(yǔ)言 編寫

  上傳時(shí)間： 2013-12-27

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• 用VHDL語(yǔ)言實(shí)現(xiàn)DDS直接數(shù)字頻率合成器的設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：用VHDL語(yǔ)言實(shí)現(xiàn)DDS直接數(shù)字頻率合成器的設(shè)計(jì)，采用正弦RAM表，可實(shí)現(xiàn)頻率可控的正弦數(shù)字信號(hào)，編譯、仿真通過(guò)。

  標(biāo)簽： VHDL DDS 語(yǔ)言 數(shù)字頻率合成器

  上傳時(shí)間： 2014-01-04

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• 基于FPGA的分頻器設(shè)計(jì),已經(jīng)通過(guò)了仿真(VHDL語(yǔ)言編寫)免費(fèi)下載

  資源簡(jiǎn)介：基于FPGA的分頻器設(shè)計(jì),已經(jīng)通過(guò)了仿真(VHDL語(yǔ)言編寫)

  標(biāo)簽： FPGA VHDL 分頻器 仿真

  上傳時(shí)間： 2013-12-14

  上傳用戶：haoxiyizhong

• 一個(gè)好用的整數(shù)分頻電路 保證你喜歡 能夠?qū)崿F(xiàn)對(duì)任意整數(shù)的分頻電路設(shè)計(jì)免費(fèi)下載

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  標(biāo)簽： 整數(shù) 分頻電路 分頻 電路設(shè)計(jì)

  上傳時(shí)間： 2013-12-24

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• 基于MC145159的PLL頻率合成器設(shè)計(jì)與實(shí)現(xiàn) 介紹了鎖相環(huán)路頻率合成器的基本原理,分析了集成鎖相環(huán)芯片M C 145159的工作特性,給出了集成鎖相環(huán)芯片M C 145159的一個(gè)應(yīng)用實(shí)例,為高免費(fèi)下載

  資源簡(jiǎn)介：基于MC145159的PLL頻率合成器設(shè)計(jì)與實(shí)現(xiàn) 介紹了鎖相環(huán)路頻率合成器的基本原理,分析了集成鎖相環(huán)芯片M C 145159的工作特性,給出了集成鎖相環(huán)芯片M C 145159的一個(gè)應(yīng)用實(shí)例,為高頻頻率合成器的設(shè)計(jì)提供了一個(gè)較好的思路.測(cè)試結(jié)果證明了設(shè)計(jì)的合理性與實(shí)用性,系...

  標(biāo)簽： 145159 PLL 頻率合成器 芯片

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• AV系統(tǒng)數(shù)字調(diào)諧PLL頻率合成器的單片機(jī)控制 文章利用LC7218PLL頻率合成器在AV領(lǐng)域的電調(diào)諧功能,提出了一個(gè)TV/FM/AM全景接收機(jī)設(shè)計(jì)方案,重點(diǎn)設(shè)計(jì)分析了LC7218與單片機(jī)之間的I/O免費(fèi)下載

  資源簡(jiǎn)介：AV系統(tǒng)數(shù)字調(diào)諧PLL頻率合成器的單片機(jī)控制 文章利用LC7218PLL頻率合成器在AV領(lǐng)域的電調(diào)諧功能,提出了一個(gè)TV/FM/AM全景接收機(jī)設(shè)計(jì)方案,重點(diǎn)設(shè)計(jì)分析了LC7218與單片機(jī)之間的I/O數(shù)據(jù)結(jié)構(gòu),顯示了它優(yōu)良的性能。

  標(biāo)簽： 7218 PLL LC 頻率合成器

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• 這是一個(gè)用VHDL語(yǔ)言寫的分頻程序,可用得著免費(fèi)下載

  資源簡(jiǎn)介：這是一個(gè)用VHDL語(yǔ)言寫的分頻程序,可用得著

  標(biāo)簽： VHDL 語(yǔ)言 分頻 程序

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