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利用Verilog設計的16位CPU的設計案例

  • 資源大小:860 K
  • 上傳時間: 2022-05-16
  • 上傳用戶:得之我幸78
  • 資源積分:2 下載積分
  • 標      簽: verilog cpu

資 源 簡 介

利用Verilog設計的16位CPU的設計案例,適合感興趣的學習者學習,可以提高自己的能力,大家可以多交流哈



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