叫你如何擁有良好的編碼風格
資源簡介:verilog HDL Coding DDR sdram control for fpga
上傳時間: 2013-12-17
上傳用戶:wangchong
資源簡介:叫你如何擁有良好的編碼風格
上傳時間: 2013-11-06
上傳用戶:yt1993410
資源簡介:叫你如何擁有良好的編碼風格
上傳時間: 2014-01-04
上傳用戶:s藍莓汁
資源簡介:這篇文章討論了不同HDL代碼的編寫方式,對綜合結果的影響。閱讀本文對深入了解綜合工具和提高HDL的編寫水平有不少幫助,原文時針對Synopsys的綜合軟件論述的,但對所有綜合軟件,都有普遍的借鑒意義 ?
上傳時間: 2014-12-23
上傳用戶:huql11633
資源簡介:這篇文章討論了不同HDL代碼的編寫方式,對綜合結果的影響。閱讀本文對深入了解綜合工具和提高HDL的編寫水平有不少幫助,原文時針對Synopsys的綜合軟件論述的,但對所有綜合軟件,都有普遍的借鑒意義 ?
上傳時間: 2014-01-11
上傳用戶:亞亞娟娟123
資源簡介:Verilog and VHDL狀態機設計,英文pdf格式 State machine design techniques for Verilog and VHDL Abstract : Designing a synchronous finite state Another way of organizing a state machine (FSM) is a common task for a digital logic only one l...
上傳時間: 2013-12-19
上傳用戶:change0329
資源簡介:The emphasis of this book is on real-time application of Synopsys tools, used to combat various problems seen at VDSM geometries. Readers will be exposed to an effective design methodology for handling complex, submicron ASIC designs. Si...
上傳時間: 2017-07-05
上傳用戶:waitingfy
資源簡介:Actel A3P250 fpga用VERILOG HDL語言實現串口功能的源代碼
上傳時間: 2013-12-23
上傳用戶:aa17807091
資源簡介:概述:數字通信和自動化控制等領域的高速度發展和世界范圍的高技術競爭對數字系統提出了越來越高的要求,特別是需要設計具有實時信號處理能力的專用集成電路,要求把包括多個CPU內核在內的整個電子系統綜合到一個芯片(SOC)上。?集成電路制造工藝的發展;?知...
上傳時間: 2013-10-28
上傳用戶:pol123
資源簡介:Debussy是NOVAS Software, Inc(思源科技)發展的HDL Debug & Analysis tool,這套軟體主要不是用來跑模擬或看波形,它最強大的功能是:能夠在HDL source code、schematic diagram、waveform、state bubble diagram之間,即時做trace,協助工程師debug。 可能...
上傳時間: 2014-01-14
上傳用戶:hustfanenze
資源簡介:Verilog HDL 串口發送程序,在Actel Fusion FPGA上實驗成功 ,和大家一起分享!^_^
上傳時間: 2016-07-17
上傳用戶:qwe1234
資源簡介:此實驗例程適用于Actel Flash架構的ProASIC3/E系列FPGA,適合于FPGA及Verilog HDL的初學者,配套EasyFPGA030開發套件。
上傳時間: 2017-06-01
上傳用戶:hgy9473
資源簡介:Verilog-HDL實踐與應用系統設計
上傳時間: 2013-08-06
上傳用戶:eeworm
資源簡介:精通Verilog HDL:IC設計核心技術實例詳解
上傳時間: 2013-07-24
上傳用戶:eeworm
資源簡介:專輯類----可編程邏輯器件相關專輯 Verilog-HDL實踐與應用系統設計-210頁-18.0M.rar
上傳時間: 2013-07-23
上傳用戶:小宇NVO
資源簡介:專輯類-可編程邏輯器件相關專輯-96冊-1.77G Verilog-HDL實踐與應用系統設計-210頁-18.0M.pdf
上傳時間: 2013-04-24
上傳用戶:vodssv
資源簡介:Actel SmartFusion智能混合信號FPGA在單個器件中整合了已經獲驗證且高度靈活的ProASIC?3 FPGA架構、先進的混合信號功能以及一個ARM? Cortex?-M3硬核處理器。SmartFusion能夠為嵌入式系統設計人員提供了多達50萬門用戶邏輯、13.8 Kb的通用FPGA RAM、眾多系...
上傳時間: 2013-04-24
上傳用戶:00.00
資源簡介:采用 Verilog HDL 語言在Altera 公司的FPGA 芯片上實現了RISC_CPU 的關鍵部件狀態控制器的設計,以及在與其它各種數字邏輯設計方法的比較下,顯示出使用Verilog
上傳時間: 2013-07-06
上傳用戶:也一樣請求
資源簡介:Verilog HDL程序設計教程,一本實用的教程,值得一看。
上傳時間: 2013-05-26
上傳用戶:cy_ewhat
資源簡介:夏宇聞教授的數字系統設計教程Verilog HDL
上傳時間: 2013-07-20
上傳用戶:FFAN
資源簡介:本文利用Verilog HDL 語言自頂向下的設計方法設計多功能數字鐘,突出了其作為硬件描述語言的良好的可讀性、可移植性和易理解等優點,并通過Altera QuartusⅡ 4.1 和ModelSim
上傳時間: 2013-07-21
上傳用戶:ve3344
資源簡介:Mentor Graphics HDL Designer 工具套件,為客戶帶來生產力更高的設計輸入、分析與管理功能,包括更強大的聯機資料表格,無論設計復雜性如何,都能迅速建立高品質且結構良好的硬件描述語言。HDL Designer Series可協助工程師迅速輸入和分析復雜的ASIC、FPGA和...
上傳時間: 2013-08-05
上傳用戶:hustfanenze
資源簡介:ALDEC公司的Active-HDL是一個開放型的仿真工具。 可支持幾乎所有的FPGA/CPLD廠商的產品,設計輸入可以原理圖或硬件描述語言或有限狀態機 方式
上傳時間: 2013-07-14
上傳用戶:來茴
資源簡介:ALDEC公司的Active-HDL是一個開放型的仿真工具。 可支持幾乎所有的FPGA/CPLD廠商的產品,設計輸入可以原理圖或硬件描述語言或有限狀態機 方式
上傳時間: 2013-05-29
上傳用戶:1583060504
資源簡介::視頻圖像采集verilog HDL源程序,視頻解碼芯片部分的,可以供參考
上傳時間: 2013-04-24
上傳用戶:koulian
資源簡介:·詳細說明:正式出版物《Verilog HDL 硬件描述語言》一書的精美 PDF 電子版。- Official publication Verilog HDL Hardware Description Language a book fine PDF electron version.目????? 錄譯者序前言第1章?? 簡介&n
上傳時間: 2013-07-02
上傳用戶:6404552
資源簡介:·本書從用戶的角度全面闡述了Verilog HDL語言的重要細節和基本設計方法,并詳細介紹了Verilog 2001版的主要改進部分。本書重點關注如何應用Verilog語言進行數字電路和系統的設計和驗證,而不僅僅講解語法。全書從基本概念講起,并逐漸過渡到編程語言接口以及...
上傳時間: 2013-04-24
上傳用戶:gyq
資源簡介:·Verilog?HDL:?A?Guide?to?Digital?Design?and??
上傳時間: 2013-04-24
上傳用戶:誰偷了我的麥兜
資源簡介:·Verilog HDL Synthesis, A Practical Primer
上傳時間: 2013-04-24
上傳用戶:muhongqing
資源簡介:人民郵電出版社一書的配套光盤,包含書上所有原代碼,特別是狀態機部分,值得學習
上傳時間: 2013-05-30
上傳用戶:鳳臨西北