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• 用FPGA實(shí)現(xiàn)RS485通信接口芯片免費(fèi)下載

  資源簡介：該文檔為用FPGA實(shí)現(xiàn)RS485通信接口芯片講解文檔，是一份很不錯(cuò)的參考資料，具有較高參考價(jià)值，感興趣的可以下載看看………………??

  標(biāo)簽： FPGA RS485 通信接口

  上傳時(shí)間： 2022-03-24

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• 用FPGA實(shí)現(xiàn)RS485通信接口芯片免費(fèi)下載

  資源簡介：在點(diǎn)對多點(diǎn)主從通信系統(tǒng)中,需要合適的接口形式和通信協(xié)議實(shí)現(xiàn)主站與各從站的信息交換。RS -485 接口是適合這種需求的一種標(biāo)準(zhǔn)接口形式。當(dāng)選擇主從多點(diǎn)同步通信方式時(shí),工作過程與幀格式符合HDLC/SDLC協(xié)議。介紹了采用VHDL 語言在FPGA 上實(shí)現(xiàn)的以HDLC/ SDLC 協(xié)...

  標(biāo)簽： FPGA 485 RS 通信接口

  上傳時(shí)間： 2013-11-02

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• 用FPGA實(shí)現(xiàn)RS485通信接口芯片免費(fèi)下載

  資源簡介：在點(diǎn)對多點(diǎn)主從通信系統(tǒng)中,需要合適的接口形式和通信協(xié)議實(shí)現(xiàn)主站與各從站的信息交換。RS -485 接口是適合這種需求的一種標(biāo)準(zhǔn)接口形式。當(dāng)選擇主從多點(diǎn)同步通信方式時(shí),工作過程與幀格式符合HDLC/SDLC協(xié)議。介紹了采用VHDL 語言在FPGA 上實(shí)現(xiàn)的以HDLC/ SDLC 協(xié)...

  標(biāo)簽： FPGA 485 RS 通信接口

  上傳時(shí)間： 2014-01-02

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• 用FPGA實(shí)現(xiàn)RS232通信,此代碼是用VHDL語言編寫免費(fèi)下載

  資源簡介：用FPGA實(shí)現(xiàn)RS232通信,此代碼是用VHDL語言編寫，非常有用的好東東啊

  標(biāo)簽： FPGA VHDL 232 RS

  上傳時(shí)間： 2013-08-21

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• 用FPGA實(shí)現(xiàn)RS232通信,此代碼是用VHDL語言編寫免費(fèi)下載

  資源簡介：用FPGA實(shí)現(xiàn)RS232通信,此代碼是用VHDL語言編寫，非常有用的好東東啊

  標(biāo)簽： FPGA VHDL 232 RS

  上傳時(shí)間： 2016-07-04

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• 用FPGA實(shí)現(xiàn)的VGA接口程序免費(fèi)下載

  資源簡介：用FPGA實(shí)現(xiàn)的VGA接口程序，采用的語言是VHDL硬件描述語言，大家可以參照下看看采用的器件是Altera EP2c35

  標(biāo)簽： FPGA VGA 接口程序

  上傳時(shí)間： 2016-10-10

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• 用FPGA實(shí)現(xiàn)任意波形發(fā)生器的源代碼免費(fèi)下載

  資源簡介：用FPGA實(shí)現(xiàn)任意波形發(fā)生器的源代碼，另外還包括FPGA實(shí)現(xiàn)UART，從而與MCU實(shí)現(xiàn)串行通信。

  標(biāo)簽： FPGA 任意波形發(fā)生器 源代碼

  上傳時(shí)間： 2013-08-27

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• 1、 用FPGA實(shí)現(xiàn)PS/2鼠標(biāo)接口。 2、 鼠標(biāo)左鍵按下時(shí)十字形鼠標(biāo)圖象的中間方塊改變顏色免費(fèi)下載

  資源簡介：1、 用FPGA實(shí)現(xiàn)PS/2鼠標(biāo)接口。 2、 鼠標(biāo)左鍵按下時(shí)十字形鼠標(biāo)圖象的中間方塊改變顏色，右按下時(shí)箭頭改變顏色。 3、 Reset按鍵：總復(fù)位。

  標(biāo)簽： FPGA 鼠標(biāo) PS 接口

  上傳時(shí)間： 2015-09-06

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• 用FPGA實(shí)現(xiàn)了RS232異步串行通信免費(fèi)下載

  資源簡介：用FPGA實(shí)現(xiàn)了RS232異步串行通信，所用語言是VHDL，另外本人還有Verilog的歡迎交流學(xué)習(xí)，根據(jù)RS232 異步串行通信來的幀格式，在FPGA發(fā)送模塊中采用的每一幀格式為：1位開始位+8位數(shù)據(jù)位+1位奇校驗(yàn)位+1位停止位，波特率為2400。由設(shè)置的波特率可以算出分頻系數(shù)...

  標(biāo)簽： FPGA 232 RS 異步串行通信

  上傳時(shí)間： 2013-11-29

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• 采用MAX485 芯片 使用ARM 系統(tǒng)硬件的UART 編程實(shí)現(xiàn)RS485 通信的基本收發(fā)功能免費(fèi)下載

  資源簡介：采用MAX485 芯片 使用ARM 系統(tǒng)硬件的UART 編程實(shí)現(xiàn)RS485 通信的基本收發(fā)功能

  標(biāo)簽： 485 UART MAX ARM

  上傳時(shí)間： 2016-10-13

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• 基于FPGA的RapidIO核接口芯片的設(shè)計(jì)和實(shí)現(xiàn)免費(fèi)下載

  資源簡介：基于FPGA的RapidIO核接口芯片的設(shè)計(jì)和實(shí)現(xiàn)這是一份非常不錯(cuò)的資料，歡迎下載，希望對您有幫助！

  標(biāo)簽： FPGA rapidio 接口

  上傳時(shí)間： 2021-12-28

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• 用FPGA實(shí)現(xiàn)FFT的算法分析免費(fèi)下載

  資源簡介：用FPGA實(shí)現(xiàn)FFT的算法分析,硬件介紹!

  標(biāo)簽： FPGA FFT 算法分析

  上傳時(shí)間： 2013-08-05

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• 用FPGA實(shí)現(xiàn)三電平PWM發(fā)生器的完整資料免費(fèi)下載

  資源簡介：用FPGA實(shí)現(xiàn)三電平PWM發(fā)生器的完整資料

  標(biāo)簽： FPGA PWM 三電平 發(fā)生器

  上傳時(shí)間： 2013-08-06

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• 這是用FPGA實(shí)現(xiàn)的設(shè)計(jì)兩人擲骰子比較點(diǎn)大小的游戲免費(fèi)下載

  資源簡介：這是用FPGA實(shí)現(xiàn)的設(shè)計(jì)兩人擲骰子比較點(diǎn)大小的游戲，里面有詳細(xì)的程序源碼及分析，希望有些幫助

  標(biāo)簽： FPGA 比較

  上傳時(shí)間： 2013-08-06

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• 用FPGA 實(shí)現(xiàn)基- 4FFT 算法免費(fèi)下載

  資源簡介：針對高速數(shù)字信號處理的要求,提出用FPGA 實(shí)現(xiàn)基- 4FFT 算法,并對其整體結(jié)構(gòu)、蝶形單\\\\\\\\r\\\\\\\\n元進(jìn)行了分析. 采用蝶算單元輸入并行結(jié)構(gòu)和同址運(yùn)算,能同時(shí)提供蝶形運(yùn)算所需的4 個(gè)操作\\\\\\\\r\\\\\\\\n數(shù),具有最大的數(shù)據(jù)并行性,能提高處理速度 按照旋...

  標(biāo)簽： FPGA 4FFT 算法

  上傳時(shí)間： 2013-08-08

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• 用FPGA實(shí)現(xiàn)dsp 的fft算法 其中有幾個(gè)文檔文件和用vhdl寫的1024點(diǎn)的fft代碼免費(fèi)下載

  資源簡介：用FPGA實(shí)現(xiàn)dsp 的fft算法 其中有幾個(gè)文檔文件和用vhdl寫的1024點(diǎn)的fft代碼

  標(biāo)簽： fft FPGA 1024 vhdl

  上傳時(shí)間： 2013-08-22

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• 用FPGA實(shí)現(xiàn)的DA轉(zhuǎn)換器免費(fèi)下載

  資源簡介：用FPGA實(shí)現(xiàn)的DA轉(zhuǎn)換器，有說明和源碼，VDHL文件。\\r\\nA PLD Based Delta-Sigma DAC\\r\\nDelta-Sigma modulation is the simple, yet powerful,\\r\\ntechnique responsible for the extraordinary\\r\\nperformance and low cost of today s audio CD\\r\\...

  標(biāo)簽： FPGA DA轉(zhuǎn)換器

  上傳時(shí)間： 2013-08-22

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• 用FPGA實(shí)現(xiàn)大型設(shè)計(jì)時(shí)免費(fèi)下載

  資源簡介：用FPGA實(shí)現(xiàn)大型設(shè)計(jì)時(shí)，可能需要FPGA具有以多個(gè)時(shí)鐘運(yùn)行的多重?cái)?shù)據(jù)通路，這種多時(shí)鐘FPGA設(shè)計(jì)必須特別小心，需要注意最大時(shí)鐘速率、抖動、最大時(shí)鐘數(shù)、異步時(shí)鐘設(shè)計(jì)和時(shí)鐘/數(shù)據(jù)關(guān)系。設(shè)計(jì)過程中最重要的一步是確定要用多少個(gè)不同的時(shí)鐘，以及如何進(jìn)行布線

  標(biāo)簽： FPGA 大型 計(jì)時(shí)

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• 利用高速FPGA實(shí)現(xiàn)PCI總線接口的設(shè)計(jì)方案免費(fèi)下載

  資源簡介：PCI是一種高性能的局部總線規(guī)范，可實(shí)現(xiàn)各種功能標(biāo)準(zhǔn)的PCI總線卡。本文簡要介紹了PCI總線的特點(diǎn)、信號與命令，提出了一種利用高速FPGA實(shí)現(xiàn)PCI總線接口的設(shè)計(jì)方案。\r\n

  標(biāo)簽： FPGA PCI 總線接口 設(shè)計(jì)方案

  上傳時(shí)間： 2013-08-30

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• 用FPGA實(shí)現(xiàn)fft免費(fèi)下載

  資源簡介：用FPGA實(shí)現(xiàn)fft

  標(biāo)簽： FPGA fft

  上傳時(shí)間： 2013-09-06

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• 用FPGA 實(shí)現(xiàn)全雙工異步串口（UART）免費(fèi)下載

  資源簡介：用FPGA 實(shí)現(xiàn)全雙工異步串口（UART），與PC 機(jī)通信。1 位起始位；8 位數(shù)據(jù)位；一個(gè)停止位；無校驗(yàn)位；波特率為2400、4800、9600、11520 任選或可變（可用按鍵控制波特率模式）。

  標(biāo)簽： FPGA UART 全雙工 異步串口

  上傳時(shí)間： 2013-12-23

  上傳用戶：無聊來刷下

• 用FPGA實(shí)現(xiàn)DDS的原理圖免費(fèi)下載

  資源簡介：用FPGA實(shí)現(xiàn)DDS的原理圖，結(jié)構(gòu)清晰，采用總線方式與外部單片機(jī)通信

  標(biāo)簽： FPGA DDS 原理圖

  上傳時(shí)間： 2015-12-16

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• 用FPGA實(shí)現(xiàn)任意波形發(fā)生器的源代碼免費(fèi)下載

  資源簡介：用FPGA實(shí)現(xiàn)任意波形發(fā)生器的源代碼，另外還包括FPGA實(shí)現(xiàn)UART，從而與MCU實(shí)現(xiàn)串行通信。

  標(biāo)簽： FPGA 任意波形發(fā)生器 源代碼

  上傳時(shí)間： 2016-01-06

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• FPGA實(shí)現(xiàn)的LCD接口免費(fèi)下載

  資源簡介：FPGA實(shí)現(xiàn)的LCD接口，VHDL編程,FPGA芯片為ALtera公司的EP2c35

  標(biāo)簽： FPGA LCD 接口

  上傳時(shí)間： 2016-10-10

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• 用Verilog實(shí)現(xiàn)的以太網(wǎng)接口免費(fèi)下載

  資源簡介：用Verilog實(shí)現(xiàn)的以太網(wǎng)接口!!!!!!!!!!!!!!!!!!

  標(biāo)簽： Verilog 以太網(wǎng)接口

  上傳時(shí)間： 2013-07-13

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• 用delphi5實(shí)現(xiàn)SOAP通信免費(fèi)下載

  資源簡介：用delphi5實(shí)現(xiàn)SOAP通信

  標(biāo)簽： delphi5 SOAP 通信

  上傳時(shí)間： 2013-12-14

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• 用匯編語言實(shí)現(xiàn)數(shù)模轉(zhuǎn)換芯片max532的控制免費(fèi)下載

  資源簡介：用匯編語言實(shí)現(xiàn)數(shù)模轉(zhuǎn)換芯片max532的控制

  標(biāo)簽： max 532 匯編語言 數(shù)模轉(zhuǎn)換

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• 用匯編語言實(shí)現(xiàn)模數(shù)轉(zhuǎn)換芯片max170的控制免費(fèi)下載

  資源簡介：用匯編語言實(shí)現(xiàn)模數(shù)轉(zhuǎn)換芯片max170的控制

  標(biāo)簽： max 170 匯編語言 模數(shù)轉(zhuǎn)換芯片

  上傳時(shí)間： 2013-12-11

  上傳用戶：jennyzai

• 用FPGA實(shí)現(xiàn)SDRAM的操作免費(fèi)下載

  資源簡介：用FPGA實(shí)現(xiàn)SDRAM的操作，具體操作見內(nèi)部說明文件

  標(biāo)簽： SDRAM FPGA 操作

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• 用FPGA實(shí)現(xiàn)IIC通訊的主控端免費(fèi)下載

  資源簡介：用FPGA實(shí)現(xiàn)IIC通訊的主控端，最簡化的代碼，占用最小FPGA資源

  標(biāo)簽： FPGA IIC 通訊 主控

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