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DC邏輯綜合

  • 資源大小:267 K
  • 上傳時(shí)間: 2013-11-12
  • 上傳用戶:eewormx
  • 資源積分:2 下載積分
  • 標(biāo)      簽: 邏輯

資 源 簡(jiǎn) 介

芯片綜合的過(guò)程:芯片的規(guī)格說(shuō)明,芯片設(shè)計(jì)的劃分,預(yù)布局,RTL 邏輯單元的綜合,各邏輯單元的集成,測(cè)試,布局規(guī)劃,布局布線,最終驗(yàn)證等步驟。設(shè)計(jì)流程與思想概述:一個(gè)設(shè)計(jì)從市場(chǎng)需求到實(shí)際應(yīng)用需要運(yùn)用工程的概念和方法加以實(shí)現(xiàn),這需要工程人員遵循一定的規(guī)則按一定的設(shè)計(jì)步驟進(jìn)行操作。

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    標(biāo)簽: 邏輯

    上傳時(shí)間: 2013-11-24

    上傳用戶:wangyi39

  • DC邏輯綜合免費(fèi)下載

    資源簡(jiǎn)介:芯片綜合的過(guò)程:芯片的規(guī)格說(shuō)明,芯片設(shè)計(jì)的劃分,預(yù)布局,RTL 邏輯單元的綜合,各邏輯單元的集成,測(cè)試,布局規(guī)劃,布局布線,最終驗(yàn)證等步驟。設(shè)計(jì)流程與思想概述:一個(gè)設(shè)計(jì)從市場(chǎng)需求到實(shí)際應(yīng)用需要運(yùn)用工程的概念和方法加以實(shí)現(xiàn),這需要工程人員遵循一定...

    標(biāo)簽: 邏輯

    上傳時(shí)間: 2013-11-12

    上傳用戶:小楓殘?jiān)?/p>

  • 基于ALM結(jié)構(gòu)FPGA的邏輯綜合技術(shù)免費(fèi)下載

    資源簡(jiǎn)介:近些年來(lái),F(xiàn)PGA已經(jīng)成為現(xiàn)代電子、半導(dǎo)體行業(yè)的最重要組成部分之一,針對(duì)FPGA的綜合技術(shù)的研究是電子設(shè)計(jì)自動(dòng)化技術(shù)的重要研究方向。邏輯綜合是FPGA綜合的重要步驟,它包括邏輯優(yōu)化和工藝映射。本文主要研究了針對(duì)一種新型ALM(Adaptive Logic Model)結(jié)構(gòu)FPGA...

    標(biāo)簽: FPGA ALM 邏輯

    上傳時(shí)間: 2013-06-24

    上傳用戶:hechao3225

  • FIFO的Verilog程序 已在modelsim中編譯通過(guò) 并且可以通過(guò)DC進(jìn)行綜合免費(fèi)下載

    資源簡(jiǎn)介:FIFO的Verilog程序 已在modelsim中編譯通過(guò) 并且可以通過(guò)DC進(jìn)行綜合

    標(biāo)簽: modelsim Verilog FIFO 程序

    上傳時(shí)間: 2015-11-22

    上傳用戶:qq521

  • 關(guān)于Mulitis 仿真和編程的的邏輯綜合免費(fèi)下載

    資源簡(jiǎn)介:關(guān)于Mulitis 仿真和編程的的邏輯綜合

    標(biāo)簽: Mulitis 仿真 編程 邏輯

    上傳時(shí)間: 2016-07-18

    上傳用戶:franktu

  • 包含了四位計(jì)數(shù)器等基本數(shù)字模塊的的verilog HDL程序代碼,該功能實(shí)現(xiàn),可以直接利用DC進(jìn)行綜合,得到硬件電路,亦能夠轉(zhuǎn)換成VHDL語(yǔ)言進(jìn)行綜合免費(fèi)下載

    資源簡(jiǎn)介:包含了四位計(jì)數(shù)器等基本數(shù)字模塊的的verilog HDL程序代碼,該功能實(shí)現(xiàn),可以直接利用DC進(jìn)行綜合,得到硬件電路,亦能夠轉(zhuǎn)換成VHDL語(yǔ)言進(jìn)行綜合

    標(biāo)簽: verilog VHDL HDL 計(jì)數(shù)器

    上傳時(shí)間: 2013-12-19

    上傳用戶:hopy

  • 邏輯綜合工具使用教程免費(fèi)下載

    資源簡(jiǎn)介:文檔內(nèi)包含了邏輯綜合工具的使用教程,內(nèi)容簡(jiǎn)單易懂,入門可學(xué)

    標(biāo)簽: 邏輯 使用教程

    上傳時(shí)間: 2018-07-28

    上傳用戶:zhangqi

  • Verilog HDL數(shù)字設(shè)計(jì)與綜合(第二版)免費(fèi)下載

    資源簡(jiǎn)介:·本書從用戶的角度全面闡述了Verilog HDL語(yǔ)言的重要細(xì)節(jié)和基本設(shè)計(jì)方法,并詳細(xì)介紹了Verilog 2001版的主要改進(jìn)部分。本書重點(diǎn)關(guān)注如何應(yīng)用Verilog語(yǔ)言進(jìn)行數(shù)字電路和系統(tǒng)的設(shè)計(jì)和驗(yàn)證,而不僅僅講解語(yǔ)法。全書從基本概念講起,并逐漸過(guò)渡到編程語(yǔ)言接口以及...

    標(biāo)簽: Verilog nbsp HDL 數(shù)字設(shè)計(jì)

    上傳時(shí)間: 2013-04-24

    上傳用戶:gyq

  • 可編輯程邏輯及IC開(kāi)發(fā)領(lǐng)域的EDA工具介紹免費(fèi)下載

    資源簡(jiǎn)介:EDA (Electronic Design Automation)即“電子設(shè)計(jì)自動(dòng)化”,是指以計(jì)算機(jī)為工作平臺(tái),以EDA軟件為開(kāi)發(fā)環(huán)境,以硬件描述語(yǔ)言為設(shè)計(jì)語(yǔ)言,以可編程器件PLD為實(shí)驗(yàn)載體(包括CPLD、FPGA、EPLD等),以集成電路芯片為目標(biāo)器件的電子產(chǎn)品自動(dòng)化設(shè)計(jì)過(guò)程。“工欲善其...

    標(biāo)簽: EDA 編輯 邏輯

    上傳時(shí)間: 2013-11-19

    上傳用戶:wxqman

  • 可綜合性邏輯設(shè)計(jì)免費(fèi)下載

    資源簡(jiǎn)介:??? 邏輯綜合帶來(lái)了數(shù)字設(shè)計(jì)行業(yè)的革命,有效地提高了生產(chǎn)率,減少了設(shè)計(jì)周期時(shí)間。在手動(dòng)轉(zhuǎn)換設(shè)計(jì)的年代,設(shè)計(jì)過(guò)程受到諸多限制,結(jié)更容易帶來(lái)人為的錯(cuò)誤。而一個(gè)小小的錯(cuò)誤就導(dǎo)致整個(gè)模塊需進(jìn)行重新設(shè)計(jì),設(shè)計(jì)轉(zhuǎn)換工作占去了整個(gè)設(shè)計(jì)周期的大部分時(shí)間,...

    標(biāo)簽: 邏輯設(shè)計(jì)

    上傳時(shí)間: 2013-10-25

    上傳用戶:colinal

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    標(biāo)簽: EDA 編輯 邏輯

    上傳時(shí)間: 2013-10-11

    上傳用戶:1079836864

  • 《VDHL硬件描述語(yǔ)言與數(shù)字邏輯》 ——————電子工程師必備知識(shí) 西安電子科技大學(xué)出版社出版 第一章 數(shù)字系統(tǒng)硬件設(shè)計(jì)概述 第二章 VHDL語(yǔ)言程序的基本結(jié)構(gòu) 第三章 VHDL語(yǔ)言的數(shù)據(jù)類免費(fèi)下載

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    標(biāo)簽: VHDL VDHL 硬件描述語(yǔ)言 數(shù)字邏輯

    上傳時(shí)間: 2013-12-30

    上傳用戶:皇族傳媒

  • 多細(xì)分二相混合式步進(jìn)電機(jī)驅(qū)動(dòng)器的研制.rar免費(fèi)下載

    資源簡(jiǎn)介:論文分析了混合式步進(jìn)電動(dòng)機(jī)的工作原理和運(yùn)行特性。采用簡(jiǎn)化的磁網(wǎng)絡(luò)模型,推導(dǎo)了建立二相混合式步進(jìn)電機(jī)數(shù)學(xué)模型的關(guān)系式。并對(duì)步進(jìn)電機(jī)的多種驅(qū)動(dòng)技術(shù)進(jìn)行了詳細(xì)的研究,著重分析和論述了正弦脈寬調(diào)制細(xì)分驅(qū)動(dòng)技術(shù)。文中對(duì)整個(gè)系統(tǒng)的結(jié)構(gòu)、硬件電路設(shè)計(jì)及驅(qū)...

    標(biāo)簽: 步進(jìn)電機(jī) 驅(qū)動(dòng)器

    上傳時(shí)間: 2013-06-07

    上傳用戶:西伯利亞狼

  • 雙余度無(wú)刷直流電機(jī)控制系統(tǒng)設(shè)計(jì)及性能研究.rar免費(fèi)下載

    資源簡(jiǎn)介:本課題來(lái)源于重點(diǎn)航空研究項(xiàng)目——某型飛機(jī)電動(dòng)舵機(jī)用雙余度隔槽嵌放式稀土永磁直流無(wú)刷電機(jī)的研制,進(jìn)行雙余度無(wú)刷直流電機(jī)的控制技術(shù)及性能研究具有理論意義、工程意義和顯著的社會(huì)效益和經(jīng)濟(jì)效益.論文介紹以AT89C51單片機(jī)與SG3525脈寬調(diào)制控制器為核心的雙...

    標(biāo)簽: 無(wú)刷直流電機(jī) 控制系統(tǒng)設(shè)計(jì) 性能

    上傳時(shí)間: 2013-07-21

    上傳用戶:FFAN

  • 基于FPGA的數(shù)字圖像處理.rar免費(fèi)下載

    資源簡(jiǎn)介:數(shù)字圖像處理技術(shù)是信息科學(xué)中近幾十年來(lái)發(fā)展最為迅速的學(xué)科之一。目前,數(shù)字圖像處理技術(shù)被廣泛應(yīng)用于航空航天、通信、醫(yī)學(xué)及工業(yè)生產(chǎn)等領(lǐng)域中。數(shù)字圖像處理的特點(diǎn)是處理的數(shù)據(jù)量大,處理非常耗時(shí),本文研究了在FPGA上用硬件描述語(yǔ)言實(shí)現(xiàn)圖像處理算法,通過(guò)...

    標(biāo)簽: FPGA 數(shù)字圖像處理

    上傳時(shí)間: 2013-04-24

    上傳用戶:han_zh

  • MPEG2視頻解碼器的FPGA設(shè)計(jì).rar免費(fèi)下載

    資源簡(jiǎn)介:MPEG-2是MPEG組織在1994年為了高級(jí)工業(yè)標(biāo)準(zhǔn)的圖象質(zhì)量以及更高的傳輸率所提出的視頻編碼標(biāo)準(zhǔn),其優(yōu)秀性使之成為過(guò)去十年應(yīng)用最為廣泛的標(biāo)準(zhǔn),也是未來(lái)十年影響力最為廣泛的標(biāo)準(zhǔn)之一。 本文以MPEG-2視頻標(biāo)準(zhǔn)為研究?jī)?nèi)容,建立系統(tǒng)級(jí)設(shè)計(jì)方案,設(shè)計(jì)FPGA原型芯片...

    標(biāo)簽: MPEG2 FPGA 視頻解碼器

    上傳時(shí)間: 2013-07-27

    上傳用戶:ice_qi

  • 基于FPGA的圖像處理算法的研究與硬件設(shè)計(jì).rar免費(fèi)下載

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    標(biāo)簽: FPGA 圖像處理 法的研究

    上傳時(shí)間: 2013-06-08

    上傳用戶:shuiyuehen1987

  • 基于FPGA/CPLD實(shí)現(xiàn)的FFT算法與仿真分析免費(fèi)下載

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    標(biāo)簽: FPGA CPLD FFT 算法

    上傳時(shí)間: 2013-07-18

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    資源簡(jiǎn)介:JPEG2000是新一代的靜態(tài)圖像壓縮標(biāo)準(zhǔn),它相比JPEG有很多新的特性,如漸進(jìn)傳輸和感興趣區(qū)域編碼等,因而它具有廣闊的應(yīng)用前景,特別是在數(shù)碼相機(jī)、PDA等便攜式設(shè)備中。 JPEG2000的核心主要包括小波變換和基于最優(yōu)化截?cái)帱c(diǎn)的嵌入式塊編碼(EBCOT)算法,其計(jì)算復(fù)...

    標(biāo)簽: JPEG 2000 FPGA 編碼

    上傳時(shí)間: 2013-04-24

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    標(biāo)簽: JPEG 2000 FPGA 小波變換

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  • 基于FPGA的JPEG編解碼芯片設(shè)計(jì)免費(fèi)下載

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    標(biāo)簽: FPGA JPEG 編解碼 芯片設(shè)計(jì)

    上傳時(shí)間: 2013-05-31

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    標(biāo)簽: FPGA 華為 培訓(xùn)教程

    上傳時(shí)間: 2013-08-08

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    標(biāo)簽: EDA 工程建模 管理方法

    上傳時(shí)間: 2013-11-10

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