?? frequency_divider.fit.rpt
字號(hào):
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
; Fout ; 22 ; 1 ; 0 ; 2 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
+------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
+-----------------------------------------------------------+
; I/O Bank Usage ;
+----------+-----------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+-----------------+---------------+--------------+
; 1 ; 5 / 14 ( 35 % ) ; 3.3V ; -- ;
; 2 ; 0 / 17 ( 0 % ) ; 3.3V ; -- ;
; 3 ; 0 / 17 ( 0 % ) ; 3.3V ; -- ;
; 4 ; 0 / 17 ( 0 % ) ; 3.3V ; -- ;
+----------+-----------------+---------------+--------------+
+--------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
; 1 ; 0 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 2 ; 1 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 3 ; 2 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 4 ; 4 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 5 ; 8 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 6 ; 9 ; 1 ; *~nCSO~ / GND* ; output ; LVTTL ; ; Row I/O ; N ;
; 7 ; 10 ; 1 ; ^DATA0 ; input ; ; ; -- ; ;
; 8 ; 11 ; 1 ; ^nCONFIG ; ; ; ; -- ; ;
; 9 ; ; ; VCCA_PLL1 ; power ; ; 1.5V ; -- ; ;
; 10 ; 12 ; 1 ; Fin ; input ; LVTTL ; ; Row I/O ; N ;
; 11 ; ; ; GNDA_PLL1 ; gnd ; ; ; -- ; ;
; 12 ; 14 ; 1 ; ^nCEO ; ; ; ; -- ; ;
; 13 ; 15 ; 1 ; ^nCE ; ; ; ; -- ; ;
; 14 ; 16 ; 1 ; ^MSEL0 ; ; ; ; -- ; ;
; 15 ; 17 ; 1 ; ^MSEL1 ; ; ; ; -- ; ;
; 16 ; 18 ; 1 ; ^DCLK ; bidir ; ; ; -- ; ;
; 17 ; 19 ; 1 ; *~ASDO~ / GND* ; output ; LVTTL ; ; Row I/O ; N ;
; 18 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ;
; 19 ; ; ; GND ; gnd ; ; ; -- ; ;
; 20 ; 23 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 21 ; 24 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 22 ; 25 ; 1 ; Fout ; output ; LVTTL ; ; Row I/O ; N ;
; 23 ; 26 ; 1 ; Reset_N ; input ; LVTTL ; ; Row I/O ; N ;
; 24 ; 27 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 25 ; 28 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 26 ; 29 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 27 ; 30 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 28 ; 33 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 29 ; 34 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 30 ; ; ; GND ; gnd ; ; ; -- ; ;
; 31 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ;
; 32 ; ; ; GND ; gnd ; ; ; -- ; ;
; 33 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 34 ; 35 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 35 ; 36 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 36 ; 39 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 37 ; 40 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 38 ; 44 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 39 ; 45 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 40 ; 46 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 41 ; 49 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 42 ; 50 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 43 ; ; ; GND ; gnd ; ; ; -- ; ;
; 44 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 45 ; ; ; GND ; gnd ; ; ; -- ; ;
; 46 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ;
; 47 ; 51 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 48 ; 52 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 49 ; 55 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 50 ; 56 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 51 ; 57 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 52 ; 58 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 53 ; 59 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 54 ; 60 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 55 ; 61 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 56 ; 62 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 57 ; 63 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 58 ; ; ; GND ; gnd ; ; ; -- ; ;
; 59 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ;
; 60 ; 68 ; 3 ; ^CONF_DONE ; ; ; ; -- ; ;
; 61 ; 69 ; 3 ; ^nSTATUS ; ; ; ; -- ; ;
; 62 ; 70 ; 3 ; #TCK ; input ; ; ; -- ; ;
; 63 ; 71 ; 3 ; #TMS ; input ; ; ; -- ; ;
; 64 ; 72 ; 3 ; #TDO ; output ; ; ; -- ; ;
; 65 ; 73 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 66 ; 75 ; 3 ; GND+ ; ; ; ; Row I/O ; ;
; 67 ; 77 ; 3 ; #TDI ; input ; ; ; -- ; ;
; 68 ; 78 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 69 ; 79 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 70 ; 80 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 71 ; 81 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 72 ; 82 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 73 ; 84 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 74 ; 87 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 75 ; 88 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 76 ; 89 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 77 ; 90 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 78 ; 93 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 79 ; 94 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 80 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ;
; 81 ; ; ; GND ; gnd ; ; ; -- ; ;
; 82 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 83 ; ; ; GND ; gnd ; ; ; -- ; ;
; 84 ; 95 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 85 ; 96 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 86 ; 99 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 87 ; 100 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 88 ; 101 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 89 ; 105 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 90 ; 106 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 91 ; 109 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 92 ; 110 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 93 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 94 ; ; ; GND ; gnd ; ; ; -- ; ;
; 95 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ;
; 96 ; ; ; GND ; gnd ; ; ; -- ; ;
; 97 ; 111 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 98 ; 112 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 99 ; 115 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 100 ; 116 ; 2 ; GND* ; ; ; ; Column I/O ; ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
+------------------------------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+---------------------+-------+------------------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+---------------------+-------+------------------------------------+
; LVTTL ; 10 pF ; Not Available ;
; LVCMOS ; 10 pF ; Not Available ;
; 2.5 V ; 10 pF ; Not Available ;
; 1.8 V ; 10 pF ; Not Available ;
; 1.5 V ; 10 pF ; Not Available ;
; SSTL-3 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-3 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; Differential SSTL-2 ; 30 pF ; (See SSTL-2) ;
+---------------------+-------+------------------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+---------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Full Hierarchy Name ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+---------------------+
; |F_Div_20 ; 12 (12) ; 9 ; 0 ; 3 ; 0 ; 3 (3) ; 0 (0) ; 9 (9) ; 8 (8) ; |F_Div_20 ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+---------------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.
+----------------------------------------------------------------------------------+
; Delay Chain Summary ;
+---------+----------+---------------+---------------+-----------------------+-----+
; Name ; Pin Type ; Pad to Core 0 ; Pad to Core 1 ; Pad to Input Register ; TCO ;
+---------+----------+---------------+---------------+-----------------------+-----+
; Reset_N ; Input ; ON ; ON ; -- ; -- ;
; Fin ; Input ; OFF ; OFF ; -- ; -- ;
; Fout ; Output ; -- ; -- ; -- ; -- ;
+---------+----------+---------------+---------------+-----------------------+-----+
+---------------------------------------------------+
; Pad To Core Delay Chain Fanout ;
+---------------------+-------------------+---------+
; Source Pin / Fanout ; Pad To Core Index ; Setting ;
+---------------------+-------------------+---------+
; Reset_N ; ; ;
; - Fout~reg0 ; 1 ; ON ;
; - j[6]~213 ; 1 ; ON ;
; Fin ; ; ;
+---------------------+-------------------+---------+
+---------------------------------------------------------------------------------------------------+
; Control Signals ;
+----------+-------------+---------+-------------+--------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Usage ; Global ; Global Resource Used ; Global Line Name ;
+----------+-------------+---------+-------------+--------+----------------------+------------------+
; Fin ; PIN_10 ; 9 ; Clock ; yes ; Global clock ; GCLK2 ;
; j[6]~213 ; LC_X2_Y2_N8 ; 8 ; Sync. clear ; no ; -- ; -- ;
+----------+-------------+---------+-------------+--------+----------------------+------------------+
+---------------------------------------------------------------------+
; Global & Other Fast Signals ;
+------+----------+---------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Global Resource Used ; Global Line Name ;
+------+----------+---------+----------------------+------------------+
?? 快捷鍵說(shuō)明
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