?? aoi_5_ca0.v
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module AOI_5_CA0(y_out,x_in1,x_in2,x_in3,x_in4,x_in5,enable); input x_in1,x_in2,x_in3,x_in4,x_in5,enable; output y_out; wire y_out=enable?~((x_in1&x_in2)|(x_in3&x_in4&x_in5)):1'bz; endmodule?? 快捷鍵說明
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