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μ<b>COS-II</b>程序設(shè)計(jì)基礎(chǔ)

μCOS-II 多任務編程設計

在基于實時操作系統的應用程序設計中，任務設計是整個應用程序的基礎，其他軟件設計工作都是圍繞任務設計來展開，任務設計就是設計“任務函數”和相關的數據結構。

標簽： COS-II 多任務編程

上傳時間： 2017-04-21

上傳用戶：shao_shl
java入門編程合集

題目：古典問題：有一對兔子，從出生后第3個月起每個月都生一對兔子，小兔子長到第三個月后每個月又生一對兔子，假如兔子都不死，問每個月的兔子總數為多少？ //這是一個菲波拉契數列問題 public class lianxi01 { public static void main(String[] args) { System.out.println("第1個月的兔子對數: 1"); System.out.println("第2個月的兔子對數: 1"); int f1 = 1, f2 = 1, f, M=24; for(int i=3; i<=M; i++) { f = f2; f2 = f1 + f2; f1 = f; System.out.println("第" + i +"個月的兔子對數: "+f2); } } } 【程序2】題目：判斷101-200之間有多少個素數，并輸出所有素數。程序分析：判斷素數的方法：用一個數分別去除2到sqrt(這個數)，如果能被整除，則表明此數不是素數，反之是素數。 public class lianxi02 { public static void main(String[] args) { int count = 0; for(int i=101; i<200; i+=2) { boolean b = false; for(int j=2; j<=Math.sqrt(i); j++) { if(i % j == 0) { b = false; break; } else { b = true; } } if(b == true) {count ++;System.out.println(i );} } System.out.println( "素數個數是: " + count); } } 【程序3】題目：打印出所有的 "水仙花數 "，所謂 "水仙花數 "是指一個三位數，其各位數字立方和等于該數本身。例如：153是一個 "水仙花數 "，因為153=1的三次方＋5的三次方＋3的三次方。 public class lianxi03 { public static void main(String[] args) { int b1, b2, b3;

標簽： java 編程

上傳時間： 2017-12-24

上傳用戶：Ariza
（網盤）300本Python電子書

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標簽： python

上傳時間： 2022-06-06

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基于ARM的無線數據傳輸系統設計

本文在分析研究部隊執勤信息化建設對無線數據傳輸技術需求的基礎上，以無線數據傳輸技術和嵌入式系統研究為背景，按照嵌入式系統開發的流程和方法，以設計通用化、模塊化軟硬件平臺為重點，解決無線數據傳輸系統設計關鍵技術為核心，設計了由32位嵌入式系統主控模塊和射頻收發模塊組成的無線數據傳輸系統原型；并通過移植嵌入式實時操作系統--uC/OS-II，構造了系統軟件開發平臺；在此基礎上，完成了系統相關驅動程序和通信協議等底層軟件設計，為進一步擴展系統功能，實現工程應用打下了基礎。首先，論文比較了系統微處理器的選擇，無線通信方式的選擇，系統接口方式的選擇等相關方案，分析了應用32位ARM處理器和嵌入式操作系統構建系統主控模塊的優勢，提出了系統的軟硬件整體結構框架。其次，從構建通用軟、硬件平臺的角度，重點介紹了LPC2138(ARM)微處理器和nRF401無線射頻芯片主要特性及相關外圍電路的設計，并對系統的硬件抗干擾措施進行了分析。在完成硬件電路設計的基礎上，針對主控模塊設計了啟動代碼，分析了uC/OS-II操作系統體系結構，進行了系統移植，形成了完整的軟硬件開發平臺。最后，在學習研究uC/OS-II操作系統程序設計技術的基礎上，討論了系統相關驅動程序和通信協議等底層軟件的開發方法，完成了基本的層次化，模塊化軟件設計，對系統無線傳輸功能進行了驗證，并對系統將來的功能擴展和工程應用提出了構想。

標簽： ARM 無線數據傳輸系統設計

上傳時間： 2013-07-06

上傳用戶：362279997
可重構FPGA通訊糾錯進化電路及其實現

ASIC對產品成本和靈活性有一定的要求.基于MCU方式的ASIC具有較高的靈活性和較低的成本,然而抗干擾性和可靠性相對較低,運算速度也受到限制.常規ASIC的硬件具有速度優勢和較高的可靠性及抗干擾能力,然而不是靈活性較差,就是成本較高.與傳統硬件(CHW)相比,具有一定可配置特性的場可編程門陣列(FPGA)的出現,使建立在可再配置硬件基礎上的進化硬件(EHW)成為智能硬件電路設計的一種新方法.作為進化算法和可編程器件技術相結合的產物,可重構FPGA的研究屬于EHW的研究范疇,是研究EHW的一種具體的實現方法.論文認為面向分類的專用類可重構FPGA(ASR-FPGA)的研究,可使可重構電路粒度劃分的針對性更強、設計更易實現.論文研究的可重構FPGA的BCH通訊糾錯碼進化電路是一類ASR-FPGA電路的具體方法,具有一定的實用價值.論文所做的工作主要包括:(1)BCH編譯碼電路的設計——求取實驗用BCH碼的生成多項式和校驗多項式及其相應的矩陣并構造實驗用BCH碼;(2)建立基于可重構FPGA的基核——構造具有可重構特性的硬件功能單元,以此作為可重構BCH碼電路的設計基礎;(3)構造實現可重構BCH糾錯碼電路的方法——建立可重構糾錯碼硬件電路算法并進行實驗驗證;(4)在可重構糾錯碼電路基礎上,構造進化硬件控制功能塊的結構,完成各進化RLA控制模塊的驗證和實現.課題是將可重構BCH碼的編譯碼電路的實現作為一類ASR-FPGA的研究目標,主要成果是根據可編程邏輯電路的特點,選擇一種可編程樹的電路模型,并將它作為可重構FPGA電路的基核T;通過對循環BCH糾錯碼的構造原理和電路結構的研究,將基核模型擴展為能滿足糾錯碼電路需要的糾錯碼基本功能單元T;以T作為再劃分的基本單元,對FPGA進行"格式化",使T規則排列在FPGA上,通過對T的控制端的不同配置來實現糾錯碼的各個功能單元;在可重構基核的基礎上提出了糾錯碼重構電路的嵌套式GA理論模型,將嵌套式GA的染色體串作為進化硬件描述語言,通過轉換為相應的VHDL語言描述以實現硬件電路;采用RLA模型的有限狀態機FSM方式實現了可重構糾錯碼電路的EHW的各個控制功能塊.在實驗方面,利用Xilinx FPGA開發系統中的VHDL語言和電路圖相結合的設計方法建立了循環糾錯碼基核單元的可重構模型,進行循環糾錯BCH碼的電路和功能仿真,在Xilinx公司的Virtex600E芯片進行了FPGA實現.課題在研究模型上選取的是比較基本的BCH糾錯碼電路,立足于解決基于可重構FPGA核的設計的基本問題.課題的研究成果及其總結的一套ASR-FPGA進化硬件電路的設計方法對實際的進化硬件設計具有一定的實際指導意義,提出的基于專用類基核FPGA電路結構的研究方法為新型進化硬件的器件結構的設計也可提供一種借鑒.

標簽： FPGA 可重構通訊糾錯

上傳時間： 2013-07-01

上傳用戶：myworkpost
ASK調制與解調VHDL程序及仿真等多篇實例

ASK調制與解調VHDL程序及仿真 \r\nFSK調制與解調VHDL程序及仿真\r\nPSK調制與解調VHDL程序及仿真\r\n基帶碼發生器程序設計與仿真\r\n頻率計程序設計與仿真

標簽： VHDL ASK 調制與解調程序

上傳時間： 2013-09-05

上傳用戶：edward_0608
微電腦型數學演算式雙輸出隔離傳送器

特點(FEATURES) 精確度0.1%滿刻度 (Accuracy 0.1%F.S.) 可作各式數學演算式功能如:A+B/A-B/AxB/A/B/A&B(Hi or Lo)/|A| (Math functioA+B/A-B/AxB/A/B/A&B(Hi&Lo)/|A|/etc.....) 16 BIT 類比輸出功能(16 bit DAC isolating analog output function) 輸入/輸出1/輸出2絕緣耐壓2仟伏特/1分鐘(Dielectric strength 2KVac/1min. (input/output1/output2/power)) 寬范圍交直流兩用電源設計(Wide input range for auxiliary power) 尺寸小,穩定性高(Dimension small and High stability)

標簽： 微電腦數學演算輸出隔離傳送器

上傳時間： 2013-11-24

上傳用戶：541657925
基于CAN總線的嵌入式車燈監控系統設計

為了確保車燈的質量可靠性，提出了一種嵌入式車燈控制及電氣參數檢測系統的設計方案。系統包括上位機監控終端和下位機控制節點，監控終端負責設置各車燈的工作參數和顯示車燈的工作狀態；控制節點采用基于Cortex-M3內核的嵌入式微處理器LM3S2965為核心，將實時操作系統μCOS-II植入其中，提高系統的實時性和穩定性，同時將我國自主研發的iCAN協議應用到系統中，從而實現對車燈的網絡化監控。結果表明，系統最多可對63個車燈進行實時的電氣參數檢測與控制，具有較高的可靠性。

標簽： CAN 總線嵌入式車燈

上傳時間： 2013-11-06

上傳用戶：cccole0605
最詳細的NIOSII教程

　　核心板配置　　 核心板配置癿FPGA芯片是Cyclone II系列癿EP2C8Q208C，具有8256個LEs，36個M4K RAM blocks (4Kbits plus 512 parity bits)，同時具有165,888bit癿RAM，支持18個Embedded multipliers和2個PLL，資源配備十分豐富。實驗證明，返款芯片在嵌入NIOS II軟核將黑釐開収板癿所有外謳全部跑起來，僅占全部資源癿70-80% ; 　　 核心板同時配備了64Mbit癿SDRAM，對亍運行NIOS軟核提供了有力癿保障，返款芯片為時鐘頻率有143MHz，實驗證明，NIOS II軟核主頻可以平穩運行120MHz，速度迓是相當忚癿; 　　 16Mbit癿配置芯片也為返款核心板增色丌少，丌僅可以存儲配置信息，同時迓可以實現NIOS II軟件程序存儲，你編寫癿程序再大也沒有后頊乀憂了。　　 20M癿有源晶振也是必丌可少癿，他是整個系統癿時鐘源泉;4個LED對亍調試來說更是提供了徑多方便;復位按鍵，重新配置按鍵，配置指示燈一個也丌能少;同時支持AS模式和JTAG模式; 　　 除此以外，核心板一個更大的特點是它可以獨立亍底板單獨運行，為此配備了5V癿電源接口，高質量癿紅色開關，為了安全迓加入了自恢復保險絲。當然擴展口是丌能少癿，除了SDRAM占用癿38個IO口外，其他100個IO全部擴展出來，為大家可以迕行自我擴展實驗做好了充分癿準備。　　四、下擴展板配置　　為了讓FPGA収揮它癿強大功能，黑釐開収板為其謳計一款資源豐富癿下擴展板(乀所以叨下擴展板，是因為我們后續迓會有上擴展板)。下面我們就來簡單介終一下下擴展板癿資源配置。　　 支持網絡功能，配置ENC28J60網口芯片。ENC28J60是Microchip Technology(美國微芯科技公司)推出癿28引腳獨立以太網控刢器。目前市場上大部分以太網控刢器癿封裝均赸過80引腳，而符吅IEEE 802.3協議癿ENC28J60叧有28引腳，既能提供相應癿功能，又可以大大簡化相關謳計，減小空間; 　　 支持USB功能，配置CH376芯片。CH376 支持USB 謳備方式和USB 主機方式，幵丏內置了USB 途訊協議癿基本固件，內置了處理Mass-Storage海量存儲謳備癿與用途訊協議癿固件，內置了SD 卡癿途訊接口固件，內置了FAT16和FAT32 以及FAT12 文件系統癿管理固件，支持常用癿USB 存儲謳備(包括U 盤/USB 硬盤/USB 閃存盤/USB 讀卡器)和SD 卡(包括標準容量SD 卡和高容量HC-SD 卡以及協議兼容癿MMC 卡和TF 卡); 　　 支持板載128*64的點陣LCD。ST7565P控刢芯片，內置DC/DC電路，途過軟件調節對比度。該芯片支持，幵口和串口丟種方式;

標簽： NIOSII 教程

上傳時間： 2013-11-23

上傳用戶：ouyangtongze
嵌入式實時操作系統μCOS-II原理及應用_任哲

本書的將應及內容: • "源碼公開的最入王軍寞時操作系統fLC/OS- 1 1 為技心介紹了般人式蠅作系統在侄務侄務的調度和管理任務之間的通倩相同步內存管理等方面的實現陽應用特點 · 語密文字通俗易懂盡量越免了大量喪序摞代碼的剖析講解而代之以揭圖和例題!挺重點突出 · 在"C/05 -11 系統的移植的講解方面盡量雖曹先讀者可能不太熟悉的葉算機硬件系徒從而沖擊，.，片學習的重點而以大多數讀者都比役了'再和熟摩的"'系列單片機為硬件系統.

標簽： COS-II 嵌入式實時操作系統

上傳時間： 2013-10-29

上傳用戶：wettetw