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乘法器設計

  • ALTERA上DE2平臺

    ALTERA上DE2平臺，verilog描述，無符號乘法器，在數碼管顯示結果。

    標簽： ALTERA DE2

    上傳時間： 2013-12-13

    上傳用戶：牧羊人8920

  • 使用C#程式語言開發

    使用C#程式語言開發，並執行於.NET Framework下；是研習「蟻拓尋優法」不可或缺的軟體工具。系統使用ACO (Ant Colony Optimization)演算公式模擬螞蟻的覓食行徑抉擇。使用者可以設定費洛蒙和食物氣味強度等相關參數以及動態設定障礙物的位置和形狀，研習螞蟻覓食的最短路徑形成過程。研習各種參數設定對螞蟻覓食行為的影響，了解費落蒙機制對蟻拓尋優化法的影響。本系統可支援柔性計算教學，研習蟻拓優化法中人工螞蟻的隨機搜尋模式和啟發式法則設計原理。

    標簽： 程式

    上傳時間： 2013-12-24

    上傳用戶：anng

  • 代碼分為兩部分：ff_const_mul.v和ff_mul.v

    代碼分為兩部分：ff_const_mul.v和ff_mul.v，從而實現GF乘法器，VERILOG編寫

    標簽： ff_const_mul ff_mul 分 代碼

    上傳時間： 2016-11-13

    上傳用戶：

  • 在 Java EE 的藍圖中

    在 Java EE 的藍圖中，JSP Servlet是屬於Web層技術，JSP與Servlet是一體的兩面，您可以使用單獨一項技術來解決動態網頁呈現的需求，但最好的方式是取兩者的長處，JSP是網頁設計人員導向的，而Servlet是程式設計人員導向的，釐清它們之間的職責可以讓兩個不同專長的團隊彼此合作，並降低相互間的牽制作用。

    標簽： Java EE

    上傳時間： 2016-11-15

    上傳用戶：sxdtlqqjl

  • 最基本的vhdl運算

    最基本的vhdl運算，採用8bit作乘法器，將兩串8bit的值輸入之後進行相乘

    標簽： vhdl

    上傳時間： 2013-12-16

    上傳用戶：zhenyushaw

  • 如果您是從使用的角度來看JSF

    如果您是從使用的角度來看JSF，則您不用理會HTTP、資料轉換等細節，JSF將細節都隱藏起來了，無論您是網頁設計人員或是應用程式設計人員，都可以使用自己熟悉的方式來看JSF。

    標簽： JSF 角度

    上傳時間： 2016-12-10

    上傳用戶：lijinchuan

  • 地址譯碼

    地址譯碼，狀態機的編寫，三態輸出，布司乘法器

    標簽： 地址 譯碼

    上傳時間： 2014-07-31

    上傳用戶：腳趾頭

  • 絕對好東西

    絕對好東西，一個VHDL寫的任意寬度通用串行乘法器，以最少的資源實現乘法器功能。

    標簽：

    上傳時間： 2017-01-10

    上傳用戶：lepoke

  • 基4-FFT蝶形單元實現

    基4-FFT蝶形單元實現，按照FPGA內部的乘法器功能編寫的

    標簽： FFT

    上傳時間： 2014-01-05

    上傳用戶：520

  • 基于verilog的fir濾波器設計

    基于verilog的fir濾波器設計，用的并行結構。在前面基礎上加入四級流水（加法器，并行乘法器，乘法結果相加兩級），通過驗證。

    標簽： verilog fir 濾波器設計

    上傳時間： 2013-11-26

    上傳用戶：liuchee

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