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二級(jí)注冊(cè)消防工程師

  • altera 颶風(fēng)二代開發(fā)板的原理圖

    altera 颶風(fēng)二代開發(fā)板的原理圖,pdf格式\r\n

    標(biāo)簽: altera 開發(fā)板 原理圖

    上傳時(shí)間: 2013-08-15

    上傳用戶:qimingxing130

  • 在文件夾YL2440_CPLD中有做好的CPLD工程

    在文件夾YL2440_CPLD中有做好的CPLD工程,請(qǐng)用Xilinx ISE 6.2打開.

    標(biāo)簽: CPLD 2440 YL 工程

    上傳時(shí)間: 2013-08-26

    上傳用戶:cainaifa

  • 基于CPLD的二進(jìn)制碼轉(zhuǎn)換為二十進(jìn)制(BCD)碼的電路

    基于CPLD的二進(jìn)制碼轉(zhuǎn)換為二十進(jìn)制(BCD)碼的電路[1].pdf

    標(biāo)簽: CPLD BCD 二進(jìn)制碼 轉(zhuǎn)換

    上傳時(shí)間: 2013-09-03

    上傳用戶:rtsm07

  • 該工程文件實(shí)現(xiàn)ARM系統(tǒng)中CPLD的邏輯工作

    該工程文件實(shí)現(xiàn)ARM系統(tǒng)中CPLD的邏輯工作,起到外圍資源的邏輯地址譯碼功能

    標(biāo)簽: CPLD ARM 工程

    上傳時(shí)間: 2013-09-05

    上傳用戶:zcs023047

  • skill語言在Cadence平臺(tái)二次開發(fā)中大量使用

    skill語言在Cadence平臺(tái)二次開發(fā)中大量使用,在IC設(shè)計(jì)中也有應(yīng)用。\r\n本文關(guān)鍵詞:SKILL Cadence SKILL開發(fā)程序源碼大集合,共有84個(gè)功能實(shí)現(xiàn)

    標(biāo)簽: Cadence skill 語言 二次開發(fā)

    上傳時(shí)間: 2013-09-09

    上傳用戶:qingzhuhu

  • skill語言在Cadence平臺(tái)二次開發(fā)中大量使用

    skill語言在Cadence平臺(tái)二次開發(fā)中大量使用,在IC設(shè)計(jì)中也有應(yīng)用。\r\n本文關(guān)鍵詞:SKILL Allegro二次開發(fā)參考 API函數(shù)

    標(biāo)簽: Cadence skill 語言 二次開發(fā)

    上傳時(shí)間: 2013-09-09

    上傳用戶:edisonfather

  • proteus教程全集發(fā)布(十二)

    proteus教程全集發(fā)布(十二)----此全集基本上匯集了網(wǎng)絡(luò)上大部分的教程、資料(isis,ares),是學(xué)習(xí)proteus的好幫手,成為proteus高手盡在此全集中.讓你爽個(gè)夠

    標(biāo)簽: proteus 教程 發(fā)布

    上傳時(shí)間: 2013-09-30

    上傳用戶:88mao

  • EDA工程建模及其管理方法研究2

    EDA工程建模及其管理方法研究2 1 隨著微電子技術(shù)與計(jì)算機(jī)技術(shù)的日益成熟,電子設(shè)計(jì)自動(dòng)化(EDA)技術(shù)在電子產(chǎn)品與集成電路 (IC)芯片特別是單片集成(SoC)芯片的設(shè)計(jì)應(yīng)用中顯得越來越重要。EDA技術(shù)采用“自上至下”的設(shè)計(jì)思想,允許設(shè)計(jì)人員能夠從系統(tǒng)功能級(jí)或電路功能級(jí)進(jìn)行產(chǎn)品或芯片的設(shè)計(jì),有利于產(chǎn)品在系統(tǒng)功能上的綜合優(yōu)化,從而提高了電子設(shè)計(jì)項(xiàng)目的協(xié)作開發(fā)效率,降低新產(chǎn)品的研發(fā)成本。 近十年來,EDA電路設(shè)計(jì)技術(shù)和工程管理方面的發(fā)展主要呈現(xiàn)出兩個(gè)趨勢(shì): (1) 電路的集成水平已經(jīng)進(jìn)入了深亞微米的階段,其復(fù)雜程度以每年58%的幅度迅速增加,芯片設(shè)計(jì)的抽象層次越來越高,而產(chǎn)品的研發(fā)時(shí)限卻不斷縮短。 (2) IC芯片的開發(fā)過程也日趨復(fù)雜。從前期的整體設(shè)計(jì)、功能分,到具體的邏輯綜合、仿真測(cè)試,直至后期的電路封裝、排版布線,都需要反復(fù)的驗(yàn)證和修改,單靠個(gè)人力量無法完成。IC芯片的開發(fā)已經(jīng)實(shí)行多人分組協(xié)作。由此可見,如何提高設(shè)計(jì)的抽象層次,在較短時(shí)間內(nèi)設(shè)計(jì)出較高性能的芯片,如何改進(jìn)EDA工程管理,保證芯片在多組協(xié)作設(shè)計(jì)下的兼容性和穩(wěn)定性,已經(jīng)成為當(dāng)前EDA工程中最受關(guān)注的問題。

    標(biāo)簽: EDA 工程建模 管理方法

    上傳時(shí)間: 2013-11-10

    上傳用戶:yan2267246

  • 基于二叉樹的時(shí)序電路測(cè)試序列設(shè)計(jì)

      為了實(shí)現(xiàn)時(shí)序電路狀態(tài)驗(yàn)證和故障檢測(cè),需要事先設(shè)計(jì)一個(gè)輸入測(cè)試序列。基于二叉樹節(jié)點(diǎn)和樹枝的特性,建立時(shí)序電路狀態(tài)二叉樹,按照電路二叉樹節(jié)點(diǎn)(狀態(tài))與樹枝(輸入)的層次邏輯關(guān)系,可以直觀和便捷地設(shè)計(jì)出時(shí)序電路測(cè)試序列。用測(cè)試序列激勵(lì)待測(cè)電路,可以驗(yàn)證電路是否具有全部預(yù)定狀態(tài),是否能夠?qū)崿F(xiàn)預(yù)定狀態(tài)轉(zhuǎn)換。

    標(biāo)簽: 二叉樹 時(shí)序電路 測(cè)試序列

    上傳時(shí)間: 2013-10-19

    上傳用戶:qitiand

  • 基于新型CCCII電流模式二階帶通濾波器設(shè)計(jì)

    針對(duì)傳統(tǒng)第二代電流傳輸器(CCII)電壓跟隨不理想的問題,提出了新型第二代電流傳輸器(CCCII)并通過采用新型第二代電流傳輸器(CCCII)構(gòu)成二階電流模式帶通濾波器,此濾波器只需使用2個(gè)電流傳輸器和2個(gè)電容即可完成設(shè)計(jì)。設(shè)計(jì)結(jié)構(gòu)簡(jiǎn)單,其中心頻率可由電流傳輸器的偏置電流控制。利用HSpice軟件仿真分析并驗(yàn)證了理論設(shè)計(jì)的準(zhǔn)確性和可行性。

    標(biāo)簽: CCCII 電流模式 二階 帶通濾波器設(shè)計(jì)

    上傳時(shí)間: 2013-11-15

    上傳用戶:jqy_china

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