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交通信號

  • 并口epp模式下與fpga通信例子

    并口epp模式下與fpga通信例子，附源碼

    標(biāo)簽： fpga epp 并口 模式

    上傳時間： 2013-09-03

    上傳用戶：caiqinlin

  • FPGA的串行通信UART控制器

    基于FPGA的串行通信UART控制器，采用VHDL語言編寫，包含多個子模塊。\r\n在ISE或FPGA的其它開發(fā)環(huán)境下新建一個工程，然后將文檔中的各個模塊程序添加進(jìn)去，即可運行仿真。源程序已經(jīng)過本人的仿真驗證。

    標(biāo)簽： FPGA UART 串行通信 控制器

    上傳時間： 2013-09-03

    上傳用戶：xieguodong1234

  • 結(jié)合XILINXCPLD所做的模擬RS232通信verilog源程序

    結(jié)合XILINXCPLD所做的模擬RS232通信verilog源程序

    標(biāo)簽： XILINXCPLD verilog 232 RS

    上傳時間： 2013-09-03

    上傳用戶：gps6888

  • 用VHDL語言在CPLD上實現(xiàn)串行通信

    用VHDL語言在CPLD上實現(xiàn)串行通信

    標(biāo)簽： VHDL CPLD 語言 串行通信

    上傳時間： 2013-09-06

    上傳用戶：q3290766

  • VHDL實現(xiàn)：單片機與FPGA接口通信源文件

    程序主要用硬件描述語言（VHDL）實現(xiàn)：\r\n單片機與FPGA接口通信的問題

    標(biāo)簽： VHDL FPGA 單片機 接口通信

    上傳時間： 2013-09-06

    上傳用戶：ddddddos

  • FPGA和PC機之間串行通信對輸出正弦波頻率的控制

    1、 利用FLEX10的片內(nèi)RAM資源，根據(jù)DDS原理，設(shè)計產(chǎn)生正弦信號的各功能模塊和頂層原理圖； 2、 利用實驗板上的TLC7259轉(zhuǎn)換器，將1中得到的正弦信號，通過D/A轉(zhuǎn)換，通過ME5534濾波后在示波器上觀察； 3、 輸出波形要求： 在輸入時鐘頻率為16KHz時，輸出正弦波分辨率達(dá)到1Hz； 在輸入時鐘頻率為4MHz時，輸出正弦波分辨率達(dá)到256Hz； 4、 通過RS232C通信，實現(xiàn)FPGA和PC機之間串行通信，從而實現(xiàn)用PC機改變頻率控制字，實現(xiàn)對輸出正弦波頻率的控制。

    標(biāo)簽： FPGA PC機 串行通信 輸出

    上傳時間： 2013-09-06

    上傳用戶：zhuimenghuadie

  • 10Gbits GPON系統(tǒng)的完整，緊湊型APD偏置解決方案

    雪崩光電二極管 (APD) 接收器模塊在光纖通信繫統(tǒng)中被廣泛地使用。APD 模塊包含 APD 和一個信號調(diào)理放大器，但並不是完全獨立。它仍舊需要重要的支持電路，包括一個高電壓、低噪聲電源和一個用於指示信號強度的精準(zhǔn)電流監(jiān)視器

    標(biāo)簽： Gbits GPON APD 10

    上傳時間： 2013-11-22

    上傳用戶：zhangyigenius

  • MT-012 ADC需要考慮的交調(diào)失真因素

    交調(diào)失真(IMD)是用于衡量放大器、增益模塊、混頻器和其他射頻元件線性度的一項常用 指標(biāo)。二階和三階交調(diào)截點(IP2和IP3)是這些規(guī)格參數(shù)的品質(zhì)因素，以其為基礎(chǔ)可以計算 不同信號幅度下的失真積。雖然射頻工程師們非常熟悉這些規(guī)格參數(shù)，但當(dāng)將其用于ADC 時往往會產(chǎn)生一些困惑。本教程首先在ADC的框架下對交調(diào)失真進(jìn)行定義，然后指出將 IP2和IP3的定義應(yīng)用于ADC時必須采取的一些預(yù)防措施。

    標(biāo)簽： 012 ADC MT 交調(diào)失真

    上傳時間： 2013-11-05

    上傳用戶：Pzj

  • DAC3484,DAC34H84輸出功率定標(biāo)

    DAC3484 和DAC34H84 是德州儀器（Texas Instruments）新推出的低功耗，高密度，高采樣率，高性能的數(shù)模轉(zhuǎn)換芯片，這款芯片目前已經(jīng)廣泛的應(yīng)用在通信行業(yè)。本文詳細(xì)介紹了DAC3484，DAC34H84 與正交調(diào)制器的輸出接口以及輸出功率定標(biāo)的計算問題。

    標(biāo)簽： DAC 3484 34 84

    上傳時間： 2013-10-18

    上傳用戶：sun_pro12580

  • 基于CORDIC算法的高速ODDFS電路設(shè)計

    為了滿足現(xiàn)代高速通信中頻率快速轉(zhuǎn)換的需求，基于坐標(biāo)旋轉(zhuǎn)數(shù)字計算（CORDIC，Coordinate Rotation Digital Computer）算法完成正交直接數(shù)字頻率合成（ODDFS，Orthogonal Direct Digital Frequency Synthesizer）電路設(shè)計方案。采用MATLAB和Xilinx System Generator開發(fā)工具搭建電路的系統(tǒng)模型，通過現(xiàn)場可編程門陣列（FPGA，F(xiàn)ield Programmable Gate Array）完成電路的寄存器傳輸級（RTL，Register Transfer Level）驗證，仿真結(jié)果表明電路設(shè)計具有很高的有效性和可行性。

    標(biāo)簽： CORDIC ODDFS 算法 電路設(shè)計

    上傳時間： 2013-11-09

    上傳用戶：hfnishi

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