以verilog HDL 語言編寫的一首歌曲
以verilog HDL 語言編寫的一首歌曲,可供初學(xué)者借鑒...
以verilog HDL 語言編寫的一首歌曲,可供初學(xué)者借鑒...
本教程定位于FPGA/CPLD的快速入門。以ALTERA公司的芯片和相應(yīng)的開發(fā)軟件為目標(biāo)載體進(jìn)行闡述,本教程闡述了ALTERA主要系列芯片PLD芯片的結(jié)構(gòu)和特點(diǎn)以及相應(yīng)的開發(fā)軟件MAX和Plusa和Q...
此手冊讓讀者以最快速度掌握protel工具幫你解決后顧之憂...
以圖片的形式簡單,明了的講解了Proteus中的如何取消TEXT字樣。一看就明白。...
現(xiàn)在生活好了,很多家庭都用上了太陽能熱水器,其應(yīng)用太陽能,清潔無污染,實(shí)用價(jià)廉,深受喜歡。但市場上出售的大多太陽能熱水器水滿報(bào)警裝置太簡陋,只設(shè)了一條回水管,水從回水管流出來很容易被忽視,易造...
由于CMOS器件靜電損傷90%是延遲失效,對整機(jī)應(yīng)用的可靠性影響太大,因而有必要對CMOS器件進(jìn)行抗靜電措施。本文描述了CMOS器件受靜電損傷的機(jī)理,從而對設(shè)計(jì)人員提出了幾種在線路設(shè)計(jì)中如何抗靜電...
電壓源電流源名字上僅差一個(gè)字…HE HE.有一些朋友對此不太明白.所以特此說明下…并以軟件仿真…詳細(xì)介紹工作原理…以及注意事項(xiàng)….下面就是電壓源和電流的符號…左邊是電流源,右邊是電壓源. 電壓源…電壓...
PCB設(shè)計(jì)問題集錦 問:PCB圖中各種字符往往容易疊加在一起,或者相距很近,當(dāng)板子布得很密時(shí),情況更加嚴(yán)重。當(dāng)我用Verify Design進(jìn)行檢查時(shí),會產(chǎn)生錯(cuò)誤,但這種錯(cuò)誤可以忽略。往往這種錯(cuò)誤很...
諸如電信設(shè)備、存儲模塊、光學(xué)繫統(tǒng)、網(wǎng)絡(luò)設(shè)備、服務(wù)器和基站等許多復(fù)雜繫統(tǒng)都采用了 FPGA 和其他需要多個(gè)電壓軌的數(shù)字 IC,這些電壓軌必須以一個(gè)特定的順序進(jìn)行啟動(dòng)和停機(jī)操作,否則 IC 就會遭到損...
太陽能AC模塊逆變器是近年來發(fā)展非常快的技術(shù),本文提出一種新型的基于反激 變換器的逆變器拓?fù)浣Y(jié)構(gòu)。該電路結(jié)構(gòu)簡單,通過Zeta電路將功率脈動(dòng)轉(zhuǎn)換成小容量電容上的 電壓脈動(dòng)。大大減小了直流輸入側(cè)的低頻諧...