<center id="thqej"></center> 甚短距離傳輸(VSR)是一種用于短距離(約300 m～600m)內進行數據傳輸的光傳輸技術.它主要應用于網絡中的交換機、核心路由器(CR)、光交叉連接設備(OXC)、分插復用器(ADM)和波分復用(WDM)終端等不同層次設備之間的互連,具有構建方便、性能穩定和成本低等優點,是光通信技術發展的一個全新領域,逐漸成為國際通用的標準技術,成為全光網的一個重要組成部分. 本文深入研究了VSR并行光傳輸系統,完成了VSR技術的核心部分--轉換器子系統的設計與實現,使用現場可編程陣列FPGA(Field Programmable GateArray)來完成轉換器電路的設計和功能實現.深入研究現有VSR4-1.0和VSR4-3.0兩種并行傳輸標準,在其技術原理的基礎上,提出新的VSR并行方案,提高了多模光纖帶的信道利用率,充分利用系統總吞吐量大的優勢,為將來向更高速率升級提供了依據.根據萬兆以太網的技術特點和傳輸要求,提出并設計了用VSR技術實現局域和廣域萬兆以太網在較短距離上的高速互連的系統方案,成功地將VSR技術移植到萬兆以太網上,實現低成本、構建方便和性能穩定的高速短距離傳輸. 本文所有的設計均在Altera Stratix GX系列FPGA的EP1SGX25F1020C7上實現,采用Altera的Quartus Ⅱ開發工具和 Verilog HDL硬件描述語言完成了VSR4-1.0轉換器集成電路和萬兆以太網的SERDES的設計和仿真,并給出了各模塊的電路結構和仿真結果.仿真的結果表明,所有的設計均能正確的實現各自的功能,完全能夠滿足10Gb/s高速并行傳輸系統的要求.
上傳時間： 2013-07-14
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本文介紹了一個以嵌入式USB 主機接口芯片SL811HS 為核心，采用U 盤為存儲介質的單片機低功耗海量存儲系統。該系統實現了儀器的便攜化，從而，為便攜儀器或嵌入式系統的外掛式海量存儲
上傳時間： 2013-06-14
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智能控制器是智能斷路器的核心，不僅具有普通脫扣器的各種保護功能，而且還具有實時參數顯示、故障記憶和查詢、自診斷等多項功能。在回顧和總結了智能斷路器的發展歷程后，討論了當前智能斷路器的發展趨勢，提出了基于ARM的斷路器智能控制器的研究。本論文介紹了斷路器智能控制器的設計原理，同時重點闡述了斷路器智能控制器的各項參數測量及保護原理和算法，并進行了具體的硬件和軟件模塊的設計，旨在實現斷路器的智能保護。 本文涉及的斷路器智能控制器，在硬件上以PHILIPS公司的ARM芯片LPC2294為核心處理器，主要進行數據的實時采集處理和斷路器的故障保護。硬件設計采用了標準化模塊設計方法，硬件電路盡可能選擇標準化、模塊化結構的典型電路，以便擴展。其中，液晶選用的是SMG240128A，鍵盤芯片選用的是ZLG7290。軟件的編制采用模塊化編程方法，每一個模塊相對獨立，完成特定功能，便于維護添加新功能。編程工具為ARM公司提供的ADS1.2。為了保證智能控制器各種保護功能的可靠實現，論文中對智能控制器的干擾源進行了分析，從硬件和軟件兩個方面采取了多項設計措施，提高了智能控制器的穩定性和可靠性。實踐證明，論文中構建的斷路器智能控制器結構簡單，易于實現，可以滿足系統需要，因此具有較高的實用價值。
上傳時間： 2013-06-10
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隨著光通信技術的不斷發展，光纖的需求量大幅增加，光纖測量儀器也隨之迅速發展起來，其中光時域反射儀(OTDR)受到廣泛重視。光時域反射儀是八十年代發展起來的新型光纖故障測試設備，其主要用途是能夠找出光纖的斷點，并進行故障定位。光時域反射儀具有非破壞性測量、功能齊全、安全性好、使用方便等優點，在工程上得到廣泛應用。目前，該領域主要被國外產品壟斷且價格昂貴。在這一背景下，國內企業開展OTDR的研制和開發，以降低成本，改進技術，占領光纖測試領域的市場成為當務之急。 本論文首先簡要介紹了光時域反射儀的歷史和現狀，并闡述了光纖測量技術涉及的光學原理，以及光時域反射儀的基本工作原理。在理論分析部分之后，基于對系統的特點及開發資源的考慮，提出基于嵌入式系統的光時域反射儀解決方案。在此基礎上，詳細介紹了以ARM為控制核心、DSP為運算核心的系統總體硬件結構；討論了采用ARM9內核的S3C2410處理器的軟件解決方案；著重說明了Linux嵌入式操作系統的選取與移植、bootloader的引導以及根文件系統的制作。最后重點論述了圖形用戶系統(GUI)的選取以及QtopiaCore的移植和開發過程。 本文所設計的光纖測量系統具有測量準確、可靠性高等特點。實驗表明，該系統能夠根據國際標準完成對光纖的衰減和長度等指標的檢測。
上傳時間： 2013-04-24
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數控機床是現代制造系統的基礎和核心，而先進的數控技術是解決機床制造業持續發展的關鍵。隨著嵌入式系統、微計算機技術和集成電路的迅速發展，高性能的32位CUP開始普及。它執行速度快、功能強大，在中、低檔數控系統中已經完全可以替代PC機及8位單片機，獲得更大的價格和技術優勢。本文旨在打破傳統基于PC機及8位單片機的數控系統，研究并設計一種基于ARM的32位嵌入式機床數控系統。 本文設計了基于ARM內核的嵌入式機床數控系統，并給出了硬件設計方案、軟件程序設計思想及相應設計。硬件部分選用是日本NOVA電子有限公司研制的DSP運動控制專用芯片MCX314AL，作為數控裝置電機的驅動芯片，其性能優良、接口簡單、編程方便、工作可靠，給運動控制帶來極大方便。采用ARM微處理器STR710負責控制MCX314AL、外圍邏輯電路的管理及后臺任務的實現。系統軟件平臺采用源代碼公開的嵌入式實時操作系統uC/OS-Ⅱ，對數控系統軟件模塊的任務進行劃分，并根據其實時性要求賦予不同優先級，采用基于優先級的搶占式調度算法，設計了任務間的通信方式及中斷事件的響應，使該數控系統具有良好的實時性和穩定性，可以滿足高精度加工的要求，同時也具有良好的人機界面和網絡支持。
上傳時間： 2013-05-25
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LM1875的經典電路及其資料，對制作以LM1875為主體集成芯片的音頻功率放大器有很大作用！
上傳時間： 2013-04-24
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隨著頻率合成理論和高速大規模集成電路的發展，信號發生器作為一類重要的儀器，在通信、檢測、導航等領域有著廣泛的應用。特別是在高壓電力系統的檢測領域，常常需要模擬電網諧波的標準信號源對檢測設備的性能進行校驗，例如高壓電力線路的相位檢測，避雷器的性能檢測，用戶電能表的性能校驗等。為此，本文圍繞一種新型的參數可調諧波信號發生器進行了研究和設計，課題得到了常州市科技攻關項目的資助。 本文首先論述了頻率合成技術的發展，并將直接數字頻率合成技術與傳統的頻率合成技術進行了比較。然后深入研究了DDS的工作原理和基本結構，從頻域角度分析了理想參數和實際參數兩種情況下DDS的輸出頻譜。在此基礎上，詳細分析了引起輸出雜散的三個主要因素，并對DDS的雜散抑制方法進行了仿真研究。最后對參數可調諧波信號發生器進行了軟硬件設計。 在系統設計的過程中，本文以Altera公司的FPGA芯片EPF10K70RC240-2為核心，利用開發工具MAX+PLUSⅡ并結合硬件描述語言VHDL設計了一種頻率、相位、幅度、諧波比例可調的諧波信號發生器。詳細闡述了該信號發生器的體系結構，并進行了軟硬件的設計和具體電路的實現。實驗結果表明，系統的性能指標均達到了設計要求，且具有使用簡單、集成度高等特點。
上傳時間： 2013-05-20
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目前對數字化音頻處理的具體實現主要集中在以DSP或專用ASIC芯片為核心的處理平臺的開發方面，存在著并行處理性能差，系統升級和在線配置不靈活等缺點。另一方面現有解決方案的設計主要集中于處理器芯片，而對于音頻編解碼芯片的關注度較低，而且沒有提出過從芯片層到PCB板層的完整設計思路。本文針對上述問題對數字化音頻處理平臺進行了研究，主要內容包括： 1、提出了基于FPGA的通用音頻處理平臺，該方案有別于現有的基于MCU、DSP和其它專用ASIC芯片的方案，論證了基于FPGA的音頻處理系統的結構及設計工作流程，并對嵌入式音頻處理系統專門進行了研究。 2、提出了從芯片層到PCB板層的完整設計思路，并將設計思路得以實現。完成了FPGA的設計及實現過程，包括：系統整體分析，設計流程分析，配置模塊和數據通信模塊的RTL實現等；解決了FPGA與音頻編解碼芯片TLV320AIC23B之間接口不匹配問題；給出配置和數據通信模塊的功能方框圖；從多個角度完善PCB板設計，給出了各個系統組成部分的詳細設計方案和硬件電路原理圖，并附有PCB圖。 3、建立了實驗和分析環境，完成了各項實驗和分析工作，主要包括：PCB板信號完整性分析和優化，FPGA系統中各個功能模塊的實驗與分析等。實驗和分析結果論證了系統設計的合理性和實用性。 本文的研究與實現工作通過實驗和分析得到了驗證。結果表明，本文提出的由FPGA和音頻編解碼芯片TLV320AIC23B組成的數字化音頻處理系統完全可以實現音頻信號的數字化處理，從而可以將FPGA在數字信號處理領域的優點充分發揮于音頻信號處理領域。
上傳時間： 2013-06-09
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波形發生器設計論文:本系統主要以單片機為控制核心，由可編程邏輯器件（CPLD）模塊、鍵盤輸入模塊、LED顯示模塊、雙口RAMIDT7132、DA轉換輸出、rom、巴特沃斯有源低通濾波器等部件組成。采用
上傳時間： 2013-07-07
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· 摘要： 給出了一個基于DSP技術實現高速度、寬范圍、高精度的溫度采集系統方案.系統以DSP為控制核心,通過測溫電路采集溫度數據,經AD轉換后給DSP控制器.重點給出疊代法計算方法,DSP與AD轉換接口電路以及系統控制軟件的設計.
上傳時間： 2013-05-29
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