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仿真

仿真(Simulation),即使用項目模型將特定于某一具體層次的不確定性轉化為它們對目標的影響,該影響是在項目仿真項目整體的層次上表示的。項目仿真利用計算機模型和某一具體層次的風險估計,一般采用蒙特卡洛法進行仿真
  • 基于數據符號同步的FPGA仿真實現

    近年來,人們對無線數據和多媒體業務的需求迅猛增加,促進了寬帶無線通信新技術的發展和應用。正交頻分復用 (Orthogonal Frequency Division Multiolexing,OFDM)技術已經廣泛應用于各種高速寬帶無線通信系統中。然而 OFDM 系統相比單載波系統更容易受到頻偏和時偏的影響,因此如何有效地消除頻偏和時偏,實現系統的時頻同步是 OFDM 系統中非常關鍵的技術。 本文討論了非同步對 OFDM 系統的影響,分析了當前用于 OFDM 系統中基于數據符號的同步算法,并簡單介紹非基于數據符號同步技術。基于數據符號的同步技術通過加入訓練符號或導頻等附加信息,并利用導頻或訓練符號的相關性實現時頻同步。此算法由于加入了附加信息,降低了帶寬利用率,但同步精度相對較高,同步捕獲時間較短。 隨著電子芯片技術的快速發展,電子設計自動化 (Electronic DesignAutomation,EDA) 技術和可編程邏輯芯片 (FPGA/CPLD) 的應用越來越受到大家的重視,為此文中對 EDA 技術和 Altera 公司制造的 FPGA 芯片的原理和結構特點進行了闡述,還介紹了在相關軟件平臺進行開發的系統流程。 論文在對基于數據符號三種算法進行較詳細的分析和研究的基礎上,尤其改進了基于導頻符號的同步算法之后,利用 Altera 公司的 FPGA 芯片EP1S25F102015 在 OuartusⅡ5.0 工具平臺上實現了 OFDM 同步的硬件設計,然后進行了軟件仿真。其中對基于導頻符號同步的改進算法硬件設計過程了進行了詳細闡述。不僅如此,對于基于 PN 序列幀的同步算法和基于循環前綴 (Cycle Prefix,CP) 的極大似然 (Maximam Likelihood,ML)估計同步算法也有具體的仿真實現。 最后,文章還對它們進行了比較,基于導頻符號同步設計的同步精度比較高,但是耗費芯片的資源多,另一個缺點是沒有頻偏估計,因此運用受到一定限制。基于 PN 序列幀的同步設計使用了最少的芯片資源,但要提取 PN 序列中的信號數據有一定困難。基于循環前綴的同步設計占用了芯片 I/O 腳稍顯多。這幾種同步算法各有優缺點,但可以根據不同的信道環境選用它們。

    標簽: FPGA 數據 同步的 仿真實現

    上傳時間: 2013-04-24

    上傳用戶:斷點PPpp

  • 基于VB的凸輪機構的參數化設計及其動畫仿真

    本文以VB 為主體開發語言,實現了參數化設計凸輪和凸輪輪廓設計過程的動畫仿真,既提高了凸輪設計效率,又益于計算機輔助教學。

    標簽: 凸輪機構 參數 動畫仿真

    上傳時間: 2013-06-13

    上傳用戶:www240697738

  • 基于FPGA的無線信道仿真器設計與實現

    隨著人們對無線通信需求和質量的要求越來越高,無線通信設備的研發也變得越來越復雜,系統測試在整個設備研發過程中所占的比重也越來越大。為了能夠盡快縮短研發周期,測試人員需要在實驗室模擬出無線信道的各種傳播特性,以便對所設計的系統進行調試與測試。無線信道仿真器是進行無線通信系統硬件調試與測試不可或缺的儀器之一。 本文設計的無線信道仿真器是以Clarke信道模型為參考,采用基于Jakes模型的改進算法,使用Altera公司的StratixⅡ EP2S180模擬實現了頻率選擇性衰落信道。信道仿真器實現了四根天線數據的上行接收,每根天線由八條可分辨路徑,每條可分辨路徑由64個反射體構成,每根天線可分辨路徑和反射體的數目可以獨立配置。通過對每個反射體初始角度和初始相位的設置,并且保證反射體的角度和相位是均勻分布的隨機數,可以使得同一條路徑不同反射體之間的非相關特性,得到的多徑傳播信道是一個離散的廣義平穩非相關散射模型(WSSUS)。無線信道仿真器模擬了上行數據傳輸環境,上行數據由后臺產生后儲存在單板上的SDRAM中。啟動測試之后,上行數據在CPU的控制下通過信道仿真器,然后送達基帶處理板解調,最后測試數據的誤碼率和誤塊率,從而分析基站的上行接收性能。 首先,本文研究了3GPP TS 25.141協議中對通信設備測試的要求和無線信道自身的特點,完成了對無線信道仿真器系統設計方案的吸收和修改。 其次,針對FPGA內部資源結構,研究了信道仿真器FPGA實現過程中的困難和資源的消耗,進行了模塊劃分。主要完成了時延模塊、瑞利衰落模塊、背板接口模塊等的RTL級代碼的開發、仿真、綜合和板上調試;完成了FPGA和后臺軟件的聯合調試;完成了兩天線到四天線的改版工作,使FPGA內部的工作頻率翻了一倍,大幅降低了FPGA資源的消耗。 最后,在完成無線信道仿真器的硬件設計之后,對無線信道仿真器的測試根據3GPP TS 25.141 V6.13.0協議中的要求進行,即在數據誤塊率(BLER)一定的情況下,對不同信道傳播環境和不同傳輸業務下的信噪比(Eb/No)進行測試,單天線和多天線的測試結果符合協議中規定的信噪比(Eb/No)的要求。

    標簽: FPGA 無線信道 仿真

    上傳時間: 2013-04-24

    上傳用戶:小楊高1

  • 信道化中頻接收機設計與仿真實現

    軟件無線電(Software Radio)具有高度靈活性、開放性,很容易實現與現有和未來多種電臺的兼容,能最大限度的滿足了互聯互通的要求。而基于多相濾波器組的信道化軟件無線電接收技術以其固有的全概率接收、降采樣速率以及其大幅提高運算速率的能力越來越受到重視。本文主要研究了基于現場可編程門陣列(FPGA)的軟件無線電信道化中頻接收技術設計與實現。 首先介紹了軟件無線電的基本概念以及其發展狀況,深入討論了軟件無線電的基本理論,主要介紹了設計中所用到的帶通采樣技術、信號的抽取技術與多相濾波技術。 然后簡要介紹了信道化中頻接收機的射頻(Radio Frequency,RF)前端接收技術,設置寬中頻超外差接收機射頻前端的設計指標,給出了改進的實信號濾波器組低通型實現結構,并依此推導和建立了實信號多相濾波器組信道化中頻接收機的數學模型。 最后基于EP1S80開發平臺實現了實信號多相濾波器組信道化的中頻接收機。給出了多相濾波器、抽取運算、FFT運算、信道劃分以及復乘運算的設計方案。仿真結果表明,該接收機能夠實現對中頻信號的正確接收,驗證了系統設計的可行性。

    標簽: 信道 中頻 仿真實現 收機設計

    上傳時間: 2013-06-12

    上傳用戶:qq521

  • Proteus的8051仿真經典實例

    Pr0teus的51系列單片機仿真的實例,初學者很有用的、、、、、、、、、、、、

    標簽: Proteus 8051 仿真

    上傳時間: 2013-04-24

    上傳用戶:chuckbassboy

  • 基于PROTEUS的單片機系統設計與仿真

    基于PROTEUS的單片機系統設計與仿真

    標簽: PROTEUS 單片機 仿真 系統設計

    上傳時間: 2013-04-24

    上傳用戶:diaorunze

  • Proteus_MSP430仿真

    Proteus_MSP430仿真,描述了msp430的各個功能特點及應用實例程序等

    標簽: Proteus_MSP 430 仿真

    上傳時間: 2013-04-24

    上傳用戶:凌云御清風

  • AVS音頻編碼中長短窗的Matlab仿真

    AVS音頻編碼中長短窗的Matlab仿真及FPGA實現

    標簽: Matlab AVS 音頻編碼 仿真

    上傳時間: 2013-04-24

    上傳用戶:tyg88888

  • 單片機仿真軟件PROTEUS入門教程

    單片機仿真軟件PROTEUS入門教程,大家看著有用就下吧

    標簽: PROTEUS 單片機仿真軟件 入門教程

    上傳時間: 2013-04-24

    上傳用戶:集美慧

  • DVBT系統中內編解碼模塊的軟件仿真

    數字電視按傳輸方式分為地面、衛星和有線三種。其中,DVB-S和DVB-C這兩個全球化的衛星和有線傳輸方式標準,目前已作為世界統一標準被大多數國家所接受。而對于地面數字電視廣播標準,經國際電訊聯盟(ITU)批準的共有三個,包括歐盟的DVB-T(Digital Video Broadcasting-Terrestrial,數字視頻地面廣播)標準、美國的ATSC(Advanced Television System Committee,先進電視制式委員會)標準和日本的ISDB-T(Terrestrial Integrated Services DigitalBroadcasting,綜合業務數字廣播)標準。綜合比較起來,歐洲的DVB-T標準在技術及應用實踐上都更加成熟。 本論文首先介紹了DVB-T系統的主要結構,針對DVB-T標準中各模塊的實現進行了闡述,并根據發射機端各個模塊討論了接收機端相關模塊的算法設計。 隨后,論文給出了基于Microsoft Visual Studio 2005平臺實現的數字電視基帶信號產生與接收的軟件仿真系統的總體設計流程,重點討論了內編解碼器和內交織/解交織器的算法與實現,并在實現的多參數可選的數字電視基帶信號產生與接收軟件仿真平臺上,重點分析了內編/解碼模塊在接收端Viterbi譯碼算法中采用硬判決、簡化軟判決以及不同調制方式時對DVB-T系統整體性能的影響。 最后,論文討論了內碼譯碼算法的實現改進,使得Viterbi譯碼更適合在FPGA上實現,同時針對邏輯設計進行優化以便節省硬件資源。論文重點討論了對幸存路徑信息存儲譯碼模塊的改進,比較了此模塊三種不同的實現方式帶來的硬件速率和資源的優劣,通過利用4塊RAM對幸存路徑信息的交互讀寫,完成了對傳統回溯算法的改進,實現了加窗回溯的譯碼輸出,同時實現了回溯長度可配置以實現系統不同的性能要求。

    標簽: DVBT 模塊 編解碼

    上傳時間: 2013-08-02

    上傳用戶:遠遠ssad

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