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位置和速度

  • 基于ARM的GPS定位系統(tǒng)設(shè)計(jì)

    當(dāng)前全球定位系統(tǒng)（Navigation Satellite Timing And Ranging Global Position System，簡(jiǎn)稱GPS）廣泛應(yīng)用于艦船導(dǎo)航，航空航天，地理測(cè)繪等領(lǐng)域，特別是移動(dòng)式定位系統(tǒng)對(duì)于目前的城市交通管理有著非常重要的意義。本文分析了當(dāng)前交通管理中的實(shí)際問(wèn)題，介紹了一種車載終端的設(shè)計(jì)方法。設(shè)計(jì)采用ARM9內(nèi)核的S3C2410微處理器構(gòu)造的嵌入式系統(tǒng)，可以實(shí)現(xiàn)對(duì)GPS定位信息的接受和處理，并采用嵌入式Linux操作系統(tǒng)，結(jié)合開(kāi)放式Linux圖形軟件Qt，可以為后續(xù)的建立地理信息系統(tǒng)（Geographic information system，簡(jiǎn)稱GIS）提供數(shù)據(jù)支持，是集GPS全球衛(wèi)星定位系統(tǒng)和通用分組無(wú)線業(yè)務(wù)（General Packet Radio Service，簡(jiǎn)稱GPRS）無(wú)線通信技術(shù)于一體的新型電子產(chǎn)品。它為現(xiàn)代交通運(yùn)輸提供了新穎，可靠，有效的控制和管理途徑。 車載終端通過(guò)將GPS模塊的定位信息提取出來(lái)，一方面將定位信息在車載終端上顯示，一方面又結(jié)合車輛的狀態(tài)信息通過(guò)GPRS模塊發(fā)送出去，該信息通過(guò)無(wú)線公共網(wǎng)絡(luò)傳輸給車輛管理部門。車輛管理部門根據(jù)車輛的位置和狀態(tài)等，結(jié)合GIS系統(tǒng)中的地圖信息提供GPS數(shù)據(jù)的差分修正，并采取一定的措施，從而實(shí)現(xiàn)車輛的有效管理。 本設(shè)計(jì)從硬件和軟件兩大部分出發(fā)，硬件上設(shè)計(jì)了ARM處理器、存儲(chǔ)器、內(nèi)存及其外圍電路，另外還有GPS模塊電路和GPRS模塊電路；軟件上采用Qt的人機(jī)界面完成數(shù)據(jù)顯示與更新，采用PPP撥號(hào)腳本完成GPRS模塊的撥號(hào)，通過(guò)Qt多線程編程的方法完成GPS數(shù)據(jù)的提取和GPRS的信息發(fā)送。在硬件和軟件之間采用了嵌入式Linux系統(tǒng)，包括啟動(dòng)代碼、內(nèi)核和文件系統(tǒng)等。

    標(biāo)簽： ARM GPS 定位 系統(tǒng)設(shè)計(jì)

    上傳時(shí)間： 2013-04-24

    上傳用戶：夜月十二橋

  • 基于單片機(jī)的步進(jìn)電機(jī)控制器設(shè)計(jì).pdf

    步進(jìn)電機(jī)是一種將電脈沖轉(zhuǎn)化為角位移的執(zhí)行機(jī)構(gòu)，可以通過(guò)控制脈沖個(gè)數(shù)來(lái)控制角位移量，從而達(dá)到準(zhǔn)確定位的目的；同時(shí)可以通過(guò)控制脈沖頻率來(lái)控制電機(jī)轉(zhuǎn)動(dòng)的速度和加速度，從而達(dá)到調(diào)速的目的。由于步進(jìn)電機(jī)的控制原理是根據(jù)控制信號(hào)動(dòng)作，因此非常適合于單片機(jī)控制。 由于工業(yè)自動(dòng)化水平的提高，對(duì)很多工業(yè)監(jiān)控設(shè)備的要求也隨著提高，特別是對(duì)其驅(qū)動(dòng)部件步進(jìn)電機(jī)的位移和速度控制的要求越來(lái)越高，用單片機(jī)機(jī)對(duì)二維步進(jìn)電機(jī)實(shí)施精確位移和速度控制有極大的優(yōu)越性，二維步進(jìn)電機(jī)數(shù)控運(yùn)行系統(tǒng)是由ipc（工業(yè)控制計(jì)算機(jī)）發(fā)出控制指令，通過(guò)與單片機(jī)之間的通信，使單片機(jī)產(chǎn)生控制步進(jìn)電機(jī)運(yùn)轉(zhuǎn)的脈沖波形，使二維步進(jìn)電機(jī)分別作正傳、反轉(zhuǎn)、快轉(zhuǎn)、慢轉(zhuǎn)和停止等。

    標(biāo)簽： 單片機(jī) 制器設(shè)計(jì) 步進(jìn)電機(jī)

    上傳時(shí)間： 2013-05-18

    上傳用戶：sn2080395

  • 基于ARM的車載GPSGPRS系統(tǒng)

    本文分析了當(dāng)前車輛交通管理中的實(shí)際問(wèn)題，介紹了一種車載終端的設(shè)計(jì)方法。設(shè)計(jì)采用ARM9微處理器構(gòu)造的嵌入式系統(tǒng)，是集GPS全球衛(wèi)星定位系統(tǒng)和GPRS無(wú)線通信技術(shù)于一體的新型車載電子產(chǎn)品。它為現(xiàn)代交通運(yùn)輸提供了新穎，可靠，有效的控制和管理途徑。 車載終端通過(guò)將GPS模塊的定位信息提取出來(lái)，一方面將定位信息在車載終端上顯示，一方面又結(jié)合車輛的狀態(tài)等信息發(fā)送給GPRS模塊，發(fā)送出去的信息通過(guò)無(wú)線網(wǎng)絡(luò)傳輸給車輛管理部門。車輛管理部門根據(jù)車輛的位置和狀態(tài)等，采取一定的措施，從而實(shí)現(xiàn)車輛的有效管理。 本設(shè)計(jì)從硬件和軟件兩大部分出發(fā)，硬件上設(shè)計(jì)了ARM處理器、存儲(chǔ)器、內(nèi)存及其外圍電路，另外還有GPS模塊電路和GPRS模塊電路；軟件上采用Qt的人機(jī)界面完成數(shù)據(jù)顯示與更新，采用PPP撥號(hào)腳本完成GPRS模塊的撥號(hào)，通過(guò)Qt多線程編程的方法完成GPS數(shù)據(jù)的提取和GPRS的信息發(fā)送。在硬件和軟件之間采用了嵌入式Linux系統(tǒng)，包括啟動(dòng)代碼、內(nèi)核和文件系統(tǒng)等。 論文的最后總結(jié)了所完成的工作，給出了設(shè)計(jì)的不足之處和有待完善的地方。

    標(biāo)簽： GPSGPRS ARM 車載

    上傳時(shí)間： 2013-04-24

    上傳用戶：ice_qi

  • AES加、解密算法的FPGA優(yōu)化設(shè)計(jì)

    2000年10月2日，美國(guó)國(guó)家標(biāo)準(zhǔn)與技術(shù)研究所宣布采用Rijndael算法作為高級(jí)加密標(biāo)準(zhǔn)，并于2002年5月26日正式生效，AES算法將在今后很長(zhǎng)一段時(shí)間內(nèi)，在信息安全中扮演重要角色。因此，對(duì)AES算法實(shí)現(xiàn)的研究就成為了國(guó)內(nèi)外的熱點(diǎn)，會(huì)在信息安全領(lǐng)域得到廣泛的應(yīng)用。用FPGA實(shí)現(xiàn)AES算法具有快速、靈活、開(kāi)發(fā)周期短等優(yōu)點(diǎn)。 本論文就是針對(duì)AES加、解密算法在同一片F(xiàn)PGA中的優(yōu)化實(shí)現(xiàn)問(wèn)題，在深入分析了AES算法的整體結(jié)構(gòu)、基本變換以及加、解密流程的基礎(chǔ)上，對(duì)AES算法的加、解密系統(tǒng)的FPGA優(yōu)化設(shè)計(jì)進(jìn)行了研究。主要內(nèi)容為： 1．確定了實(shí)現(xiàn)方案以及關(guān)鍵技術(shù)，在比較了常用的結(jié)構(gòu)后，采用了適合高速并行實(shí)現(xiàn)AES加、解密算法的結(jié)構(gòu)——內(nèi)外混合的流水線結(jié)構(gòu)，并給出了總體的設(shè)計(jì)框圖。由于流水線結(jié)構(gòu)不適用于反饋模式，為了達(dá)到較高的運(yùn)算速度，該系統(tǒng)使用的是電碼本模式(ECB)的工作方式； 2．對(duì)各個(gè)子模塊的設(shè)計(jì)分別予以詳細(xì)分析，結(jié)合算法本身和FPGA的特點(diǎn)，采用查表法優(yōu)化處理了字節(jié)代換運(yùn)算，列混合運(yùn)算和密鑰擴(kuò)展運(yùn)算。同時(shí)，考慮到應(yīng)用環(huán)境的不同，本設(shè)計(jì)支持?jǐn)?shù)據(jù)分組為128比特，密鑰長(zhǎng)度為128比特、192比特以及256比特三種模式下的AES算法加、解密過(guò)程。完成了AES加、解密算法在同一片F(xiàn)PGA中實(shí)現(xiàn)的這個(gè)系統(tǒng)的優(yōu)化設(shè)計(jì)； 3．利用QLJARTUSII開(kāi)發(fā)工具進(jìn)行代碼的編寫工作和綜合編譯工作，在 MODELSIM中進(jìn)行仿真并給出仿真結(jié)果，給出了各個(gè)模塊和整個(gè)設(shè)計(jì)的仿真測(cè)試結(jié)果； 4．和其他類似的設(shè)計(jì)做了橫向?qū)Ρ龋贸鼋Y(jié)論：本設(shè)計(jì)在保證了速度的基礎(chǔ)上實(shí)現(xiàn)了資源和速度的均衡，在性能上具有較大的優(yōu)勢(shì)。

    標(biāo)簽： FPGA AES 解密 算法

    上傳時(shí)間： 2013-05-25

    上傳用戶：wcl168881111111

  • 基于FPGA的雙自觸發(fā)脈沖激光測(cè)距關(guān)鍵技術(shù)研究

    激光測(cè)距技術(shù)被廣泛應(yīng)用于現(xiàn)代工業(yè)測(cè)量、航空與大地的測(cè)量、國(guó)防及通信等諸多領(lǐng)域。本文從已獲得廣泛應(yīng)用的脈沖激光測(cè)距技術(shù)入手，重點(diǎn)分析了近年提出的自觸發(fā)脈沖激光測(cè)距技術(shù)(STPLR)特別是其中的雙自觸發(fā)脈沖激光測(cè)距技術(shù)(BSTPLR)，通過(guò)分析發(fā)現(xiàn)其核心部件之一就是用于測(cè)量激光脈沖飛行時(shí)間(周期)的高精度高速計(jì)數(shù)器，而目前一般的方式是采用昂貴的進(jìn)口高速計(jì)數(shù)器或?qū)Ｓ眉呻娐?ASIC)來(lái)完成，這使得激光測(cè)距儀在研發(fā)、系統(tǒng)的改造升級(jí)和自主知識(shí)產(chǎn)權(quán)保護(hù)等諸多方面受到制約，同時(shí)在其整體性能上特別是在集成化、小型化和高可靠性方面帶來(lái)阻礙。為此，本文研究了采用現(xiàn)場(chǎng)可編程門陣列(FPGA)來(lái)實(shí)現(xiàn)脈沖激光測(cè)距中的高精度高速計(jì)數(shù)及其他相關(guān)功能，基本解決了以上存在的問(wèn)題。 論文通過(guò)對(duì)雙自觸發(fā)脈沖激光測(cè)距的主要技術(shù)要求和技術(shù)指標(biāo)進(jìn)行分析，對(duì)其中的信號(hào)處理單元采用了FPGA+單片機(jī)的設(shè)計(jì)形式。由FPGA主控芯片(EPF10K20TC144-4)作為周期測(cè)量模塊，在整個(gè)測(cè)距系統(tǒng)中是信號(hào)處理的核心部件，借助其用戶可編程特性及很高的內(nèi)部時(shí)鐘頻率，設(shè)計(jì)了專用于BSTPLR的高速高精度計(jì)數(shù)芯片，負(fù)責(zé)對(duì)測(cè)距信號(hào)產(chǎn)生電路中的時(shí)刻鑒別電路輸出信號(hào)進(jìn)行計(jì)數(shù)。數(shù)據(jù)處理模塊則主要由單片機(jī)(AT89C51)來(lái)實(shí)現(xiàn)。系統(tǒng)可以通過(guò)鍵盤預(yù)置門控信號(hào)的寬度以均衡測(cè)量的精度和速度，測(cè)量結(jié)果采用7位LED數(shù)碼管顯示。本設(shè)計(jì)在近距離(大尺寸)范圍內(nèi)實(shí)驗(yàn)測(cè)試時(shí)基本滿足設(shè)計(jì)要求。

    標(biāo)簽： FPGA 自觸發(fā)脈沖 激光測(cè)距 關(guān)鍵技術(shù)

    上傳時(shí)間： 2013-04-24

    上傳用戶：dapangxie

  • 基于FPGA的星圖采集及預(yù)處理算法實(shí)現(xiàn)

    本文的目的就是研究如何應(yīng)用FPGA這種大規(guī)模的可編程邏輯器件實(shí)現(xiàn)CCD（Charge Coupled Device，電荷耦合器件）數(shù)字圖像的實(shí)時(shí)采集及預(yù)處理?；趯?duì)實(shí)時(shí)圖像處理系統(tǒng)的研究與設(shè)計(jì)，本文主要研究工作及成果如下： 1.本論文詳細(xì)的介紹了圖像采集卡的結(jié)構(gòu)和基本工作原理。同時(shí)，針對(duì)高分辨率的CCD攝像機(jī)，探討了有關(guān)點(diǎn)目標(biāo)與CCD像元一一對(duì)應(yīng)的圖像采集及其硬件和軟件設(shè)計(jì)方法。 2.本文分析了星圖中弱小目標(biāo)、噪聲以及背景的特點(diǎn)，給出了點(diǎn)目標(biāo)的場(chǎng)景圖像的數(shù)學(xué)模型及復(fù)雜背景下點(diǎn)目標(biāo)檢測(cè)的預(yù)處理方法。針對(duì)星圖灰度分布的特點(diǎn)，采用高斯低通濾波算法和高通濾波算法對(duì)星圖進(jìn)行預(yù)處理，同時(shí)還對(duì)圖像掃描聚類算法進(jìn)行了研究與分析。 3.數(shù)字信號(hào)處理器常常因?yàn)樵趶?fù)雜性、運(yùn)算速度等方面的限制，難以實(shí)時(shí)的實(shí)現(xiàn)復(fù)雜的檢測(cè)算法。本文采用FPGA技術(shù)，實(shí)現(xiàn)了復(fù)雜背景下弱點(diǎn)目標(biāo)的預(yù)處理算法，解決了計(jì)算、數(shù)據(jù)緩沖和存儲(chǔ)操作協(xié)調(diào)一致的問(wèn)題，同時(shí)采用并行高密度加法器和流水線的工作方式，使整個(gè)系統(tǒng)的數(shù)據(jù)交換和處理速度得以很大的提高，合理的解決了資源和速度之間的相互制約問(wèn)題，并在實(shí)際中取得滿意的結(jié)果。

    標(biāo)簽： FPGA 采集 預(yù)處理算法

    上傳時(shí)間： 2013-07-03

    上傳用戶：wang5829

  • 基于FPGA的DAB信道編碼器輸入接口的設(shè)計(jì)與實(shí)現(xiàn)

    電臺(tái)廣播在我們的社會(huì)生活中占有重要的地位。隨著我國(guó)廣播事業(yè)的發(fā)展，對(duì)我國(guó)廣播業(yè)開(kāi)發(fā)技術(shù)、信號(hào)的傳輸質(zhì)量和速度提出了更高更新的要求，促使廣播科研人員不斷更新現(xiàn)有技術(shù)，以滿足人民群眾日益增長(zhǎng)的需求。 本論文主要分析了現(xiàn)行廣播發(fā)射臺(tái)的數(shù)字廣播激勵(lì)器輸入接口的不足之處，根據(jù)歐洲ETS300799標(biāo)準(zhǔn)，實(shí)現(xiàn)了一種激勵(lì)器輸入接口的解決方案，這種方案將復(fù)接器送來(lái)的ETI(NA,G704)格式的碼流轉(zhuǎn)換成符合ETS300799標(biāo)準(zhǔn)ETI(NI)的標(biāo)準(zhǔn)碼流，并送往后面的信道編碼器。ETI(NA,G704)格式與現(xiàn)行的ETI(NI,G703)格式相比，主要加入了交織和RS糾錯(cuò)編碼，使得信號(hào)抗干擾能力大大加強(qiáng)，提高了節(jié)目從演播室到發(fā)射臺(tái)的傳輸質(zhì)量，特別是實(shí)時(shí)直播節(jié)目要求信號(hào)質(zhì)量比較好時(shí)具有更大的作用。 本論文利用校驗(yàn)位為奇數(shù)個(gè)的RS碼，對(duì)可檢不可糾的錯(cuò)誤發(fā)出報(bào)警信號(hào)，通過(guò)其它方法替代原有信號(hào)，對(duì)音質(zhì)影響不大，節(jié)省了糾正這個(gè)錯(cuò)誤的資源和開(kāi)發(fā)成本。 同時(shí)，我們采用FPGA硬件開(kāi)發(fā)平臺(tái)和VHDL硬件描述語(yǔ)言編寫代碼實(shí)現(xiàn)硬件功能，而不采用專用芯片實(shí)現(xiàn)功能，使得修改電路和升級(jí)變得異常方便，大大提高了開(kāi)發(fā)產(chǎn)品的效率，降低了成本。 經(jīng)過(guò)軟件仿真和硬件驗(yàn)證，本系統(tǒng)已經(jīng)基本實(shí)現(xiàn)了預(yù)想的功能，擴(kuò)展性較好，硬件資源開(kāi)銷較小，具有實(shí)用價(jià)值。

    標(biāo)簽： FPGA DAB 信道 編碼器

    上傳時(shí)間： 2013-07-15

    上傳用戶：afeiafei309

  • 基于FPGA的FFT數(shù)字處理器的硬件實(shí)現(xiàn)

    DFT(Discrete Fourier Transformation)是數(shù)字信號(hào)分析與處理如圖形、語(yǔ)音及圖像等領(lǐng)域的重要變換工具,直接計(jì)算DFT的計(jì)算量與變換區(qū)間長(zhǎng)度N的平方成正比.當(dāng)N較大時(shí),因計(jì)算量太大,直接用DFT算法進(jìn)行譜分析和喜好的實(shí)時(shí)處理是不切實(shí)際的.快速傅里葉變換(Fast Fourier Transformation,簡(jiǎn)稱FFT)使DFT運(yùn)算效率提高1~2個(gè)數(shù)量級(jí).本文的目的就是研究如何應(yīng)用FPGA這種大規(guī)?？删幊踢壿嬈骷?shí)現(xiàn)FFT的算法.本設(shè)計(jì)主要采用先進(jìn)的基-4DIT算法研制一個(gè)具有實(shí)用價(jià)值的FFT實(shí)時(shí)硬件處理器.在FFT實(shí)時(shí)硬件處理器的設(shè)計(jì)實(shí)現(xiàn)過(guò)程中,利用遞歸結(jié)構(gòu)以及成組浮點(diǎn)制運(yùn)算方式,解決了蝶形計(jì)算、數(shù)據(jù)傳輸和存儲(chǔ)操作協(xié)調(diào)一致問(wèn)題.合理地解決了位增長(zhǎng)問(wèn)題.同時(shí),采用并行高密度乘法器和流水線(pipeline)工作方式,并將雙端口RAM、只讀ROM全部?jī)?nèi)置在FPGA芯片內(nèi)部,使整個(gè)系統(tǒng)的數(shù)據(jù)交換和處理速度得以很大提高,實(shí)際合理地解決了資源和速度之間相互制約的問(wèn)題.本設(shè)計(jì)采用Verilog HDL硬件描述語(yǔ)言進(jìn)行設(shè)計(jì),由于在設(shè)計(jì)中采用Xilinx公司提供的稱為Core的IP功能塊極大地提高了設(shè)計(jì)效率.

    標(biāo)簽： FPGA FFT 數(shù)字處理器 硬件實(shí)現(xiàn)

    上傳時(shí)間： 2013-06-20

    上傳用戶：小碼農(nóng)lz

  • 低速率語(yǔ)音聲碼器的研究與實(shí)現(xiàn)

    數(shù)字語(yǔ)音通信是當(dāng)前信息產(chǎn)業(yè)中發(fā)展最快、普及面最廣的業(yè)務(wù)。語(yǔ)音信號(hào)壓縮編碼是數(shù)字語(yǔ)音信號(hào)處理的一個(gè)方面，它和通信領(lǐng)域聯(lián)系最為密切。在現(xiàn)有的語(yǔ)音編碼中，美國(guó)聯(lián)邦標(biāo)準(zhǔn)混合激勵(lì)線性預(yù)測(cè)（MELP—Mixed Excited Linear Prediction）算法在2．4kb/s的碼率下取得了較好的語(yǔ)音質(zhì)量，具有廣闊的應(yīng)用前景。 FPGA作為一種快速、高效的硬件平臺(tái)在數(shù)字信號(hào)處理和通信領(lǐng)域具有著獨(dú)特的優(yōu)勢(shì)?，F(xiàn)代大容量、高速度的FPGA一般都內(nèi)嵌有可配置的高速RAM、PLL、LVDS、LVTTL以及硬件乘法累加器等DSP模塊。用FPGA來(lái)實(shí)現(xiàn)數(shù)字信號(hào)處理可以很好地解決并行性和速度問(wèn)題，而且其靈活的可配置特性，使得FPGA構(gòu)成的DSP系統(tǒng)非常易于修改、測(cè)試及硬件升級(jí)。 本論文闡述了一種基于FPGA的混合激勵(lì)線性預(yù)測(cè)聲碼器的研究與設(shè)計(jì)。首先介紹了語(yǔ)音編碼研究的發(fā)展?fàn)顩r以及低速率語(yǔ)音編碼研究的意義，接著在對(duì)MELP算法進(jìn)行深入分析的基礎(chǔ)上，提出了利用DSP Builder在Matlab中建模的思路及實(shí)現(xiàn)過(guò)程，最后本文把重點(diǎn)放在MELP聲碼器的編解碼器設(shè)計(jì)上，利用DSP Builder、QuartusⅡ分別設(shè)計(jì)了其中的濾波器、分幀加窗處理、線性預(yù)測(cè)分析等關(guān)鍵模塊。 在Simulink環(huán)境下運(yùn)用SignalCompiler對(duì)編解碼系統(tǒng)進(jìn)行功能仿真，為了便于仿真，系統(tǒng)中沒(méi)有設(shè)計(jì)的模塊在Simulink中用數(shù)學(xué)模型代替，仿真結(jié)果表明，合成語(yǔ)音信號(hào)與原始信號(hào)很好的擬合，系統(tǒng)編解碼后語(yǔ)音質(zhì)量基本良好。

    標(biāo)簽： 低速 語(yǔ)音 聲碼器

    上傳時(shí)間： 2013-06-02

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  • 電磁無(wú)損檢測(cè)系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

    近年來(lái)，在鋼鐵材質(zhì)質(zhì)量檢測(cè)的研究領(lǐng)域，電磁無(wú)損檢測(cè)方法以其非破壞性和簡(jiǎn)便快速的優(yōu)點(diǎn)取得了大量成果，然而對(duì)于鋼材及其制品的混料、硬度和裂紋質(zhì)量檢測(cè)還存在許多難題.如用傳統(tǒng)檢測(cè)平臺(tái)檢測(cè)鋼鐵件硬度的檢測(cè)精度和速度都不夠理想。 基于上述情況，論文將先進(jìn)的SOPC技術(shù)應(yīng)用到鋼鐵件的電磁無(wú)損檢測(cè)中。SOPC技術(shù)將處理器、存儲(chǔ)器、IO接口、各種外圍設(shè)備等系統(tǒng)設(shè)計(jì)需要的部件集成到一個(gè)可編程邏輯器件上，構(gòu)建成一個(gè)可編程的片上系統(tǒng)。 論文詳細(xì)論述了基于FPGA的電磁無(wú)損檢測(cè)試驗(yàn)裝置的理論基礎(chǔ)，并在此基礎(chǔ)上給出了總體設(shè)計(jì)方案。全文著重?cái)⑹隽讼到y(tǒng)的模擬部分，系統(tǒng)配置以及軟件部分的整個(gè)設(shè)計(jì)過(guò)程。利用QuartusⅡ自定義外設(shè)和Avalon總線多主并行處理的特點(diǎn)，采用Vefilog HDL，語(yǔ)言實(shí)現(xiàn)激勵(lì)信號(hào)發(fā)生器和高速數(shù)據(jù)采集器，使得信號(hào)激勵(lì)和信號(hào)采集在同一片芯片中實(shí)現(xiàn)，從而提高了信號(hào)及信號(hào)處理的精確度。由于電磁檢測(cè)對(duì)多種參數(shù)的敏感反應(yīng)，必須抑制由此引入的多種因素的干擾，利用FIR數(shù)字濾波和相關(guān)方法從眾多的干擾信號(hào)中提取出有效信號(hào)的幅度和相位，同時(shí)利用NiosⅡC2H功能對(duì)濾波模塊進(jìn)行硬件加速處理，大大提高了信號(hào)處理的速度。利用最小二乘法建立回歸方程模型進(jìn)行無(wú)損檢測(cè)。最后運(yùn)用此電磁無(wú)損檢測(cè)系統(tǒng)對(duì)軸承鋼的硬度進(jìn)行了定性測(cè)試，取得了較好的檢測(cè)結(jié)果。 試驗(yàn)結(jié)果表明，將SOPC技術(shù)應(yīng)用到電磁無(wú)損檢測(cè)系統(tǒng)中，系統(tǒng)的檢測(cè)速度和檢測(cè)精度都有所提高，并使得整個(gè)系統(tǒng)在規(guī)模、可靠性、性能指標(biāo)、開(kāi)發(fā)成本、產(chǎn)品維護(hù)及硬件升級(jí)等多方面實(shí)現(xiàn)了優(yōu)化。

    標(biāo)簽： 電磁 無(wú)損檢測(cè)

    上傳時(shí)間： 2013-06-04

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