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供電系

  • 實用供配電技術手冊-550頁-17.5M.pdf

    專輯類-電工電力專輯-99冊-1.27G 實用供配電技術手冊-550頁-17.5M.pdf

    標簽: 17.5 550 供配電

    上傳時間: 2013-04-24

    上傳用戶:1757122702

  • GB-T-12560-1990-半導體器件-分立器件分規范-可供認證用-.pdf

    專輯類-國標類相關專輯-313冊-701M GB-T-12560-1990-半導體器件-分立器件分規范-可供認證用-.pdf

    標簽: 12560 GB-T 1990

    上傳時間: 2013-06-12

    上傳用戶:h886166

  • (臺達)開關電源基本原理與設計介紹

    (臺達)開關電源基本原理與設計介紹,比較實用

    標簽: 開關電源

    上傳時間: 2013-06-15

    上傳用戶:ybysp008

  • SPICE 60

    Cadence OrCAD 10.5, 讓PCB的設計進入更細節階段。與PSpice結合可應用于在Allegro平臺上。此套組系為一完整涵蓋前端至后端、使用微軟視窗平臺的流程,可以供印刷電路板(PCB) 設計師透過工具整合與程式自動化改善生產力

    標簽: SPICE 60

    上傳時間: 2013-06-07

    上傳用戶:225588

  • 常用供配電設備選型手冊.第01分冊.pdf

    資料->【F】機械結構->【F1】機械叢書->常用供配電設備選型手冊 (共5冊)->常用供配電設備選型手冊.第01分冊.pdf

    標簽: 供配電 設備

    上傳時間: 2013-04-24

    上傳用戶:gxrui1991

  • 常用供配電設備選型手冊.第05分冊.pdf

    資料->【F】機械結構->【F1】機械叢書->常用供配電設備選型手冊 (共5冊)->常用供配電設備選型手冊.第05分冊.pdf

    標簽: 供配電 設備

    上傳時間: 2013-06-05

    上傳用戶:snowkiss2014

  • FPGA可促進嵌入式系統設計改善即時應用性能

    FPGA可促進嵌入式系統設計改善即時應用性能,臺灣人寫的,關于FPGA應用的技術文章

    標簽: FPGA 嵌入式 系統 性能

    上傳時間: 2013-08-20

    上傳用戶:liuwei6419

  • 僅供參考的protel電路圖

    僅供參考的protel電路圖,實現電路交換。哈哈

    標簽: protel 電路圖

    上傳時間: 2013-09-16

    上傳用戶:lllliii

  • protel99se元件名系表

    protel99se元件名系表

    標簽: protel 99 se 元件

    上傳時間: 2013-10-08

    上傳用戶:liuwei6419

  • pcb layout design(臺灣硬件工程師15年經驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

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