摘 要 在沙丁(Cranz2Schardin)機(jī)基礎(chǔ)上,實(shí)現(xiàn)了反射式動(dòng)態(tài)云紋測(cè)量法.該法可用于不透明模型的動(dòng)態(tài)位移,應(yīng)變及應(yīng)力場(chǎng)的研究.關(guān)鍵詞 反射式,動(dòng)態(tài)云紋法
標(biāo)簽: 反射式 動(dòng)態(tài) 實(shí)驗(yàn)
上傳時(shí)間: 2014-12-31
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緊湊式高速貼片機(jī)XP-142E/XP-143E系統(tǒng)手冊(cè)
標(biāo)簽: XP 142 143 高速貼片機(jī)
上傳時(shí)間: 2014-01-06
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摘要:貼片機(jī)貼裝時(shí)間是影響表面組裝生產(chǎn)線效率的重要因素,文中提出了一種改進(jìn)式分階段啟發(fā)式算法解決具有分飛行換嘴結(jié)構(gòu)的多貼裝頭動(dòng)臂式貼片機(jī)貼裝時(shí)間優(yōu)化問(wèn)題;首先,根據(jù)飛行換嘴的特點(diǎn),提出了適用于飛行換嘴的喂料器組分配方案;其次,依據(jù)這一分配結(jié)果,通過(guò)改進(jìn)式啟發(fā)式算法實(shí)現(xiàn)了喂料器組在喂料器機(jī)構(gòu)上的分配;最后,結(jié)合近鄰搜索法解決了元器件的貼裝順序優(yōu)化問(wèn)題;仿真結(jié)果證明,文中采用的改進(jìn)分階段啟發(fā)式算法比傳統(tǒng)分階段啟發(fā)式算法具有更好的貼裝時(shí)間優(yōu)化效果。關(guān)鍵詞:分階段啟發(fā)式算法;貼片機(jī);飛行換嘴
標(biāo)簽: 貼片機(jī) 分 優(yōu)化算法 啟發(fā)式
上傳時(shí)間: 2013-10-22
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XP-142E是實(shí)現(xiàn)調(diào)整貼裝以及緊湊式機(jī)器空間的全影像方式的貼片機(jī),是可以對(duì)應(yīng)用小型芯片元件~中型元件為止的調(diào)整貼片機(jī).
標(biāo)簽: 142 XP 高速貼片機(jī) 規(guī)格
上傳時(shí)間: 2013-11-05
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4種感應(yīng)式測(cè)電筆的電路工作原理、電路圖及有關(guān)說(shuō)明。
標(biāo)簽: 感應(yīng)式測(cè)電筆
上傳時(shí)間: 2013-10-19
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4種感應(yīng)式測(cè)電筆的電路工作原理、電路圖及有關(guān)說(shuō)明。
標(biāo)簽: 感應(yīng)式測(cè)電筆
上傳時(shí)間: 2013-10-11
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PCI Express 協(xié)議由于其高速串行、系統(tǒng)拓?fù)浜?jiǎn)單等特點(diǎn)被廣泛用于各種領(lǐng)域。Altera公司的Arria II GX FPGA內(nèi)集成了支持鏈?zhǔn)紻MA傳輸功能的PCI Express硬核,適應(yīng)了PCI Express總線高速度的要求。文中利用Jungo公司的WinDriver軟件實(shí)現(xiàn)了鏈?zhǔn)紻MA的上層應(yīng)用設(shè)計(jì)。首先給出了鏈?zhǔn)紻MA實(shí)現(xiàn)的基本過(guò)程,接著分析了鏈?zhǔn)紻MA數(shù)據(jù)傳輸需要處理的幾個(gè)問(wèn)題,給出了相應(yīng)的解決辦法和策略。采用這些方法,保證了DAM數(shù)據(jù)傳輸?shù)恼_性,簡(jiǎn)化了底層FPGA應(yīng)用邏輯的設(shè)計(jì)。
標(biāo)簽: WinDriver DMA 上傳時(shí)間: 2014-12-22
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數(shù)顯式測(cè)量電路pcb簡(jiǎn)圖
標(biāo)簽: PCB 數(shù)顯式 測(cè)量電路
上傳時(shí)間: 2013-11-03
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WP369可擴(kuò)展式處理平臺(tái)-各種嵌入式系統(tǒng)的理想解決方案 :Delivering unrivaled levels of system performance,flexibility, scalability, and integration to developers,Xilinx's architecture for a new Extensible Processing Platform is optimized for system power, cost, and size. Based on ARM's dual-core Cortex™-A9 MPCore processors and Xilinx’s 28 nm programmable logic,the Extensible Processing Platform takes a processor-centric approach by defining a comprehensive processor system implemented with standard design methods. This approach provides Software Developers a familiar programming environment within an optimized, full featured,powerful, yet low-cost, low-power processing platform.
標(biāo)簽: 369 WP 擴(kuò)展式 處理平臺(tái)
上傳時(shí)間: 2013-10-18
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賽靈思的新型可擴(kuò)展式處理平臺(tái)架構(gòu)可為開(kāi)發(fā)人員提供無(wú)與倫比的系統(tǒng)性能、靈活性、可擴(kuò)展性和集成度,并為降低系統(tǒng)功耗、成本和縮小尺寸進(jìn)行了精心優(yōu)化。 可擴(kuò)展式處理平臺(tái)基于 ARM 的雙核 Cortex™-A9MPCore 處理器以及賽靈思的 28nm 可編程邏輯之上,采用以處理器為核心的設(shè)計(jì)方案,并能定義通過(guò)標(biāo)準(zhǔn)設(shè)計(jì)方法實(shí)施的綜合處理器系統(tǒng)。這種方案可為軟件開(kāi)發(fā)人員在功能齊備且強(qiáng)大的優(yōu)化型低成本低功耗處理平臺(tái)上提供熟悉的編程環(huán)境。
標(biāo)簽: 369 WP 擴(kuò)展式 處理平臺(tái)
上傳時(shí)間: 2013-11-02
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