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信號發(fā)生

  • 雷達信號預(yù)處理算法的研究

    在VTS(Vessel Tramc Services船舶交管系統(tǒng))系統(tǒng)中,雷達信號的處理器的能力己成為制約雷達目標(biāo)錄取、跟蹤處理能力和可靠性以及整個VTS系統(tǒng)工作的主要因素。隨著區(qū)域性VTS的建立,要求將雷達信號以最高的質(zhì)量和最低的代價遠距離傳輸,而達到這一要求的關(guān)鍵技術(shù)環(huán)節(jié)一雷達信息的壓縮處理也將受到雷達信號預(yù)處理系統(tǒng)的影響。 因此,研究更有效的VTS雷達信號預(yù)處理系統(tǒng)是一項很有價值和實際意義的工作。本文是在前人研究成果的基礎(chǔ)上,面向?qū)嶋H應(yīng)用的需求,主要研究VTS雷達信號預(yù)處理算法的設(shè)計方法和實現(xiàn)手段,設(shè)計完成了一個數(shù)字化的雷達原始信號實時采集與處理系統(tǒng)。 本設(shè)計主要包括雷達信號的采集、雜波抑制處理以及與DSP芯片的信號傳輸。在硬件結(jié)構(gòu)上,本設(shè)計采用FPGA完成信號的采集、CFAR處理和雷達信號檢測器的設(shè)計,將大量的以前需要由DSP芯片來完成的算法移植到FPGA中實現(xiàn),大大減輕了DSP芯片的工作壓力,也減小了系統(tǒng)的體積。 在算法研究中,設(shè)計中重點討論了雜波的抑制方法和目標(biāo)的檢測方法。本文在研究了大量現(xiàn)有的雷達信號雜波抑制及信號檢測的算法的基礎(chǔ)上,比較了各種算法的優(yōu)劣,最終選擇了一種適合本次設(shè)計要求的CFAR算法和雙極點濾波雷達信號檢測器在FPGA中實現(xiàn)。 論文中對設(shè)計中所采用的方法給出了理論分析、試驗仿真結(jié)果和試驗實際調(diào)試結(jié)果。通過本文所述的設(shè)計和實驗,本文設(shè)計的雷達信號預(yù)處理系統(tǒng)對雷達視頻信號的采集與傳輸都有很好的效果,所選用的雜波處理算法對雷達雜波、雨雪雜波和陸地回波都具有較好的抑制作用,能有效地處理雷達雜波中的尖峰成分,使信噪比得到較大改善。

    標(biāo)簽: 雷達信號 法的研究 預(yù)處理

    上傳時間: 2013-04-24

    上傳用戶:pei5

  • 基于FPGA的數(shù)字視頻信號發(fā)生

    隨著數(shù)字技術(shù)的高速發(fā)展,越來越多的針對數(shù)字視頻壓縮、傳送、顯示等的設(shè)備涌入市場。要從這些良莠不齊的產(chǎn)品中挑選出令人滿意的商品,一套良好的數(shù)字視頻測試設(shè)備就必不可少。然而,現(xiàn)階段大多數(shù)數(shù)字視頻信號源都存在不同的缺點,如測試圖像種類太少、沒有動態(tài)測試源、缺乏專用測試信號等。為有效克服這些缺陷,作者設(shè)計并開發(fā)了一套基于FPGA的數(shù)字視頻信號發(fā)生器。整個系統(tǒng)包括硬件平臺和圖像格式轉(zhuǎn)換軟件兩大部分。硬件平臺本身即為獨立的信號發(fā)生器,可以生成多種測試圖像。配備了圖像格式轉(zhuǎn)換軟件,就可以實現(xiàn)硬件平臺從PC機接收各種靜態(tài)測試圖像、動態(tài)測試序列,不斷更新測試圖像庫。整個系統(tǒng)具有良好的硬件體系結(jié)構(gòu)、便捷的輸入接口,穩(wěn)定的信號輸出,同時操作靈活、方便,易于升級更新。 在系統(tǒng)的開發(fā)過程中,使用了多種硬件、軟件開發(fā)工具,如PROTEL DXP、ISE、MODEL SIM、MATLAB、C#.NET等。由于軟硬件調(diào)試均由同一人完成,因此整個系統(tǒng)具備良好的統(tǒng)一性和兼容性。 另外,作者還研究并設(shè)計了一種針對H.264編解碼器壓縮損傷的測試信號。評估一個編碼器的性能可采用主觀評價或客觀評價兩種方法。其中主觀評價最為直接、有效。本文在依托主觀評價方法的基礎(chǔ)上,結(jié)合客觀參數(shù)的指導(dǎo)性,研究并設(shè)計一種通過人眼就可以方便的觀測到實際存在的壓縮損傷的測試信號,以達到直接對編解碼器性能進行比較的目的。

    標(biāo)簽: FPGA 數(shù)字視頻 信號發(fā)生

    上傳時間: 2013-07-19

    上傳用戶:cxl274287265

  • 基于FPGA的液晶顯示控制系統(tǒng)

    本文對基于FPGA的液晶顯示控制系統(tǒng)的設(shè)計與實現(xiàn)進行了研究。設(shè)計中從LCD技術(shù)參數(shù)著手,通過對顯示驅(qū)動系統(tǒng)結(jié)構(gòu)與工作原理的研究,設(shè)計出顯示控制系統(tǒng)的框圖及各功能模塊的VHDL程序,通過單片機系統(tǒng)配置FPGA芯片,控制LCD顯示相應(yīng)的漢字和圖形。LCD顯示控制系統(tǒng)由顯示控制電路、顯示驅(qū)動電路和相關(guān)外圍輔助電路組成。顯示控制電路從電路中各個功能模塊所需要的控制時序信號出發(fā),通過對其工作過程的研究,設(shè)計出控制器、RAM控制器等各功能模塊。顯示驅(qū)動電路從LCD工作所需要的掃描時序信號出發(fā),設(shè)計出時序發(fā)生電路等各功能模塊。所有的VHDL程序通過了MAX+PLUS—II軟件實現(xiàn)編譯及仿真后,在實際的硬件中調(diào)試通過。

    標(biāo)簽: FPGA 液晶顯示 控制系統(tǒng)

    上傳時間: 2013-05-24

    上傳用戶:portantal

  • 基于FPGA實現(xiàn)雷達信號處理和圖像顯示

    在船舶交管系統(tǒng)中,雷達信息處理是最重要的組成部分。視頻回波處理中的雜波處理要求實時性很高,大約要在一個距離單元的時間(0.05-0.1us)內(nèi)完成。雜波處理如恒虛警處理本身比較復(fù)雜,這類處理過程又要求快速,圖像顯示系統(tǒng)要求及時的把接收到的雷達方位數(shù)據(jù)從極坐標(biāo)轉(zhuǎn)換成直角坐標(biāo)。在軟件上實現(xiàn)這些算法雖然精度可以達到,但是實時性問題不能滿足。因此這類問題多采用高速專用數(shù)字設(shè)備來實現(xiàn)。FPGA在數(shù)字信號處理領(lǐng)域有非常廣闊的應(yīng)用前景,以其優(yōu)良的性能在數(shù)字信號處理中發(fā)揮了重大的作用。CORDIC算法可以在硬件上以很高的精度實現(xiàn)一些函數(shù)和運算。針對以上幾點,本文提出了利用CORDIC算法,基于FPGA來實現(xiàn)雷達信號處理和圖像顯示的算法研究,用硬件來實現(xiàn)正弦、余弦、正切、乘法、除法、指數(shù)和對數(shù)等基本函數(shù)和運算,把他們設(shè)計成為可重用的IP core,這樣可以滿足實時性和精度的問題。從而在將來的算法研究中方便的調(diào)用,這樣在算法研究中可以節(jié)約大量的時間,在一定程度上降低研究的難度。 圍繞雷達信號處理和圖像顯示,本次課題設(shè)計主要做了如下工作: 1.對CORDIC算法進行分析和研究,以及它在雷達信號處理和圖像顯示中的影響。 2.成功用硬件描述語言在Xilinx公司軟件ISE的環(huán)境下編寫代碼,在Synplify和Modelsim上做了綜合和仿真。 3.對實驗結(jié)果進行精度和速度分析。 4.對雷達信號處理和圖像顯示的相關(guān)算法進行分析和研究。 5.從實例分析IP core的特點,對算法研究的影響和IP core在雷達信號處理和圖像顯示中的應(yīng)用。 最終在實踐環(huán)節(jié),成功利用CORDIC算法,在FPGA上實現(xiàn)可重用的IP core,這些IP core能夠以很高的精度實現(xiàn)一些基本函數(shù)和運算,在雷達信號處理與圖像顯示中起到很大的作用。

    標(biāo)簽: FPGA 雷達信號處理 圖像顯示

    上傳時間: 2013-07-16

    上傳用戶:steele

  • 跳頻信號檢測與接收系統(tǒng)

    擴展頻譜通信技術(shù),它的突出優(yōu)點是保密性好,抗干擾性強.隨著通信系統(tǒng)與現(xiàn)代計算機軟、硬件技術(shù)與微電子技術(shù)發(fā)展,越來越多的通信系統(tǒng)構(gòu)建于這種技術(shù)之上.在實際擴頻通信系統(tǒng)工程中,用得比較普遍的是直擴方式和跳頻方式,它們的不同在于直擴是采取隱藏的方式對抗干擾,而跳頻采取躲避的方式. 西方國家早在20世紀50年代就開始對跳頻通信進行研究,在上個世紀末的幾次局部戰(zhàn)爭中,跳頻電臺得到了普遍的應(yīng)用.跳頻通信的發(fā)展促進了其對抗技術(shù)的發(fā)展,目前,世界主要幾個軍事先進的國家,已經(jīng)研究出高性能的跳頻通信對抗設(shè)備,國內(nèi)這方面的發(fā)展相對國外差距比較大. 未來戰(zhàn)爭是科學(xué)技術(shù)的斗爭,研究跳頻通信對抗勢在必行.基于這種目的,本文研究和設(shè)計了跳頻檢測的FPGA實現(xiàn),利用基于時頻分析的處理方法,完成了跳頻信號檢測的FPGA實現(xiàn),通過測試,表明系統(tǒng)達到了設(shè)計要求,可以滿足實際的需要.主要內(nèi)容包括: 1.概述了跳頻檢測接收研究的發(fā)展動態(tài),闡述了擴展頻譜通信及短時傅立葉變換的原理. 2.分析了基于快速傅立葉變換(FFT)處理跳頻信號,檢測跳頻的可行性,利用FFT檢測頻譜的原理,合理使用頻譜采樣策略,做到了增加頻譜利用率,提高了檢測概率和分析信噪比;利用抽取內(nèi)插技術(shù)完成數(shù)據(jù)速率的轉(zhuǎn)換,使其滿足后續(xù)信號的處理要求;利用同相和正交的DDC實現(xiàn)結(jié)構(gòu),完成對跳頻信號的解跳. 3.設(shè)計完成了跳頻信號檢測與接收系統(tǒng)的FPGA實現(xiàn),其主要包括:數(shù)據(jù)速率變換的實現(xiàn),FIR低通濾波器的實現(xiàn),快速傅立葉變換(FFT)的實現(xiàn),下變頻的實現(xiàn)等.在濾波器的實現(xiàn)中,提出了兩種設(shè)計方法:基于常系數(shù)乘法器和分布式算法濾波器,分析了上述兩種方法的優(yōu)缺點,選擇用分布式算法實現(xiàn)設(shè)計中的低通濾波器;在快速傅立葉變換實現(xiàn)中,分析了基2和基4的算法結(jié)構(gòu),并分別實現(xiàn)了基2和基4的算法,滿足了不同場合對處理器的要求.在下變頻的設(shè)計中,使用濾波器的多相結(jié)構(gòu)完成抽取的實現(xiàn),并使用低通濾波器使信號帶寬滿足指標(biāo)的要求.此外,設(shè)計中還包括雙端口RAM的實現(xiàn),比較模塊的實現(xiàn)、數(shù)據(jù)緩存模塊和串并轉(zhuǎn)換模塊的實現(xiàn). 4.介紹了實現(xiàn)系統(tǒng)的硬件平臺.

    標(biāo)簽: 跳頻信號 檢測 接收系統(tǒng)

    上傳時間: 2013-04-24

    上傳用戶:zttztt2005

  • 線性調(diào)頻信號的脈沖壓縮系統(tǒng)

    本文完成了一種高速高性能數(shù)字脈沖壓縮處理器的設(shè)計和FPGA實現(xiàn),包括系統(tǒng)架構(gòu)設(shè)計、方案論證及仿真、算法實現(xiàn)、結(jié)果的測試等。 緒論部分首先闡明了本課題研究的背景和意義,概述了雷達數(shù)字脈沖壓縮系統(tǒng)的主要研究內(nèi)容,關(guān)鍵技術(shù)及其發(fā)展趨勢,然后介紹了數(shù)字脈沖壓縮系統(tǒng)設(shè)計與實現(xiàn)的要求,最后給出了本文的主要研究內(nèi)容。 第二章敘述了線性調(diào)頻信號脈沖壓縮的基本原理,對系統(tǒng)設(shè)計的實現(xiàn)方法進行了實時性方面的論證,并基于MATLAB做了仿真分析。 第三章從數(shù)字系統(tǒng)結(jié)構(gòu)化設(shè)計方面將本系統(tǒng)劃分為三個部分:輸入部分、脈壓計算部分、輸出部分,并在流程圖中對各部分所要實現(xiàn)的功能做了介紹。 第四章首先總結(jié)了數(shù)字脈沖壓縮的實現(xiàn)途徑;提出了基于自定制浮點數(shù)據(jù)格式和分時復(fù)用蝶型結(jié)構(gòu)的數(shù)字脈沖壓縮系統(tǒng)設(shè)計思想,對其關(guān)鍵技術(shù)進行了深入的研究。 第五章對輸入輸出模塊的功能做了詳細的描述,設(shè)計了具體的結(jié)構(gòu)和電路。 第六章針對系統(tǒng)的測試驗證,提出面向SOC的模塊驗證和系統(tǒng)軟硬協(xié)同驗證的驗證策略。通過Link for Modelsim工具,實現(xiàn)MATAB與Modelsim之間對VHDL代碼的聯(lián)合仿真測試,通過在線邏輯分析工具ChipScope,完成系統(tǒng)的片上測試,并分析系統(tǒng)的性能,證明系統(tǒng)的可實用性。滿足設(shè)計的要求。 本文研制的數(shù)字脈沖壓縮處理器具有動態(tài)范圍大、處理精度高、處理能力強、體積小、重量輕、實時性好的優(yōu)點,為設(shè)計高性能的現(xiàn)代雷達信號處理系統(tǒng)提供了可靠的保證。

    標(biāo)簽: 線性調(diào)頻信號 脈沖壓縮

    上傳時間: 2013-07-01

    上傳用戶:lingduhanya

  • GPS信號CA碼跟蹤的FPGA實現(xiàn)

    GPS全球定位系統(tǒng)是美國國防部為軍事目的而建立的衛(wèi)星導(dǎo)航系統(tǒng),其主要目的是解決海上、陸地和空中運載工具的導(dǎo)航定位問題。GPS作為新一代衛(wèi)星導(dǎo)航系統(tǒng),不僅具有全球、全天候、連續(xù)、高精度導(dǎo)航與定位能力,而且具有優(yōu)良的抗干擾性和保密性。因此,發(fā)展全球定位系統(tǒng)是當(dāng)今導(dǎo)航技術(shù)現(xiàn)代化的一個重要標(biāo)志。在GPS接收機中,為了得到導(dǎo)航電文并對其進行解算,要完成復(fù)雜的信號處理過程。其中,怎樣捕獲到衛(wèi)星信號,并對C/A碼進行跟蹤是研制GPS接收機的重要問題之一。本文在對GPS信號的結(jié)構(gòu)進行深入的分析后,結(jié)合FPGA的特點,對算法進行設(shè)計及優(yōu)化后,給出了相應(yīng)的仿真。內(nèi)容主要包括以下幾個方面: 1.對GPS信號結(jié)構(gòu)的產(chǎn)生原理進行了深入地分析,并對GPS信號的調(diào)制機理進行詳細地闡述。 2.在GPS信號的捕獲方面,采用了基于FFT頻域的快速捕獲的方法,即將接收到的GPS信號先利用快速傅立葉變換(FFT)變換到頻域,在頻域完成相應(yīng)的運算后,再利用傅立葉反變換(IFFT)變換到時域。從而大大減少了計算量,加快了信號捕獲的速度,提高了捕獲性能。 3.在C/A碼跟蹤部分,本文采用了非相干延遲鎖定環(huán)對C/A碼進行跟蹤。來自載波跟蹤環(huán)路的本地載波將輸入的信號變成基帶信號,然后分別和本地碼的三個不同相位序列進行相乘,將相乘結(jié)果進行累加,經(jīng)過處理將得到碼相位和當(dāng)前的載波頻率送到載波跟蹤環(huán)路。 4.載波跟蹤環(huán),本文采用的是科斯塔斯環(huán)。載波跟蹤環(huán)和碼跟蹤環(huán)在結(jié)構(gòu)上相似,故本文只對關(guān)鍵的載波NCO進行了仿真。 本文的創(chuàng)新點主要是使用FPGA對整個GPS信號的捕獲及C/A碼的跟蹤進行設(shè)計。此外,根據(jù)FPGA的特點,在不改變外部硬件設(shè)計的前提下,改變相應(yīng)的IP核或相關(guān)的VHDL程序就可對系統(tǒng)進行各種優(yōu)化設(shè)計,以適應(yīng)不同類型的GPS接收機的不同功能。

    標(biāo)簽: FPGA GPS 信號

    上傳時間: 2013-06-27

    上傳用戶:哇哇哇哇哇

  • Morlet小波分析的BOTDR信號處理

    基于布里淵散射的分布式光纖傳感器是當(dāng)前國內(nèi)外研究的熱點。本文介紹了基于布里淵散射的分布式光纖傳感器的的原理、應(yīng)用;布里淵時域反射技術(shù)(BOTDR)和布里淵時域分析技術(shù)(BOTDA)的原理。 受激布里淵散射(SBS)的過程中,入射光和散射光滿足耦合振幅方程組。我們對該方程組采用有限差分法進行數(shù)值計算,并用Matlab模擬計算過程,對布里淵散射信號進行分析。 根據(jù)布里淵散射信號的特點,我們采用基于Morlet小波變換的DSP信號算法來處理 BOTDR傳感信號。通過對該算法的核心單元——快速傅立葉變換(FFT)的硬件實現(xiàn),我們在Stratix FPGA上實現(xiàn)了基于Morlet小波變換的DSP算法的硬件電路設(shè)計。 最后,在此基礎(chǔ)上,我們對電路功能進行實際的仿真和驗證,并和Matlab得到結(jié)果進行比較和分析。

    標(biāo)簽: Morlet BOTDR 小波分析 信號處理

    上傳時間: 2013-07-22

    上傳用戶:牛布牛

  • DDS 短波信號發(fā)生

    基于AD9851的DDS短波信號發(fā)生器,詳細論述AD9851的使用,在做高頻信號源時很值得參考。

    標(biāo)簽: DDS 短波信號 發(fā)生器

    上傳時間: 2013-05-26

    上傳用戶:qweqweqwe

  • 海事衛(wèi)星突發(fā)信號位同步檢測

    碼元定時恢復(fù)(位同步)技術(shù)是數(shù)字通信中的關(guān)鍵技術(shù)。位同步信號本身的抖動、錯位會直接降低通信設(shè)備的抗干擾性能,使誤碼率上升,甚至?xí)箓鬏斣獾酵耆茐摹S绕鋵τ谕话l(fā)傳輸系統(tǒng),快速、精確的定時同步算法是近年來研究的一個焦點。本文就是以Inmarsat GES/AES數(shù)據(jù)接收系統(tǒng)為背景,研究了突發(fā)通信傳輸模式下的全數(shù)字接收機中位同步方法,并予以實現(xiàn)。 本文系統(tǒng)地論述了位同步原理,在此基礎(chǔ)上著重研究了位同步的系統(tǒng)結(jié)構(gòu)、碼元定時恢復(fù)算法以及衡量系統(tǒng)性能的各項指標(biāo),為后續(xù)工作奠定了基礎(chǔ)。 首先根據(jù)衛(wèi)星系統(tǒng)突發(fā)信道傳輸?shù)奶攸c分析了傳統(tǒng)位同步方法在突發(fā)系統(tǒng)中的不足,接下來對Inmarsat系統(tǒng)的短突發(fā)R信道和長突發(fā)T信道的調(diào)制方式和幀結(jié)構(gòu)做了細致的分析,并在Agilent ADS中進行了仿真。 在此基礎(chǔ)上提出了一種充分利用報頭前導(dǎo)比特信息的,由滑動平均、閾值判斷和累加求極值組成的快速報頭時鐘捕獲方法,此方法可快速精準(zhǔn)地完成短突發(fā)形式下的位同步,并在FPGA上予以實現(xiàn),效果良好。 在長突發(fā)形式下的報頭時鐘捕獲后還需要對后續(xù)數(shù)據(jù)進行位同步跟蹤,在跟蹤過程中本論文首先用DSP Builder實現(xiàn)了插值環(huán)路的位同步算法,進行了Matlab仿真和FPGA實現(xiàn)。并在插值環(huán)路的基礎(chǔ)上做出改進,提出了一種新的高效的基于移位算法的位同步方案并予以FPGA實現(xiàn)。最后將移位算法與插值算法進行了性能比較,證明該算法更適合于本項目中Inmarsat的長突發(fā)信道位同步跟蹤。 論文對兩個突發(fā)信道的位同步系統(tǒng)進行了理論研究、算法設(shè)計以及硬件實現(xiàn)的全過程,滿足系統(tǒng)要求。

    標(biāo)簽: 海事衛(wèi)星 信號 位同步 檢測

    上傳時間: 2013-04-24

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