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位同步

位同步是指在數(shù)據(jù)通信系統(tǒng)中,數(shù)據(jù)信號(hào)是以碼元形式逐個(gè)地發(fā)送和接收的,這要求發(fā)、收雙方的時(shí)鐘要有一個(gè)穩(wěn)定而可靠的同步關(guān)系。另外,無論是基帶傳輸還是頻帶傳輸,接收端收到的信號(hào)都可能存在一定程度的畸變和干擾。為此,接收端就必須有一個(gè)與發(fā)送端碼元定時(shí)脈沖頻率相同、相位與最佳取樣時(shí)刻一致的碼元定時(shí)脈沖序列的過程,也稱為碼元同步。對(duì)位同步的基本要求以及它的實(shí)現(xiàn)方法,與載波同步相類似。為了獲取碼元定時(shí)信號(hào),必須先確定接收到的基帶信號(hào)中是否存在位定時(shí)的頻率分量。如果存在此頻率分量,就可用濾波器直接從中把位定時(shí)信息提取出來。而對(duì)某些本身不包含位定時(shí)信息的基帶信號(hào)(如隨機(jī)的二進(jìn)制不歸零碼),則有必要在基帶信號(hào)中插入位同步的導(dǎo)頻信號(hào),或者對(duì)該基帶信號(hào)進(jìn)行某種碼型變換,以達(dá)到獲取位定時(shí)信息的目的。[1]
  • 基于FPGA的海事衛(wèi)星突發(fā)信號(hào)位同步檢測研究及實(shí)現(xiàn).rar

    碼元定時(shí)恢復(fù)(位同步)技術(shù)是數(shù)字通信中的關(guān)鍵技術(shù)。位同步信號(hào)本身的抖動(dòng)、錯(cuò)位會(huì)直接降低通信設(shè)備的抗干擾性能,使誤碼率上升,甚至?xí)箓鬏斣獾酵耆茐摹S绕鋵?duì)于突發(fā)傳輸系統(tǒng),快速、精確的定時(shí)同步算法是近年來研究的一個(gè)焦點(diǎn)。本文就是以Inmarsat GES/AES數(shù)據(jù)接收系統(tǒng)為背景,研究了突發(fā)通信傳輸模式下的全數(shù)字接收機(jī)中位同步方法,并予以實(shí)現(xiàn)。 本文系統(tǒng)地論述了位同步原理,在此基礎(chǔ)上著重研究了位同步的系統(tǒng)結(jié)構(gòu)、碼元定時(shí)恢復(fù)算法以及衡量系統(tǒng)性能的各項(xiàng)指標(biāo),為后續(xù)工作奠定了基礎(chǔ)。 首先根據(jù)衛(wèi)星系統(tǒng)突發(fā)信道傳輸?shù)奶攸c(diǎn)分析了傳統(tǒng)位同步方法在突發(fā)系統(tǒng)中的不足,接下來對(duì)Inmarsat系統(tǒng)的短突發(fā)R信道和長突發(fā)T信道的調(diào)制方式和幀結(jié)構(gòu)做了細(xì)致的分析,并在Agilent ADS中進(jìn)行了仿真。 在此基礎(chǔ)上提出了一種充分利用報(bào)頭前導(dǎo)比特信息的,由滑動(dòng)平均、閾值判斷和累加求極值組成的快速報(bào)頭時(shí)鐘捕獲方法,此方法可快速精準(zhǔn)地完成短突發(fā)形式下的位同步,并在FPGA上予以實(shí)現(xiàn),效果良好。 在長突發(fā)形式下的報(bào)頭時(shí)鐘捕獲后還需要對(duì)后續(xù)數(shù)據(jù)進(jìn)行位同步跟蹤,在跟蹤過程中本論文首先用DSP Builder實(shí)現(xiàn)了插值環(huán)路的位同步算法,進(jìn)行了Matlab仿真和FPGA實(shí)現(xiàn)。并在插值環(huán)路的基礎(chǔ)上做出改進(jìn),提出了一種新的高效的基于移位算法的位同步方案并予以FPGA實(shí)現(xiàn)。最后將移位算法與插值算法進(jìn)行了性能比較,證明該算法更適合于本項(xiàng)目中Inmarsat的長突發(fā)信道位同步跟蹤。 論文對(duì)兩個(gè)突發(fā)信道的位同步系統(tǒng)進(jìn)行了理論研究、算法設(shè)計(jì)以及硬件實(shí)現(xiàn)的全過程,滿足系統(tǒng)要求。

    標(biāo)簽: FPGA 海事衛(wèi)星 信號(hào)

    上傳時(shí)間: 2013-04-24

    上傳用戶:yare

  • 海事衛(wèi)星突發(fā)信號(hào)位同步檢測

    碼元定時(shí)恢復(fù)(位同步)技術(shù)是數(shù)字通信中的關(guān)鍵技術(shù)。位同步信號(hào)本身的抖動(dòng)、錯(cuò)位會(huì)直接降低通信設(shè)備的抗干擾性能,使誤碼率上升,甚至?xí)箓鬏斣獾酵耆茐摹S绕鋵?duì)于突發(fā)傳輸系統(tǒng),快速、精確的定時(shí)同步算法是近年來研究的一個(gè)焦點(diǎn)。本文就是以Inmarsat GES/AES數(shù)據(jù)接收系統(tǒng)為背景,研究了突發(fā)通信傳輸模式下的全數(shù)字接收機(jī)中位同步方法,并予以實(shí)現(xiàn)。 本文系統(tǒng)地論述了位同步原理,在此基礎(chǔ)上著重研究了位同步的系統(tǒng)結(jié)構(gòu)、碼元定時(shí)恢復(fù)算法以及衡量系統(tǒng)性能的各項(xiàng)指標(biāo),為后續(xù)工作奠定了基礎(chǔ)。 首先根據(jù)衛(wèi)星系統(tǒng)突發(fā)信道傳輸?shù)奶攸c(diǎn)分析了傳統(tǒng)位同步方法在突發(fā)系統(tǒng)中的不足,接下來對(duì)Inmarsat系統(tǒng)的短突發(fā)R信道和長突發(fā)T信道的調(diào)制方式和幀結(jié)構(gòu)做了細(xì)致的分析,并在Agilent ADS中進(jìn)行了仿真。 在此基礎(chǔ)上提出了一種充分利用報(bào)頭前導(dǎo)比特信息的,由滑動(dòng)平均、閾值判斷和累加求極值組成的快速報(bào)頭時(shí)鐘捕獲方法,此方法可快速精準(zhǔn)地完成短突發(fā)形式下的位同步,并在FPGA上予以實(shí)現(xiàn),效果良好。 在長突發(fā)形式下的報(bào)頭時(shí)鐘捕獲后還需要對(duì)后續(xù)數(shù)據(jù)進(jìn)行位同步跟蹤,在跟蹤過程中本論文首先用DSP Builder實(shí)現(xiàn)了插值環(huán)路的位同步算法,進(jìn)行了Matlab仿真和FPGA實(shí)現(xiàn)。并在插值環(huán)路的基礎(chǔ)上做出改進(jìn),提出了一種新的高效的基于移位算法的位同步方案并予以FPGA實(shí)現(xiàn)。最后將移位算法與插值算法進(jìn)行了性能比較,證明該算法更適合于本項(xiàng)目中Inmarsat的長突發(fā)信道位同步跟蹤。 論文對(duì)兩個(gè)突發(fā)信道的位同步系統(tǒng)進(jìn)行了理論研究、算法設(shè)計(jì)以及硬件實(shí)現(xiàn)的全過程,滿足系統(tǒng)要求。

    標(biāo)簽: 海事衛(wèi)星 信號(hào) 位同步 檢測

    上傳時(shí)間: 2013-04-24

    上傳用戶:zukfu

  • 基于FPGA的新型數(shù)據(jù)位同步時(shí)鐘提取(CDR)實(shí)現(xiàn)方法

    基于FPGA的新型數(shù)據(jù)位同步時(shí)鐘提取(CDR)實(shí)現(xiàn)方法

    標(biāo)簽: FPGA CDR 數(shù)據(jù) 位同步時(shí)鐘

    上傳時(shí)間: 2013-08-28

    上傳用戶:huyahui

  • 一種可變位速率的位同步器的設(shè)計(jì)與仿真

    大部分傳統(tǒng)的位同步器是針對(duì)固定位速率遙測系統(tǒng)來設(shè)計(jì)的,這不能滿足一些可變位速率遙測接收機(jī)的需求。因此,提出一種基于FPGA實(shí)現(xiàn)的位同步器的設(shè)計(jì),它能適應(yīng)不同位速率的遙測系統(tǒng)。同時(shí),對(duì)這種位同步器的實(shí)現(xiàn)進(jìn)行了仿真,驗(yàn)證其正確性和可實(shí)現(xiàn)性。

    標(biāo)簽: 速率 位同步 仿真

    上傳時(shí)間: 2013-11-01

    上傳用戶:qb1993225

  • 通信中位同步的gardner算法的matlab仿真

    通信中位同步的gardner算法的matlab仿真

    標(biāo)簽: gardner matlab 通信 位同步

    上傳時(shí)間: 2015-11-03

    上傳用戶:zhichenglu

  • 位同步gardner 算法的simulink仿真

    位同步gardner 算法的simulink仿真

    標(biāo)簽: simulink gardner 位同步 仿真

    上傳時(shí)間: 2014-01-25

    上傳用戶:咔樂塢

  • 基于FPGA的新型數(shù)據(jù)位同步時(shí)鐘提取(CDR)實(shí)現(xiàn)方法

    基于FPGA的新型數(shù)據(jù)位同步時(shí)鐘提取(CDR)實(shí)現(xiàn)方法

    標(biāo)簽: FPGA CDR 數(shù)據(jù) 位同步時(shí)鐘

    上傳時(shí)間: 2013-12-22

    上傳用戶:天涯

  • I0口驅(qū)動(dòng)74LS164,8位同步移位寄存器

    I0口驅(qū)動(dòng)74LS164,8位同步移位寄存器,將data_buf的數(shù)據(jù)逐位輸出到simuseri_DATA

    標(biāo)簽: 164 74 LS 驅(qū)動(dòng)

    上傳時(shí)間: 2014-01-25

    上傳用戶:yuanyuan123

  • 針對(duì)位同步問題

    針對(duì)位同步問題,提出了一種基于基函數(shù)分解的開環(huán)位定時(shí)估計(jì)算法。該算法首先利用基函數(shù)分解的結(jié)果進(jìn)行相關(guān)運(yùn)算,將本地參考信號(hào)波形和接收信號(hào)波形的定時(shí)偏差縮小到T/4以內(nèi);再根據(jù)相關(guān)運(yùn)算提供的角度信息進(jìn)行精確的位同步估計(jì)。該算法不需要提取載波相位信息,復(fù)雜度較低。仿真結(jié)果表明該算法具有較好的估計(jì)精度

    標(biāo)簽: 位同步

    上傳時(shí)間: 2013-12-13

    上傳用戶:yangbo69

  • 微分器:利用數(shù)字鎖相環(huán)進(jìn)行位同步信號(hào)提取的關(guān)鍵模塊

    微分器:利用數(shù)字鎖相環(huán)進(jìn)行位同步信號(hào)提取的關(guān)鍵模塊

    標(biāo)簽: 微分器 位同步 信號(hào) 數(shù)字鎖相環(huán)

    上傳時(shí)間: 2014-09-10

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