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信號源

產生和發出信號的物體,稱為信號源,即信號的源頭[1]。
  • 數據采集圖解

    常見問題數據采集控制系統的組成?  1、變送器和執行器 2、信號調理器3、數據采集控制硬件4、計算機軟件 選擇數據采集卡要從那幾個方面進行考慮?  1、通道的類型及個數2、差分或單端輸入3、采樣速度4、精度要求 名詞解釋單端輸入方式:各路輸入信號共用一個參考電位,即各路輸入信號共地,這是最常用的接線方式。使用單端輸入方式時,地線比較穩定,抗干擾能力較強。 雙端輸入方式:各路輸入信號各自使用自己的參考電位,即各路輸入信號不共地。如果輸入信號來自不同的信號源,而這些信號源的參考電位(地線)略有差異,可考慮使用這種接線方式。 單極性信∶號輸入信號相對于模擬地電位來講,只偏向一側,如輸入電壓為0~10V。雙極性信號∶輸入信號相對于模擬地電位來講,可高可低,如輸入電壓為-5V~+5V。 A/D轉換速率∶表明A/D轉換芯片的工作速度。 初始地址∶使用板卡時,需要對卡上的一組寄存器進行操作,這組寄存器占用數個連續的地址,一般將其中最低的地址值定為此卡的初始地址。

    標簽: 數據采集 圖解

    上傳時間: 2014-01-13

    上傳用戶:sy_jiadeyi

  • 基于軟件無線電思想的GMSK調制設計

    GMSK在無線通信中得到了廣泛的應用,是通信設備半實物仿真器生成的重要信號之一。文中針對仿真器信號源庫的構建,在介紹通用通信設備半實物仿真器組成的基礎上,分析了GMSK調制的設計,利用Matlab軟件仿真了GMSK信號正交分量的生成。提出了一種基于軟件無線電思想,在仿真器通用硬件框架下產生GMSK信號的設計方案。為通信設備半實物仿真器信號源庫的構建提供了參考,也為通信設備的仿真和通信電磁環境的模擬提供了借鑒。

    標簽: GMSK 軟件無線電 調制

    上傳時間: 2013-12-28

    上傳用戶:yt1993410

  • Arduino學習筆記4_Arduino軟件模擬PWM

    注:1.這篇文章斷斷續續寫了很久,畫圖技術也不精,難免錯漏,大家湊合看.有問題可以留言.      2.論壇排版把我的代碼縮進全弄沒了,大家將代碼粘貼到arduino編譯器,然后按ctrl+T重新格式化代碼格式即可看的舒服. 一、什么是PWM PWM 即Pulse Wavelength Modulation 脈寬調制波,通過調整輸出信號占空比,從而達到改 變輸出平均電壓的目的。相信Arduino 的PWM 大家都不陌生,在Arduino Duemilanove 2009 中,有6 個8 位精度PWM 引腳,分別是3, 5, 6, 9, 10, 11 腳。我們可以使用analogWrite()控 制PWM 腳輸出頻率大概在500Hz 的左右的PWM 調制波。分辨率8 位即2 的8 次方等于 256 級精度。但是有時候我們會覺得6 個PWM 引腳不夠用。比如我們做一個10 路燈調光, 就需要有10 個PWM 腳。Arduino Duemilanove 2009 有13 個數字輸出腳,如果它們都可以 PWM 的話,就能滿足條件了。于是本文介紹用軟件模擬PWM。 二、Arduino 軟件模擬PWM Arduino PWM 調壓原理:PWM 有好幾種方法。而Arduino 因為電源和實現難度限制,一般 使用周期恒定,占空比變化的單極性PWM。 通過調整一個周期里面輸出腳高/低電平的時間比(即是占空比)去獲得給一個用電器不同 的平均功率。 如圖所示,假設PWM 波形周期1ms(即1kHz),分辨率1000 級。那么需要一個信號時間 精度1ms/1000=1us 的信號源,即1MHz。所以說,PWM 的實現難點在于需要使用很高頻的 信號源,才能獲得快速與高精度。下面先由一個簡單的PWM 程序開始: const int PWMPin = 13; int bright = 0; void setup() { pinMode(PWMPin, OUTPUT); } void loop() { if((bright++) == 255) bright = 0; for(int i = 0; i < 255; i++) { if(i < bright) { digitalWrite(PWMPin, HIGH); delayMicroseconds(30); } else { digitalWrite(PWMPin, LOW); delayMicroseconds(30); } } } 這是一個軟件PWM 控制Arduino D13 引腳的例子。只需要一塊Arduino 即可測試此代碼。 程序解析:由for 循環可以看出,完成一個PWM 周期,共循環255 次。 假設bright=100 時候,在第0~100 次循環中,i 等于1 到99 均小于bright,于是輸出PWMPin 高電平; 然后第100 到255 次循環里面,i 等于100~255 大于bright,于是輸出PWMPin 低電平。無 論輸出高低電平都保持30us。 那么說,如果bright=100 的話,就有100 次循環是高電平,155 次循環是低電平。 如果忽略指令執行時間的話,這次的PWM 波形占空比為100/255,如果調整bright 的值, 就能改變接在D13 的LED 的亮度。 這里設置了每次for 循環之后,將bright 加一,并且當bright 加到255 時歸0。所以,我們 看到的最終效果就是LED 慢慢變亮,到頂之后然后突然暗回去重新變亮。 這是最基本的PWM 方法,也應該是大家想的比較多的想法。 然后介紹一個簡單一點的。思維風格完全不同。不過對于驅動一個LED 來說,效果與上面 的程序一樣。 const int PWMPin = 13; int bright = 0; void setup() { pinMode(PWMPin, OUTPUT); } void loop() { digitalWrite(PWMPin, HIGH); delayMicroseconds(bright*30); digitalWrite(PWMPin, LOW); delayMicroseconds((255 - bright)*30); if((bright++) == 255) bright = 0; } 可以看出,這段代碼少了一個For 循環。它先輸出一個高電平,然后維持(bright*30)us。然 后輸出一個低電平,維持時間((255-bright)*30)us。這樣兩次高低就能完成一個PWM 周期。 分辨率也是255。 三、多引腳PWM Arduino 本身已有PWM 引腳并且運行起來不占CPU 時間,所以軟件模擬一個引腳的PWM 完全沒有實用意義。我們軟件模擬的價值在于:他能將任意的數字IO 口變成PWM 引腳。 當一片Arduino 要同時控制多個PWM,并且沒有其他重任務的時候,就要用軟件PWM 了。 多引腳PWM 有一種下面的方式: int brights[14] = {0}; //定義14個引腳的初始亮度,可以隨意設置 int StartPWMPin = 0, EndPWMPin = 13; //設置D0~D13為PWM 引腳 int PWMResolution = 255; //設置PWM 占空比分辨率 void setup() { //定義所有IO 端輸出 for(int i = StartPWMPin; i <= EndPWMPin; i++) { pinMode(i, OUTPUT); //隨便定義個初始亮度,便于觀察 brights[ i ] = random(0, 255); } } void loop() { //這for 循環是為14盞燈做漸亮的。每次Arduino loop()循環, //brights 自增一次。直到brights=255時候,將brights 置零重新計數。 for(int i = StartPWMPin; i <= EndPWMPin; i++) { if((brights[i]++) == PWMResolution) brights[i] = 0; } for(int i = 0; i <= PWMResolution; i++) //i 是計數一個PWM 周期 { for(int j = StartPWMPin; j <= EndPWMPin; j++) //每個PWM 周期均遍歷所有引腳 { if(i < brights[j])\   所以我們要更改PWM 周期的話,我們將精度(代碼里面的變量:PWMResolution)降低就行,比如一般調整LED 亮度的話,我們用64 級精度就行。這樣速度就是2x32x64=4ms。就不會閃了。

    標簽: Arduino PWM 軟件模擬

    上傳時間: 2013-10-08

    上傳用戶:dingdingcandy

  • FPGA數字存儲掃頻儀(源代碼+電路圖+PCB圖)

      頻率特征測試儀是用來測量電路傳輸特性和阻抗特性的儀器,簡稱掃頻儀。掃頻信號源是掃頻儀的主要功能部件,作用是產生測量用的正弦掃頻信號,其 掃頻范圍可調,輸出信號幅度等幅。本設計采用DDS(數字頻率合成技術)產生掃頻信號,以Xilinx FPGA為控制核心,通過A/D和D/A等接口電路,實現掃頻信號頻率的步進調整、幅度與相位的測量,創新的使用了計算機軟件作為儀器面板來顯示被測網絡 幅頻特性與相頻特性,并且測試結果可保存到各種存儲介質中。

    標簽: FPGA PCB 數字存儲 掃頻儀

    上傳時間: 2013-11-03

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  • Verilog_HDL的基本語法詳解(夏宇聞版)

            Verilog_HDL的基本語法詳解(夏宇聞版):Verilog HDL是一種用于數字邏輯電路設計的語言。用Verilog HDL描述的電路設計就是該電路的Verilog HDL模型。Verilog HDL既是一種行為描述的語言也是一種結構描述的語言。這也就是說,既可以用電路的功能描述也可以用元器件和它們之間的連接來建立所設計電路的Verilog HDL模型。Verilog模型可以是實際電路的不同級別的抽象。這些抽象的級別和它們對應的模型類型共有以下五種:   系統級(system):用高級語言結構實現設計模塊的外部性能的模型。   算法級(algorithm):用高級語言結構實現設計算法的模型。   RTL級(Register Transfer Level):描述數據在寄存器之間流動和如何處理這些數據的模型。   門級(gate-level):描述邏輯門以及邏輯門之間的連接的模型。   開關級(switch-level):描述器件中三極管和儲存節點以及它們之間連接的模型。   一個復雜電路系統的完整Verilog HDL模型是由若干個Verilog HDL模塊構成的,每一個模塊又可以由若干個子模塊構成。其中有些模塊需要綜合成具體電路,而有些模塊只是與用戶所設計的模塊交互的現存電路或激勵信號源。利用Verilog HDL語言結構所提供的這種功能就可以構造一個模塊間的清晰層次結構來描述極其復雜的大型設計,并對所作設計的邏輯電路進行嚴格的驗證。   Verilog HDL行為描述語言作為一種結構化和過程性的語言,其語法結構非常適合于算法級和RTL級的模型設計。這種行為描述語言具有以下功能:   · 可描述順序執行或并行執行的程序結構。   · 用延遲表達式或事件表達式來明確地控制過程的啟動時間。   · 通過命名的事件來觸發其它過程里的激活行為或停止行為。   · 提供了條件、if-else、case、循環程序結構。   · 提供了可帶參數且非零延續時間的任務(task)程序結構。   · 提供了可定義新的操作符的函數結構(function)。   · 提供了用于建立表達式的算術運算符、邏輯運算符、位運算符。   · Verilog HDL語言作為一種結構化的語言也非常適合于門級和開關級的模型設計。因其結構化的特點又使它具有以下功能:   - 提供了完整的一套組合型原語(primitive);   - 提供了雙向通路和電阻器件的原語;   - 可建立MOS器件的電荷分享和電荷衰減動態模型。   Verilog HDL的構造性語句可以精確地建立信號的模型。這是因為在Verilog HDL中,提供了延遲和輸出強度的原語來建立精確程度很高的信號模型。信號值可以有不同的的強度,可以通過設定寬范圍的模糊值來降低不確定條件的影響。   Verilog HDL作為一種高級的硬件描述編程語言,有著類似C語言的風格。其中有許多語句如:if語句、case語句等和C語言中的對應語句十分相似。如果讀者已經掌握C語言編程的基礎,那么學習Verilog HDL并不困難,我們只要對Verilog HDL某些語句的特殊方面著重理解,并加強上機練習就能很好地掌握它,利用它的強大功能來設計復雜的數字邏輯電路。下面我們將對Verilog HDL中的基本語法逐一加以介紹。

    標簽: Verilog_HDL

    上傳時間: 2014-12-04

    上傳用戶:cppersonal

  • DDS信號源的設計和制作

    。。。

    標簽: DDS 信號源

    上傳時間: 2013-10-26

    上傳用戶:z1191176801

  • 基于FPGA的DDS IP核設計方案

    以Altera公司的Quartus Ⅱ 7.2作為開發工具,研究了基于FPGA的DDS IP核設計,并給出基于Signal Tap II嵌入式邏輯分析儀的仿真測試結果。將設計的DDS IP核封裝成為SOPC Builder自定義的組件,結合32位嵌入式CPU軟核Nios II,構成可編程片上系統(SOPC),利用極少的硬件資源實現了可重構信號源。該系統基本功能都在FPGA芯片內完成,利用 SOPC技術,在一片 FPGA 芯片上實現了整個信號源的硬件開發平臺,達到既簡化電路設計、又提高系統穩定性和可靠性的目的。

    標簽: FPGA DDS IP核 設計方案

    上傳時間: 2013-12-22

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  • pspice使用教程

    第一單 PSPICE使用初步第二章 文本文件描述第三章 電路原理圖程序第四章 模擬計算程序PSPICE及圖形后第五章 信號源模型編輯STMED第六章 模型參數提取PArts第七章 常見問題處理第八章 PSPICE應用。

    標簽: pspice 使用教程

    上傳時間: 2013-10-29

    上傳用戶:libenshu01

  • Pspice教程(基礎篇)

    Pspice教程課程內容:在這個教程中,我們沒有提到關于網絡表中的Pspice 的網絡表文件輸出,有關內容將會在后面提到!而且我想對大家提個建議:就是我們不要只看波形好不好,而是要學會分析,分析不是分析的波形,而是學會分析數據,找出自己設計中出現的問題!有時候大家可能會看到,其實電路并沒有錯,只是有時候我們的仿真設置出了問題,需要修改。有時候是電路的參數設計的不合理,也可能導致一些莫明的錯誤!我覺得大家做一個分析后自己看看OutFile文件!點,就可以看到詳細的情況了!基本的分析內容:1.直流分析2.交流分析3.參數分析4.瞬態分析進階分析內容:1. 最壞情況分析.2. 蒙特卡洛分析3. 溫度分析4. 噪聲分析5. 傅利葉分析6. 靜態直注工作點分析數字電路設計部分淺談附錄A: 關于Simulation Setting的簡介附錄B: 關于測量函數的簡介附錄C:關于信號源的簡介

    標簽: Pspice 教程

    上傳時間: 2013-10-14

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  • 磁芯電感器的諧波失真分析

    磁芯電感器的諧波失真分析 摘  要:簡述了改進鐵氧體軟磁材料比損耗系數和磁滯常數ηB,從而降低總諧波失真THD的歷史過程,分析了諸多因數對諧波測量的影響,提出了磁心性能的調控方向。 關鍵詞:比損耗系數, 磁滯常數ηB ,直流偏置特性DC-Bias,總諧波失真THD  Analysis on THD of the fer rite co res u se d i n i nductancShi Yan Nanjing Finemag Technology Co. Ltd., Nanjing 210033   Abstract:    Histrory of decreasing THD by improving the ratio loss coefficient and hysteresis constant of soft magnetic ferrite is briefly narrated. The effect of many factors which affect the harmonic wave testing is analysed. The way of improving the performance of ferrite cores is put forward.  Key words: ratio loss coefficient,hysteresis constant,DC-Bias,THD  近年來,變壓器生產廠家和軟磁鐵氧體生產廠家,在電感器和變壓器產品的總諧波失真指標控制上,進行了深入的探討和廣泛的合作,逐步弄清了一些似是而非的問題。從工藝技術上采取了不少有效措施,促進了質量問題的迅速解決。本文將就此熱門話題作一些粗淺探討。  一、 歷史回顧 總諧波失真(Total harmonic distortion) ,簡稱THD,并不是什么新的概念,早在幾十年前的載波通信技術中就已有嚴格要求<1>。1978年郵電部公布的標準YD/Z17-78“載波用鐵氧體罐形磁心”中,規定了高μQ材料制作的無中心柱配對罐形磁心詳細的測試電路和方法。如圖一電路所示,利用LC組成的150KHz低通濾波器在高電平輸入的情況下測量磁心產生的非線性失真。這種相對比較的實用方法,專用于無中心柱配對罐形磁心的諧波衰耗測試。 這種磁心主要用于載波電報、電話設備的遙測振蕩器和線路放大器系統,其非線性失真有很嚴格的要求。  圖中  ZD   —— QF867 型阻容式載頻振蕩器,輸出阻抗 150Ω, Ld47 —— 47KHz 低通濾波器,阻抗 150Ω,阻帶衰耗大于61dB,       Lg88 ——并聯高低通濾波器,阻抗 150Ω,三次諧波衰耗大于61dB Ld88 ——并聯高低通濾波器,阻抗 150Ω,三次諧波衰耗大于61dB FD   —— 30~50KHz 放大器, 阻抗 150Ω, 增益不小于 43 dB,三次諧波衰耗b3(0)≥91 dB, DP  —— Qp373 選頻電平表,輸入高阻抗, L ——被測無心罐形磁心及線圈, C  ——聚苯乙烯薄膜電容器CMO-100V-707APF±0.5%,二只。 測量時,所配用線圈應用絲包銅電磁線SQJ9×0.12(JB661-75)在直徑為16.1mm的線架上繞制 120 匝, (線架為一格) , 其空心電感值為 318μH(誤差1%) 被測磁心配對安裝好后,先調節振蕩器頻率為 36.6~40KHz,  使輸出電平值為+17.4 dB, 即選頻表在 22′端子測得的主波電平 (P2)為+17.4 dB,然后在33′端子處測得輸出的三次諧波電平(P3), 則三次諧波衰耗值為:b3(+2)= P2+S+ P3 式中:S 為放大器增益dB 從以往的資料引證, 就可以發現諧波失真的測量是一項很精細的工作,其中測量系統的高、低通濾波器,信號源和放大器本身的三次諧波衰耗控制很嚴,阻抗必須匹配,薄膜電容器的非線性也有相應要求。濾波器的電感全由不帶任何磁介質的大空心線圈繞成,以保證本身的“潔凈” ,不至于造成對磁心分選的誤判。 為了滿足多路通信整機的小型化和穩定性要求, 必須生產低損耗高穩定磁心。上世紀 70 年代初,1409 所和四機部、郵電部各廠,從工藝上改變了推板空氣窯燒結,出窯后經真空罐冷卻的落后方式,改用真空爐,并控制燒結、冷卻氣氛。技術上采用共沉淀法攻關試制出了μQ乘積 60 萬和 100 萬的低損耗高穩定材料,在此基礎上,還實現了高μ7000~10000材料的突破,從而大大縮短了與國外企業的技術差異。當時正處于通信技術由FDM(頻率劃分調制)向PCM(脈沖編碼調制) 轉換時期, 日本人明石雅夫發表了μQ乘積125 萬為 0.8×10 ,100KHz)的超優鐵氧體材料<3>,其磁滯系數降為優鐵

    標簽: 磁芯 電感器 諧波失真

    上傳時間: 2013-12-15

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