FPGA RSIC CPU設計文檔和源碼是EDA中對CPU設計非常好用的程序
標簽： CPU FPGA RSIC EDA
上傳時間： 2013-08-21
上傳用戶：cppersonal
盡管頻率合成技術已經經歷了大半個世紀的發展史，但直到今天，人們對\\r\\n它的研究仍然在繼續。現在，我們可以開發出輸出頻率高達IG的DDS系統，\\r\\n武漢理工大學碩士學位論文\\r\\n已能滿足絕大多數頻率源的要求，集成DDS產品的信噪比也可達到75dB以上，\\r\\n已達到鎖相頻率合成的一般水平。電子技術的發展己進入數字時代，模擬信號\\r\\n數字化的方法也是目前一個熱門研究課題，高速AD、DA器件在通信、廣播電\\r\\n視等領域的應用越來越廣泛。本次設計完成了軟件仿真和硬件實現，對設計原
標簽： FPGA 頻率合成 軟硬件設計
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通過fpga產生時鐘的VHDL源碼，QII7.1下調試通過
標簽： fpga VHDL 時鐘 源碼
上傳時間： 2013-08-24
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真序擴頻通信系統的SYSTEMVIEW信真及其FPGA實現發送端設計
標簽： SYSTEMVIEW FPGA 發送
上傳時間： 2013-08-28
上傳用戶：debuchangshi
ACTEL A3P StartKit FPGA開發全套文擋（含測試源碼）
標簽： StartKit ACTEL FPGA A3P
上傳用戶：litianchu
FPGA數字電子系統設計與開發實例導航光盤內附源碼
標簽： FPGA 數字電子 開發實例 導航
上傳用戶：r5100
基于FPGA＋DDS的MSK數字調制源設計 通信中的DDS技術應用
標簽： FPGA DDS MSK 數字調制
上傳時間： 2013-08-29
本文：采用了FPGA方法來模擬高動態(Global Position System GPS)信號源中的C／A碼產生器。C／A碼在GPS中實現分址、衛星信號粗捕和精碼(P碼)引導捕獲起著重要的作用，通過硬件描述語言VERILOG在ISE中實現電路生成，采用MODELSIM、SYNPLIFY工具分別進行仿真和綜合。
標簽： FPGA GPS 模擬 動態
上傳時間： 2013-08-31
上傳用戶：pwcsoft
fpga實現ＣＡＮ總線控制器源碼,每個項目都有說明文件，介紹使用方法。
標簽： fpga CAN 總線控制器 源碼
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這是一個FPGA的實驗源碼，可以實現對一段音樂的播放。用Verilog語言編寫的，對初學者會有一定的幫助。
標簽： Verilog FPGA 音樂播放 實驗
上傳時間： 2013-09-01
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