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信道模擬

  • 微電腦型盤(pán)面式精密直流毫安電流,直流電壓,頻率(脈波)標(biāo)準(zhǔn)產(chǎn)生器

    特點(diǎn) 精確度0.05%滿刻度 可顯示與產(chǎn)生精密直流毫安電流,直流電壓,頻率(脈波) 可模擬90度相位差脈波輸出功能 高解析度類比輸出功能(15bit DAC) 類比輸出范圍0至20.000毫安培(0至10.000伏特) 寬范圍頻率輸出功能10Hz至4KHz 寬范圍脈波輸出功能1至10000個(gè) 尺寸小,穩(wěn)定性高

    標(biāo)簽: 微電腦 產(chǎn)生器 精密直流 電流

    上傳時(shí)間: 2013-11-03

    上傳用戶:yy_cn

  • Debussy是NOVAS Software, Inc(思源科技)發(fā)展的HDL Debug & Analysis tool

    Debussy是NOVAS Software, Inc(思源科技)發(fā)展的HDL Debug & Analysis tool,這套軟體主要不是用來(lái)跑模擬或看波形,它最強(qiáng)大的功能是:能夠在HDL source code、schematic diagram、waveform、state bubble diagram之間,即時(shí)做trace,協(xié)助工程師debug。 可能您會(huì)覺(jué)的:只要有simulator如ModelSim就可以做debug了,我何必再學(xué)這套軟體呢? 其實(shí)Debussy v5.0以後的新版本,還提供了nLint -- check coding style & synthesizable,這蠻有用的,可以協(xié)助工程師了解如何寫(xiě)好coding style,並養(yǎng)成習(xí)慣。 下圖所示為整個(gè)Debussy的原理架構(gòu),可歸納幾個(gè)結(jié)論:

    標(biāo)簽: Analysis Software Debussy Debug

    上傳時(shí)間: 2014-01-14

    上傳用戶:hustfanenze

  • 外部中斷模擬UART演示程序

    外部中斷模擬UART演示程序,只做過(guò)模擬仿真

    標(biāo)簽: UART 外部中斷 模擬 程序

    上傳時(shí)間: 2015-11-13

    上傳用戶:tianjinfan

  • 徑向基底函數(shù)類神經(jīng)網(wǎng)路

    徑向基底函數(shù)類神經(jīng)網(wǎng)路,是單隱藏層的3層前向網(wǎng)路,模擬人腦中局部調(diào)整,有很好的逼近能力

    標(biāo)簽:

    上傳時(shí)間: 2014-01-15

    上傳用戶:wanghui2438

  • sigma-delta ADC轉(zhuǎn)換之matlab模型

    sigma-delta ADC轉(zhuǎn)換之matlab模型,整個(gè)系統(tǒng)都可模擬。

    標(biāo)簽: sigma-delta matlab ADC 模型

    上傳時(shí)間: 2014-01-24

    上傳用戶:xjz632

  • SPI(serial port interface)的Verilog/VHDL源代碼

    SPI(serial port interface)的Verilog/VHDL源代碼,已模擬並驗(yàn)證。

    標(biāo)簽: interface Verilog serial port

    上傳時(shí)間: 2016-03-07

    上傳用戶:jichenxi0730

  • 一篇來(lái)自臺(tái)灣中華大學(xué)的論文--《無(wú)線射頻系統(tǒng)標(biāo)簽晶片設(shè)計(jì)》

    一篇來(lái)自臺(tái)灣中華大學(xué)的論文--《無(wú)線射頻系統(tǒng)標(biāo)簽晶片設(shè)計(jì)》,彩色版。其摘要為:本論文討論使用於無(wú)線射頻辨識(shí)系統(tǒng)(RFID)之標(biāo)籤晶片系統(tǒng)的電路設(shè)計(jì)和晶片製作,初步設(shè)計(jì)標(biāo)籤晶片的基本功能,設(shè)計(jì)流程包含數(shù)位軟體及功能的模擬、基本邏輯閘及類比電路的設(shè)計(jì)與晶片電路的佈局考量。 論文的第一部份是序論、射頻辨識(shí)系統(tǒng)的規(guī)劃、辨識(shí)系統(tǒng)的規(guī)格介紹及制定,而第二部份是標(biāo)籤晶片設(shè)計(jì)、晶片量測(cè)、結(jié)論。 電路的初步設(shè)計(jì)功能為:使用電容作頻率緩衝的Schmitt trigger Clock、CRC-16的錯(cuò)誤偵測(cè)編碼、Manchester編碼及使用單一電路做到整流、振盪及調(diào)變的功能,最後完成晶片的實(shí)作。

    標(biāo)簽: 大學(xué) 論文 無(wú)線射頻

    上傳時(shí)間: 2016-08-27

    上傳用戶:tb_6877751

  • 使用C#程式語(yǔ)言開(kāi)發(fā)

    使用C#程式語(yǔ)言開(kāi)發(fā),並執(zhí)行於.NET Framework下;是研習(xí)「蟻拓尋優(yōu)法」不可或缺的軟體工具。系統(tǒng)使用ACO (Ant Colony Optimization)演算公式模擬螞蟻的覓食行徑抉擇。使用者可以設(shè)定費(fèi)洛蒙和食物氣味強(qiáng)度等相關(guān)參數(shù)以及動(dòng)態(tài)設(shè)定障礙物的位置和形狀,研習(xí)螞蟻覓食的最短路徑形成過(guò)程。研習(xí)各種參數(shù)設(shè)定對(duì)螞蟻覓食行為的影響,了解費(fèi)落蒙機(jī)制對(duì)蟻拓尋優(yōu)化法的影響。本系統(tǒng)可支援柔性計(jì)算教學(xué),研習(xí)蟻拓優(yōu)化法中人工螞蟻的隨機(jī)搜尋模式和啟發(fā)式法則設(shè)計(jì)原理。

    標(biāo)簽: 程式

    上傳時(shí)間: 2013-12-24

    上傳用戶:anng

  • [Flash煙冒效果] Flash 8 後版本適用

    [Flash煙冒效果] Flash 8 後版本適用,利用新增濾鏡功能模擬煙冒效果。

    標(biāo)簽: Flash 版本

    上傳時(shí)間: 2017-02-28

    上傳用戶:yulg

  • Verilog HDL的程式

    Verilog HDL的程式,上網(wǎng)找到SPI程式, vspi.v這程式相當(dāng)好用可用來(lái)接收與傳送SPI,並且寫(xiě)了一個(gè)傳輸信號(hào)測(cè)試,spidatasent.v這程式就是傳送的資料,分別為00 66... 01 77...... 02 55這樣的資料,並透過(guò)MAX+PULS II軟體進(jìn)行模擬,而最外層的程式是test_createspi.v!

    標(biāo)簽: Verilog HDL 程式

    上傳時(shí)間: 2017-03-06

    上傳用戶:onewq

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