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  • 提供了拉普拉斯銳化(邊緣檢測)的實例程序和數據及結果

    ·詳細說明:本代碼提供了拉普拉斯銳化(邊緣檢測)的實例程序和數據及結果

    標簽: 拉普拉斯 實例程序 邊緣檢測 數據

    上傳時間: 2013-07-25

    上傳用戶:love1314

  • 基于FPGA模型化設計的雷達信號

    隨著現場可編程門陣列(FPGA)在工業中的廣泛應用,使得基于FPGA數字信號處理的實現在雷達信號處理中有著重要地位。模型化設計是一種自頂向下的面向FPGA的快速原型驗證法,它不僅降低了FPGA設計門檻,而且縮短了開發周期,提高了設計效率。這使得FPGA模型化設計成為了FPGA系統設計的發展趨勢。本文針對常見雷達信號處理模塊的FPGA模型化實現,在以下幾個方面展開研究:首先對基于FPGA的模型化設計方法進行了研究,給出了模型化設計方法的發展現狀和趨勢,并對本文中使用的模型化設計方法的軟件工具System Generator和AccelDSP進行了介紹。其次使用這兩種軟件工具對FIR濾波器進行了模型化設計并同RTL(寄存器傳輸級)設計方法進行對比,全面分析了模型化設計方法和RTL設計方法的優缺點。然后在簡明闡述雷達信號處理原理的基礎上,使用System Generator對數字下變頻(DDC)、脈沖壓縮、動目標顯示(MTI)及恒虛警(CFAR)處理等雷達信號處理模塊進行了自頂向下的模型化設計。在Simulink中進行了功能仿真驗證,生成了HDL代碼,并在Xilinx FPGA中進行了RTL的時序仿真分析。關鍵詞:雷達信號處理 FPGA 模型化設計 System Generator AccelDSP

    標簽: FPGA 模型 雷達信號

    上傳時間: 2013-07-25

    上傳用戶:zhangsan123

  • 神經網絡PID飛行控制算法的FPGA實現

    神經網絡控制算法作為一種比較成熟的智能控制算法,在空空導彈的理論研究中也得到了很多應用,但它的實際應用通常是通過軟件實現的,而軟件實現是串行執行指令,運行速度慢,可靠性低,很難滿足實際導彈制導系統實時性的要求。控制算法硬件實現的最大特點就是可提高控制算法的實時運算速度和可靠性。本課題針對導彈制導系統,以FPGA為硬件平臺研究神經網絡控制算法的硬件實現。本文首先對BP神經網絡算法思想進行了深入分析,并對BP網絡的各個階段進行了理論推導,最后對BP神經網絡PID飛行控制算法進行了研究和總結,為硬件實現提供了理論基礎。基于對上述理論的深入研究和分析,本文提出了一種適合FPGA實現該神經網絡控制算法的硬件實現模型。在該模型中,神經網絡各層之間采用串行執行數據方式,層間則采用并行運行方式,可有效提高系統的運算速度。由于模塊化、層次化的自頂向下的模塊化設計方法可有效減少錯誤的產生,是設計復雜大規模系統的理想設計方法。本文采用了此設計方法,通過把系統模塊化,對各個子模塊分別用VHDL硬件描述語言進行描述,并基于QUARTUS II軟件開發平臺進行綜合和仿真,直到達到研究設計要求。最后將仿真程序源代碼下載配置到具體的Cyclone II系列EP2C70 FPGA芯片中,應用于某實際導彈控制系統的研究。理論分析和實驗結果表明該神經網絡飛行控制算法的FPGA硬件實現是有效可行的,可滿足系統實時性的要求,為制導系統的實際工程實現提供了基礎。

    標簽: FPGA PID 神經網絡 飛行控制

    上傳時間: 2013-04-24

    上傳用戶:冇尾飛鉈

  • 語音識別:語音矢量化及算法及與原文件的矢量對比功能源代碼

    ·詳細說明:語音識別:語音矢量化及算法及與原文件的矢量對比功能源代碼文件列表:   BShvoice   ........\Debug   ........\dllSudx.h   ........\dllSudx.lib   ........\SHvoice.cpp   ........\SHvoice.dsp   ......

    標簽: 語音識別 語音 矢量化 矢量

    上傳時間: 2013-07-10

    上傳用戶:博雅abcd

  • PCB可制造性設計

    在pcb設計中,對于可制造性設計需要認真對待,值得大家學習

    標簽: PCB 可制造性

    上傳時間: 2013-06-07

    上傳用戶:dialouch

  • Verilog HDL高級數字設計

    ·作者:[美]Michael D.Ciletti出版社:電子工業出版社 內容簡介:本書通過大量完整的實例講解了使用VerilogHDL進行超大規模集成電路設計的結構化建模方法、關鍵步驟和設計驗證方法等實用內容。全書共分11章,涵蓋了建模、結構平衡、功能驗證、故障模擬和邏輯合成等關鍵問題,還有合成后設計確認、定時分析及可測性設計等內容。

    標簽: Verilog nbsp HDL 數字設計

    上傳時間: 2013-06-19

    上傳用戶:PresidentHuang

  • 數字集成電路與嵌入式內核系統可測試性設計(影印版)

    ·書中包括的索引使你能夠根據自己的需要,直接閱讀你所關注的內容。主要內容包括:設計核心,關注嵌入核心和嵌入存儲器;系統集成和超大規模集成電路的設計問題;AC掃描、正常速度掃描和嵌入式可測試性設計;內建、自測試、含內存BIST、邏輯BIST及掃描BIST;虛擬測試套接字和隔離測試 ·重用設計,包括重用和隔離測試;用VSIA和IEEE P1500標準處理測試問題。 書中穿插的整幅圖解直接來自作者的教學材

    標簽: 數字集成電路 嵌入式 內核

    上傳時間: 2013-04-24

    上傳用戶:sjb555

  • ssd1963初始化

    初始化SSD1963 STM32+SSD1963 驅動 4.3" LCD( 480*272) 初始化代碼,已調試通過。

    標簽: 1963 ssd 初始化

    上傳時間: 2013-05-17

    上傳用戶:W51631

  • proteus 7.10 漢化

    proteus 7.10 漢化文件ISIS.dll、ARES.dll

    標簽: proteus 7.10 漢化

    上傳時間: 2013-04-24

    上傳用戶:huxz911

  • Protel_99_se_sch漢化注釋及教程

    漢化注釋,可以對所有的排列項進行詳細解釋,實用,實戰。。。

    標簽: Protel se_sch 99 漢化

    上傳時間: 2013-07-24

    上傳用戶:xymbian

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